ZHCSPD3A
december 2022 – june 2023
AFE8000
,
AFE8004
,
AFE8010
PRODUCTION DATA
1
1
特性
2
应用
3
说明
4
Functional Block Diagram
5
Revision History
6
Device and Documentation Support
6.1
Documentation Support
6.1.1
Related Documentation
6.2
接收文档更新通知
6.3
支持资源
6.4
Trademarks
6.5
静电放电警告
6.6
术语表
7
Mechanical, Packaging, and Orderable Information
封装选项
机械数据 (封装 | 引脚)
ABJ|400
MCBG079C
ALK|400
MPBGAU3B
散热焊盘机械数据 (封装 | 引脚)
订购信息
zhcspd3a_oa
zhcspd3a_pm
1
特性
申请完整数据表
AFE80xx 版本:
AFE8000:8 TX,10 RX
AFE8004:4 TX,4 RX
AFE8010:10 RX
12GSPS 射频采样 DAC
4GSPS 射频取样 ADC
最大射频信号带宽:
TX:800MHz(8 通道)或 1.2GHz(4 通道)
RX:800MHz(8 通道)或 400MHz(8 通道)+ 800MHz(2 通道)
射频频率范围:
TX:5MHz 至 7.125GHz
RX:100MHz 至 7.125GHz
数字步进衰减器 (DSA):
TX:40dB 范围,1dB 模拟和 0.125dB 数字步进
RX/FB:25dB 范围,1dB 步进
单频带或双频带 DUC、DDC
每链两个 NCO,支持快速频率切换
通过在 TX 和 RX 之间快速切换来支持 TDD 操作
用于生成 DAC/ADC 时钟的内部 PLL/VCO
DAC 或 ADC 速率下的可选外部 CLK
串行器/解串器数据接口:
JESD204B 和 JESD204C
8 个高达 32.5Gbps 的串行器/解串器收发器
8b/10b 和 64b/66b 编码
12 位、16 位、24 位和 32 位分辨率
子类 1 多器件同步
封装:
17mm × 17mm FCBGA,间距为 0.8mm
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