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ZHCSTX4A November 2023 – June 2024 AM625SIP

PRODUCTION DATA

请参考 PDF 数据表获取器件具体的封装图。

6.4 运行性能点

本节介绍了表 6-1 中器件的最大工作条件，以及表 6-2 中处理器时钟和器件内核时钟的每个运行性能点 (OPP)。

表 6-1 器件速度等级

速度等级	VDD_CORE (V)⁽¹⁾	最大工作频率 (MHz)								最大转换率 (MT/s)
速度等级	VDD_CORE (V)⁽¹⁾	A53SS (Cortex-A53x)	GPU	PRU	Main Infra (CBA)	MCUSS (Cortex-M4F)	器件/ 电源管理器 (Cortex-R5F)	SMS 子系统（两个 Cortex-M4F）	OCSRAM	LPDDR4
T	0.75/0.85	1250	500	333	250	400	400	400	400	1600
T	0.85	1400	500	333	250	400	400	400	400	1600

(1) 额定工作电压，请参阅建议运行条件。

表 6-2 器件运行性能点

OPP	A53SS⁽¹⁾	固定工作频率选项 (MHz)⁽²⁾							MT/s
OPP	A53SS⁽¹⁾	GPU	PRU	MAIN INFRA (CBA)	MCUSS	器件/ 电源管理器	SMS / SMS CBA	OCSRAM	LPDDR4
高	从 ARM0 PLL 旁路至速度等级最大值	500	333、 250 或 200	250	400 或 200	400	400	400	从 DDR PLL 旁路⁽³⁾ 至 1600
低	从 ARM0 PLL 旁路至速度等级最大值	不适用	333、 250 或 200	125	400 或 200	133	133	133	从 DDR PLL 旁路⁽³⁾ 至 1600

(1) 默认工作频率，在启动时由软件设置。支持启动后动态频率调节。

(2) 固定工作频率，在启动时由软件设置。

(3) 源自 DDR0_CK0 和 DDR0_CK0_n 的 DDR PLL 输出，通常以频率单位定义。因此，在旁路模式下运行时，“DDR PLL 旁路”事务速率等于 DDR PLL 输出频率的 2 倍。