ZHCSJ79D December   2018  – September 2024 AWR1843

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 功能方框图
  6. 5 器件比较
    1. 5.1 相关米6体育平台手机版_好二三四
  7. 6 端子配置和功能
    1. 6.1 引脚图
    2. 6.2 信号说明
      1. 6.2.1 信号说明 - 数字
      2. 6.2.2 信号说明 - 模拟
    3. 6.3 引脚属性
  8. 7 规格
    1. 7.1  绝对最大额定值
    2. 7.2  ESD 等级
    3. 7.3  上电小时数 (POH)
    4. 7.4  建议运行条件
    5. 7.5  电源规格
    6. 7.6  功耗摘要
    7. 7.7  射频规格
    8. 7.8  CPU 规格
    9. 7.9  FCBGA 封装的热阻特性 [ABL0161]
    10. 7.10 时序和开关特性
      1. 7.10.1  电源时序和复位时序
      2. 7.10.2  输入时钟和振荡器
        1. 7.10.2.1 时钟规格
      3. 7.10.3  多缓冲/标准串行外设接口 (MibSPI)
        1. 7.10.3.1 外设说明
        2. 7.10.3.2 MibSPI 发送和接收 RAM 组织结构
          1. 7.10.3.2.1 SPI 时序条件
          2. 7.10.3.2.2 SPI 控制器模式开关参数（时钟相位 = 0、SPICLK = 输出、SPISIMO = 输出和 SPISOMI = 输入） #GUID-C70CFB1F-161A-495B-85B8-62E1C643D037/T4362547-236 #GUID-C70CFB1F-161A-495B-85B8-62E1C643D037/T4362547-237 #GUID-C70CFB1F-161A-495B-85B8-62E1C643D037/T4362547-238
          3. 7.10.3.2.3 SPI 控制器模式开关参数（时钟相位 = 1、SPICLK = 输出、SPISIMO = 输出和 SPISOMI = 输入） #GUID-F724BCC6-8F26-42C4-8723-451EDE9A36D3/T4362547-244 #GUID-F724BCC6-8F26-42C4-8723-451EDE9A36D3/T4362547-245 #GUID-F724BCC6-8F26-42C4-8723-451EDE9A36D3/T4362547-246
        3. 7.10.3.3 SPI 外设模式 I/O 时序
          1. 7.10.3.3.1 SPI 外设模式开关参数（SPICLK = 输入、SPISIMO = 输入和 SPISOMI = 输出） #GUID-1B5DE4C6-14B2-48EF-965D-3B03E1AE325B/T4362547-70 #GUID-1B5DE4C6-14B2-48EF-965D-3B03E1AE325B/T4362547-71 #GUID-1B5DE4C6-14B2-48EF-965D-3B03E1AE325B/T4362547-73
        4. 7.10.3.4 典型接口协议图（外设模式）
      4. 7.10.4  LVDS 接口配置
        1. 7.10.4.1 LVDS 接口时序
      5. 7.10.5  通用输入/输出
        1. 7.10.5.1 输出时序的开关特性与负载电容 (CL) 间的关系
      6. 7.10.6  控制器局域网接口 (DCAN)
        1. 7.10.6.1 DCANx TX 和 RX 引脚的动态特性
      7. 7.10.7  控制器局域网 - 灵活数据速率 (CAN-FD)
        1. 7.10.7.1 CANx TX 和 RX 引脚的动态特性
      8. 7.10.8  串行通信接口 (SCI)
        1. 7.10.8.1 SCI 时序要求
      9. 7.10.9  内部集成电路接口 (I2C)
        1. 7.10.9.1 I2C 时序要求 #GUID-36963FBF-DA1A-4FF8-B71D-4A185830E708/T4362547-185
      10. 7.10.10 四线串行外设接口 (QSPI)
        1. 7.10.10.1 QSPI 时序条件
        2. 7.10.10.2 QSPI 输入（读取）时序的时序要求 #GUID-6DC69BBB-F187-4499-AC42-8C006552DEE1/T4362547-210 #GUID-6DC69BBB-F187-4499-AC42-8C006552DEE1/T4362547-209
        3. 7.10.10.3 QSPI 开关特性
      11. 7.10.11 ETM 跟踪接口
        1. 7.10.11.1 ETMTRACE 时序条件
        2. 7.10.11.2 ETM 跟踪开关特性
      12. 7.10.12 数据修正模块 (DMM)
        1. 7.10.12.1 DMM 时序要求
      13. 7.10.13 JTAG 接口
        1. 7.10.13.1 JTAG 时序条件
        2. 7.10.13.2 IEEE 1149.1 JTAG 的时序要求
        3. 7.10.13.3 IEEE 1149.1 JTAG 在推荐工作条件下的开关特性
  9. 8 详细说明
    1. 8.1 概述
    2. 8.2 功能方框图
    3. 8.3 子系统
      1. 8.3.1 射频和模拟子系统
        1. 8.3.1.1 时钟子系统
        2. 8.3.1.2 发送子系统
        3. 8.3.1.3 接收子系统
      2. 8.3.2 处理器子系统
      3. 8.3.3 汽车接口
      4. 8.3.4 主子系统 Cortex-R4F 存储器映射
      5. 8.3.5 DSP 子系统存储器映射
    4. 8.4 其他子系统
      1. 8.4.1 用于用户应用的 ADC 通道（服务）
        1. 8.4.1.1 GP-ADC 参数
  10. 9 监控和诊断
    1. 9.1 监测和诊断机制
      1. 9.1.1 错误信令模块
  11. 10应用、实施和布局
    1. 10.1 应用信息
    2. 10.2 短距离和中距离雷达
    3. 10.3 参考原理图
  12. 11器件和文档支持
    1. 11.1 器件命名规则
    2. 11.2 工具与软件
    3. 11.3 文档支持
    4. 11.4 支持资源
    5. 11.5 商标
    6. 11.6 静电放电警告
    7. 11.7 术语表
  13. 12修订历史记录
  14. 13机械、封装和可订购信息
    1. 13.1 封装信息
    2. 13.2 的托盘信息

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • ABL|161
散热焊盘机械数据 (封装 | 引脚)
订购信息

6.2.2 信号说明 - 模拟

接口信号名称引脚类型说明焊球编号
发送器TX1O单端发送器 1 输出B4
TX2O单端发送器 2 输出B6
TX3O单端发送器 3 输出B8
接收器RX1I单端接收器 1 输入M2
RX2I单端接收器 2 输入K2
RX3I单端接收器 3 输入H2
RX4I单端接收器 4 输入F2
复位NRESETI芯片的上电复位。低电平有效R3
基准振荡器CLKPI在 XTAL 模式下：基准晶体的输入
在外部时钟模式下：单端输入基准时钟端口		B15
CLKMI在 XTAL 模式下：：基准晶体的反馈驱动
在外部时钟模式下：将此端口接地		C15
基准时钟OSC_CLKOUTO清理 PLL 后时钟子系统的基准时钟输出（1.4V 输出电压摆幅）。A14
带隙电压VBGAPO器件的带隙基准输出B10
电源VDDIN电源1.2V 数字电源H15、N11、P15、R6
VIN_SRAM电源用于内部 SRAM 的 1.2V 电源轨G15
VNWA电源用于 SRAM 阵列反馈偏置的 1.2V 电源轨P14
VIOIN电源I/O 电源（3.3V 或 1.8V）：所有 CMOS I/O 都将在此电源上运行R10、F15
VIOIN_18电源用于 CMOS IO 的 1.8V 电源R9
VIN_18CLK电源用于时钟模块的 1.8V 电源B11
VIOIN_18DIFF电源用于 LVDS 端口的 1.8V 电源D15
VPP电源保险丝链的电压电源L13
电源VIN_13RF1电源1.3V 模拟和射频电源，VIN_13RF1 和 VIN_13RF2 可以在电路板上短接G5、H5、J5
VIN_13RF2电源1.3V 模拟和射频电源C2、D2
VIN_18BB电源1.8V 模拟基带电源K5、F5
VIN_18VCO电源1.8V 射频 VCO 电源B12
VSS地数字地L5、L6、L8、L10、K7、K8、K9、K10、K11、J6、J7、J8、J10、H7、H9、H11、G6、G7、G8、G10、F9、F11、E5、E6、E8、E10、E11、R15
VSSA地模拟地A1、A3、A5、A7、A15、B1、B3、B5、B7、C1、C3、C4、C5、C6、C7、E1、E2、E3、F3、G1、G2、G3、H3、J1、J2、J3、K3、L1、L2、L3、M3、N1、N2、N3、R1、A13、C8、A9、B9、C9、B14、C14
内部 LDO 输出/输入VOUT_14APLLO内部 LDO 输出A10
VOUT_14SYNTHO内部 LDO 输出B13
VOUT_PAIO在使用内部 PA LDO 时，该引脚提供 LDO 的输出电压。在绕过并禁用内部 PA LDO 时，应在该引脚上馈送 1V 电源电压。在 3TX 同时使用的情况下，这是强制性的。A2、B2
预量产阶段的测试和调试输出。可以在生产硬件上用引脚输出信号，以用于现场调试模拟测试 1/ADC1IOADC 通道 1(1)P1
模拟测试 2/ADC2IOADC 通道 2(1)P2
模拟测试 3/ADC3IOADC 通道 3(1)P3
模拟测试 4/ADC4IOADC 通道 4(1)R2
ANAMUX/ADC5IOADC 通道 5(1)C13
VSENSE/ADC6IOADC 通道 6(1)D14
(1) 相关详细信息，请参阅节 8.4.1。
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