ZHCSS92A September   2024  – October 2024 DLPC8445

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
    1.     6
    2. 4.1  初始化、板级测试和调试
    3. 4.2  V-by-One 接口输入数据和控制
    4. 4.3  FPD Link 端口输入数据和控制（DLPC8445 和 DLPC8445V 不支持）
    5. 4.4  DSI 输入数据和时钟（DLPC8445 和 DLPC8445V 不支持）
    6. 4.5  DMD SubLVDS 接口
    7. 4.6  DMD 复位和低速接口
    8. 4.7  闪存接口
    9. 4.8  外设接口
    10. 4.9  GPIO 外设接口
    11. 4.10 时钟和 PLL 支持
    12. 4.11 电源和接地
    13. 4.12 I/O 类型下标定义
    14. 4.13 内部上拉和下拉电阻器特性
  6. 5 规格
    1. 5.1  绝对最大额定值
    2.     22
    3. 5.2  ESD 等级
    4. 5.3  建议运行条件
    5. 5.4  热性能信息
    6. 5.5  电源电气特性
    7. 5.6  引脚电气特性
    8. 5.7  DMD SubLVDS 接口电气特性
    9.     29
    10. 5.8  DMD 低速接口电气特性
    11.     31
    12. 5.9  V-by-One 接口电气特性
    13. 5.10 USB 电气特性
    14.     34
    15. 5.11 系统振荡器时序要求
    16.     36
    17. 5.12 电源和复位时序要求
    18.     38
    19. 5.13 V-by-One 接口一般时序要求
    20.     40
    21. 5.14 闪存接口时序要求
    22.     42
    23. 5.15 源帧时序要求
    24.     44
    25. 5.16 同步串行端口接口时序要求
    26.     46
    27. 5.17 I2C 接口时序要求
    28. 5.18 可编程输出时钟时序要求
    29. 5.19 JTAG 边界扫描接口时序要求（仅限调试）
    30.     50
    31. 5.20 DMD 低速接口时序要求
    32.     52
    33. 5.21 DMD SubLVDS 接口时序要求
  7. 6 详细说明
    1. 6.1 概述
    2. 6.2 功能方框图
    3. 6.3 特性说明
      1. 6.3.1 输入源
      2. 6.3.2 V-by-One 接口
      3. 6.3.3 DMD (SubLVDS) 接口
      4. 6.3.4 串行闪存接口
      5. 6.3.5 GPIO 支持的功能
        1.       63
        2.       64
      6. 6.3.6 调试支持
  8. 7 电源相关建议
    1. 7.1 系统上电和断电序列
    2. 7.2 DMD 快速停止控制 (PARKZ)
    3. 7.3 电源管理
    4. 7.4 热插拔用法
    5. 7.5 未使用的输入源接口的电源
    6. 7.6 电源
      1. 7.6.1 DLPA3085 或 DLPA3082 电源
  9. 8 布局
    1. 8.1 布局指南
      1. 8.1.1 DLPC8445 或 DLPC8445V 基准时钟布局指南
        1. 8.1.1.1 建议的晶体振荡器配置
      2. 8.1.2 V-by-One 接口布局注意事项
      3. 8.1.3 最大引脚对引脚 PCB 互连蚀刻长度
      4. 8.1.4 电源布局指南
    2. 8.2 散热注意事项
  10. 9 器件和文档支持
    1. 9.1 第三方米6体育平台手机版_好二三四免责声明
    2. 9.2 文档支持
      1. 9.2.1 相关文档
    3. 9.3 接收文档更新通知
    4. 9.4 支持资源
    5. 9.5 器件命名规则
      1. 9.5.1 器件标识
    6. 9.6 商标
    7. 9.7 静电放电警告
    8. 9.8 术语表
      1. 9.8.1 视频时序参数定义
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

6.3.3 DMD (SubLVDS) 接口

控制器 DMD 接口支持四个用于数据传输的高速 SubLVDS 仅输出接口、一个用于命令写入事务的单端低速 LVDS 仅输出接口以及四个用于命令读取事务的低速单端输入接口。每个 SubLVDS 端口都支持端口内仅传输完整数据的通道间重映射，但不支持端口之间的重映射。使用此特性时，每个唯一数据通道对只能映射到一个唯一目标数据通道对，并且不支持通道内重映射（即 P 与 N 交换）。此外，也可以交换四个 HS 数据端口。HS CLK 引脚在端口之间不可互换，必须与相应的端口数据通道组合在一起。通道和端口重映射（在闪存中指定）有助于根据需要进行电路板布局布线。所需的 HS 端口数和每个 HS 端口的 HS 通道数取决于 DMD 类型和 DMD 显示分辨率。表 6-9 显示了两个 HS 端口配置的一些重映射示例，相同的规则最多适用于四个 HS 端口。使用所有端口时，它们无需相同的引脚映射。

表 6-9 控制器到 DMD 引脚映射示例
DLPC8445 和 DLPC8445V 控制器引脚 - 到 DMD 引脚的重映射示例DMD 引脚
基线翻转 HS0 180
无翻转 HS1		将 HS0 端口交换为 HS1 端口将 HS0 端口交换为 HS1 端口和混合重映射
DMD_HS0_CLK_P
DMD_HS0_CLK_N		DMD_HS0_CLK_P
DMD_HS0_CLK_N		DMD_HS1_CLK_P
DMD_HS1_CLK_N		DMD_HS1_CLK_P
DMD_HS1_CLK_N		DCLK_AP
DCLK_AN
DMD_HS0_WDATA0_P
DMD_HS0_WDATA0_N		DMD_HS0_WDATA7_P
DMD_HS0_WDATA7_N		DMD_HS1_WDATA0_P
DMD_HS1_WDATA0_N		DMD_HS1_WDATA2_P
DMD_HS1_WDATA2_N		D_AP(0)
D_AN(0)
DMD_HS0_WDATA1_P
DMD_HS0_WDATA1_N		DMD_HS0_WDATA6_P
DMD_HS0_WDATA6_N		DMD_HS1_WDATA1_P
DMD_HS1_WDATA1_N		DMD_HS1_WDATA3_P
DMD_HS1_WDATA3_N		D_AP(1)
D_AN(1)
DMD_HS0_WDATA2_P
DMD_HS0_WDATA2_N		DMD_HS0_WDATA5_P
DMD_HS0_WDATA5_N		DMD_HS1_WDATA2_P
DMD_HS1_WDATA2_N		DMD_HS1_WDATA0_P
DMD_HS1_WDATA0_N		D_AP(2)
D_AN(2)
DMD_HS0_WDATA3_P
DMD_HS0_WDATA3_N		DMD_HS0_WDATA4_P
DMD_HS0_WDATA4_N		DMD_HS1_WDATA3_P
DMD_HS1_WDATA3_N		DMD_HS1_WDATA1_P
DMD_HS1_WDATA1_N		D_AP(3)
D_AN(3)
DMD_HS0_WDATA4_P
DMD_HS0_WDATA4_N		DMD_HS0_WDATA3_P
DMD_HS0_WDATA3_N		DMD_HS1_WDATA4_P
DMD_HS1_WDATA4_N		DMD_HS1_WDATA6_P
DMD_HS1_WDATA6_N		D_AP(4)
D_AN(4)
DMD_HS0_WDATA5_P
DMD_HS0_WDATA5_N		DMD_HS0_WDATA2_P
DMD_HS0_WDATA2_N		DMD_HS1_WDATA5_P
DMD_HS1_WDATA5_N		DMD_HS1_WDATA7_P
DMD_HS1_WDATA7_N		D_AP(5)
D_AN(5)
DMD_HS0_WDATA6_P
DMD_HS0_WDATA6_N		DMD_HS0_WDATA1_P
DMD_HS0_WDATA1_N		DMD_HS1_WDATA6_P
DMD_HS1_WDATA6_N		DMD_HS1_WDATA4_P
DMD_HS1_WDATA4_N		D_AP(6)
D_AN(6)
DMD_HS0_WDATA7_P
DMD_HS0_WDATA7_N		DMD_HS0_WDATA0_P
DMD_HS0_WDATA0_N		DMD_HS1_WDATA7_P
DMD_HS1_WDATA7_N		DMD_HS1_WDATA5_P
DMD_HS1_WDATA5_N		D_AP(7)
D_AN(7)
DMD_HS1_CLK_P
DMD_HS1_CLK_N		DMD_HS1_CLK_P
DMD_HS1_CLK_N		DMD_HS0_CLK_P
DMD_HS0_CLK_N		DMD_HS0_CLK_P
DMD_HS0_CLK_N		DCLK_BP
DCLK_BN
DMD_HS1_WDATA0_P
DMD_HS1_WDATA0_N		DMD_HS1_WDATA0_P
DMD_HS1_WDATA0_N		DMD_HS0_WDATA0_P
DMD_HS0_WDATA0_N		DMD_HS0_WDATA6_P
DMD_HS0_WDATA6_N		D_BP(0)
D_BN(0)
DMD_HS1_WDATA1_P
DMD_HS1_WDATA1_N		DMD_HS1_WDATA1_P
DMD_HS1_WDATA1_N		DMD_HS0_WDATA1_P
DMD_HS0_WDATA1_N		DMD_HS0_WDATA7_P
DMD_HS0_WDATA7_N		D_BP(1)
D_BN(1)
DMD_HS1_WDATA2_P
DMD_HS1_WDATA2_N		DMD_HS1_WDATA2_P
DMD_HS1_WDATA2_N		DMD_HS0_WDATA2_P
DMD_HS0_WDATA2_N		DMD_HS0_WDATA4_P
DMD_HS0_WDATA4_N		D_BP(2)
D_BN(2)
DMD_HS1_WDATA3_P
DMD_HS1_WDATA3_N		DMD_HS1_WDATA3_P
DMD_HS1_WDATA3_N		DMD_HS0_WDATA3_P
DMD_HS0_WDATA3_N		DMD_HS0_WDATA5_P
DMD_HS0_WDATA5_N		D_BP(3)
D_BN(3)
DMD_HS1_WDATA4_P
DMD_HS1_WDATA4_N		DMD_HS1_WDATA4_P
DMD_HS1_WDATA4_N		DMD_HS0_WDATA4_P
DMD_HS0_WDATA4_N		DMD_HS0_WDATA2_P
DMD_HS0_WDATA2_N		D_BP(4)
D_BN(4)
DMD_HS1_WDATA5_P
DMD_HS1_WDATA5_N		DMD_HS1_WDATA5_P
DMD_HS1_WDATA5_N		DMD_HS0_WDATA5_P
DMD_HS0_WDATA5_N		DMD_HS0_WDATA3_P
DMD_HS0_WDATA3_N		D_BP(5)
D_BN(5)
DMD_HS1_WDATA6_P
DMD_HS1_WDATA6_N		DMD_HS1_WDATA6_P
DMD_HS1_WDATA6_N		DMD_HS0_WDATA6_P
DMD_HS0_WDATA6_N		DMD_HS0_WDATA0_P
DMD_HS0_WDATA0_N		D_BP(6)
D_BN(6)
DMD_HS1_WDATA7_P
DMD_HS1_WDATA7_N		DMD_HS1_WDATA7_P
DMD_HS1_WDATA7_N		DMD_HS0_WDATA7_P
DMD_HS0_WDATA7_N		DMD_HS0_WDATA1_P
DMD_HS0_WDATA1_N		D_BP(7)
D_BN(7)
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