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ZHCSS92A September 2024 – October 2024 DLPC8445

PRODUCTION DATA

封装选项

机械数据 (封装 | 引脚)

AMD|484
- MPBC006C

散热焊盘机械数据 (封装 | 引脚)

订购信息

5.16 同步串行端口接口时序要求

参数			最小值	最大值	单位
SSP0 主机
F_CLK	SSP*_CLK 频率	广播写入传输 ⁽¹⁾ ⁽²⁾	0.457	75	MHz
F_CLK	SSP*_CLK 频率	全双工 SPI 传输	0.457	50	MHz
T_CLK	SSP*_CLK 时钟周期	广播写入传输 ⁽¹⁾ ⁽²⁾	13.33	2188	ns
T_CLK	SSP*_CLK 时钟周期	全双工 SPI 传输	20.00	2188	ns
t_HPW	SSP*_CLK 高电平/低电平脉冲宽度	广播写入传输 ⁽¹⁾ ⁽²⁾	6.0		ns
t_HPW	SSP*_CLK 高电平/低电平脉冲宽度	全双工 SPI 传输	9.2		ns
t_LPW	SSP*_CLK 高电平/低电平脉冲宽度	广播写入传输 ⁽¹⁾ ⁽²⁾	6.0		ns
t_LPW	SSP*_CLK 高电平/低电平脉冲宽度	全双工 SPI 传输	9.2		ns
t_S	SSP*_DI 输入建立时间	在 SSP*_CLK ↓ 之前（模式 0 和 3） ⁽²⁾	9.4		ns
t_S	SSP*_DI 输入建立时间	在 SSP*_CLK ↑ 之前（模式 1 和 2）	9.4		ns
t_H	SSP*_DI 输入保持时间	在 SSP*_CLK ↓ 之前（模式 0 和 3） ⁽²⁾	0		ns
t_H	SSP*_DI 输入保持时间	在 SSP*_CLK ↑ 之前（模式 1 和 2）	0		ns
t_DOUT	SSP*_DO 输出延迟 ⁽²⁾	在 SSP*_CLK ↓ 之后（模式 0 和 3）	-2.5	2.5	ns
		在 SSP*_CLK ↑ 之后（模式 1 和 2）	-2.5	2.5	ns
		在 SSP*_(B)CSZ ↓ 之后（模式 0 和 2）	-2.5	2.5	ns
		在 SSP*_(B)CSZ ↑ 之后（模式 1 和 3）	-2.5	2.5	ns
SSP1 目标方
t_CSZD	在 SPI 传输之间 SSP_(B)CSZ 被置为无效（即高电平）的时间 ⁽³⁾		13.33		ns
t_CSS	SSP_(B)CSZ 输入建立时间 ⁽⁴⁾	在 SSP_CLK ↑ 之前 SSP_(B)CSZ ↓（模式 0 和 1）	6.0		ns
t_CSS	SSP_(B)CSZ 输入建立时间 ⁽⁴⁾	在 SSP_CLK ↓ 之前 SSP_(B)CSZ ↓（模式 2 和 3）	6.0		ns
t_CSH	SSP_(B)CSZ 输入建立时间 ⁽⁴⁾	在 SSP_CLK ↓ 之后 SSP_(B)CSZ ↑（模式 0 和 1）	6.0		ns
t_CSH	SSP_(B)CSZ 输入建立时间 ⁽⁴⁾	在 SSP_CLK ↑ 之后 SSP_(B)CSZ ↑（模式 2 和 3）	6.0		ns
t_S	SSP*_DI 输入建立时间	在 SSP*_CLK ↑ 之前（模式 0 和 3）	2.5		ns
t_S	SSP*_DI 输入建立时间	在 SSP*_CLK ↓ 之前（模式 1 和 2）	2.5
t_H	SSP*_DI 输入保持时间	在 SSP*_CLK ↑ 之前（模式 0 和 3）	2.5		ns
t_H	SSP*_DI 输入保持时间	在 SSP*_CLK ↓ 之前（模式 1 和 2）	2.5		ns
t_DOUT	SSP*_DO 输出延迟	在 SSP*_CLK ↓ 之后（模式 0 和 3）	0	8.0	ns
		在 SSP*_CLK ↑ 之后（模式 1 和 2）	0	8.0	ns
		在 SSP*_CSZ ↓ 之后（模式 0 和 3）	0	8.0	ns
		在 SSP*_CSZ ↑ 之后（模式 1 和 2）	0	8.0	ns

(1) 广播写入传输是半双工传输，其中 SSP 主机输出 SSP*_DO，但不接收任何 SSP*_DI 输入；因此，在广播写入传输期间，SSP*_DI 输入建立/保持时间检查不适用。

(2) 外设接口中显示了适用于 SSP0 和 SSP1 SPI 接口的控制器引脚。

(3) 至少 1 个 SSP*_CLK 周期

(4) 至少 0.5 个 SSP*_CLK 周期