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ZHCSN95A August 2022 – December 2022 DRV8452

PRODUCTION DATA

图 7-73 展示了 CTRL13，表 7-54 中对此进行了介绍。

读/写

图 7-73 CTRL13 控制寄存器

表 7-54 CTRL13 控制寄存器字段说明

位	字段	类型	默认值	说明
7-2	TSTSL_DLY[5:0]	R/W	000100b	控制最后一个 STEP 脉冲和激活静止省电模式之间的延迟。 000000b：被保留 000001b：延迟 = 1 x 16ms = 16ms ............ 000100b：延迟 = 4 x 16ms = 64ms ............ 111111b：延迟 = 63 x 16ms = 1.008s
1	VREF_INT_EN	R/W	0b	当该位为 1b 时，器件使用内部 3.3V 基准进行电流调节，并忽略 VREF 引脚上的电压。
0	RSVD	R/W	0b	保留

位

字段

类型

默认值

说明

7-2

TSTSL_DLY[5:0]

R/W

000100b

控制最后一个 STEP 脉冲和激活静止省电模式之间的延迟。

VREF_INT_EN

R/W

当该位为 1b 时，器件使用内部 3.3V 基准进行电流调节，并忽略 VREF 引脚上的电压。

RSVD

R/W

保留

注：

请勿将 TSTSL_DLY 设置为 000000b。