ZHCSKG2B September   2016  – October 2019 DS280BR820

PRODUCTION DATA.  

  1. 1 特性
  2. 2 应用
  3. 3 说明
    1.     简化电路原理图
  4. 4 修订历史记录
  5. 5 Pin Configuration and Functions
    1.     Pin Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Electrical Characteristics – Serial Management Bus Interface
    7. 6.7 Timing Requirements – Serial Management Bus Interface
    8. 6.8 Typical Characteristics
  7. 7 Detailed Description
    1. 7.1 Overview
    2. 7.2 Functional Block Diagram
    3. 7.3 Feature Description
      1. 7.3.1 Device Data Path Operation
      2. 7.3.2 AC-Coupled Receiver Inputs
      3. 7.3.3 Signal Detect
      4. 7.3.4 2-Stage CTLE
      5. 7.3.5 Driver DC Gain Control
      6. 7.3.6 FIR Filter (Limiting Mode)
      7. 7.3.7 Configurable SMBus Address
    4. 7.4 Device Functional Modes
      1. 7.4.1 SMBus Slave Mode Configuration
      2. 7.4.2 SMBus Master Mode Configuration (EEPROM Self Load)
    5. 7.5 Programming
      1. 7.5.1 Transfer of Data with the SMBus Interface
    6. 7.6 Register Maps
      1. 7.6.1 Register Types: Global, Shared, and Channel
      2. 7.6.2 Global Registers: Channel Selection and ID Information
        1. Table 2. Global Register Map
      3. 7.6.3 Shared Registers
        1. Table 3. Shared Register Map
      4. 7.6.4 Channel Registers
        1. Table 4. Channel Register Map
  8. 8 Application and Implementation
    1. 8.1 Application Information
    2. 8.2 Typical Applications
      1. 8.2.1 Backplane and Mid-Plane Reach Extension
        1. 8.2.1.1 Design Requirements
        2. 8.2.1.2 Detailed Design Procedure
      2. 8.2.2 Front-Port Applications
        1. 8.2.2.1 Design Requirements
        2. 8.2.2.2 Detailed Design Procedure
      3. 8.2.3 Application Curves
        1. 8.2.3.1 Pattern Generator Characteristics
        2. 8.2.3.2 Equalizing Moderate Pre-Channel Loss
        3. 8.2.3.3 Equalizing High Pre-Channel Loss
        4. 8.2.3.4 Equalizing High Pre-Channel Loss and Moderate Post-Channel Loss
        5. 8.2.3.5 Output in FIR Limiting Mode with 16T Pattern
    3. 8.3 Initialization Set Up
  9. 9 Power Supply Recommendations
  10. 10Layout
    1. 10.1 Layout Guidelines
    2. 10.2 Layout Examples
      1. 10.2.1 Stripline Example
      2. 10.2.2 Microstrip Example
  11. 11器件和文档支持
    1. 11.1 文档支持
      1. 11.1.1 相关文档
    2. 11.2 接收文档更新通知
    3. 11.3 商标
    4. 11.4 静电放电警告
    5. 11.5 Glossary

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

3 说明

DS280BR820 是一款超低功耗、高性能八通道线性均衡器，支持数据传输速率高达 28Gbps 的多速率、多协议接口。该器件可用于扩展长度范围并提高背板、前端口和芯片至芯片应用的高速串行链路的稳定性。 应用。

DS280BR820 均衡器的线性特质保留了发射信号的特性，因此允许主机与链路合作伙伴 ASIC 自由协商发射均衡器系数 (100G-CR4/KR4)。这种链路协商协议的透明管理有助于在对延迟影响最小的情况下实现系统级互操作性。每条通道独立运行，允许 DS280BR820 进行独立信道前向纠错 (FEC)。

DS280BR820 将小型封装尺寸、经优化的高速信号退出和引脚兼容的重定时器相结合，使其成为高密度背板应用的 理想选择。。凭借简化的均衡控制、低功耗和超低附加抖动特性，该器件适用于 100G-SR4/LR4/CR4 等前端接口。8mm x 13mm 小型封装适用于 QSFP、SFP、CFP2、CFP4 和 CDFP 等多种标准前端口连接器，并且无需散热器。

集成交流耦合电容（Rx 侧）免除了集成电路板 (PCB) 对于外部电容的需求。DS280BR820 具备一个单电源，能够最大限度地降低外部组件的数量。这些 特性 降低了 PCB 布局布线复杂度以及物料清单 (BOM) 成本。

引脚兼容的重定时器可用于距离较长的 应用。

DS280BR820 可通过 SMBus 或外部 EEPROM 进行配置。单个 EEPROM 最多可由 16 个器件共享。

器件信息 (1)

器件型号 封装 封装尺寸（标称值）
DS280BR820 nFBGA (135) 8.0mm x 13.0mm
  1. 如需了解所有可用封装，请参阅数据表末尾的可订购米6体育平台手机版_好二三四附录。

简化电路原理图

DS280BR820 schematic_page1_externalCaps.gif
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