ZHCSDB4B MARCH   2013  – January 2015 DS90UH928Q-Q1

PRODUCTION DATA.  

  1. 1 特性
  2. 2 应用范围
  3. 3 说明
  4. 4 应用图
  5. 5 修订历史记录
  6. 6 Pin Configuration and Functions
  7. 7 Specifications
    1. 7.1  Absolute Maximum Ratings
    2. 7.2  ESD Ratings
    3. 7.3  Recommended Operating Conditions
    4. 7.4  Thermal Information
    5. 7.5  DC Electrical Characteristics
    6. 7.6  AC Electrical Characteristics
    7. 7.7  Timing Requirements for the Serial Control Bus
    8. 7.8  Timing Requirements
    9. 7.9  DC and AC Serial Control Bus Characteristics
    10. 7.10 Typical Characteristics
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1  High Speed Forward Channel Data Transfer
      2. 8.3.2  Low Speed Back Channel Data Transfer
      3. 8.3.3  Backward Compatible Mode
      4. 8.3.4  Input Equalization
      5. 8.3.5  Common Mode Filter Pin (CMF)
      6. 8.3.6  Power Down (PDB)
      7. 8.3.7  Video Control Signals
      8. 8.3.8  EMI Reduction Features
        1. 8.3.8.1 LVCMOS VDDIO Option
      9. 8.3.9  Built In Self Test (BIST)
        1. 8.3.9.1 BIST Configuration and Status
          1. 8.3.9.1.1 Sample BIST Sequence
        2. 8.3.9.2 Forward Channel and Back Channel Error Checking
      10. 8.3.10 Internal Pattern Generation
        1. 8.3.10.1 Pattern Options
        2. 8.3.10.2 Color Modes
        3. 8.3.10.3 Video Timing Modes
        4. 8.3.10.4 External Timing
        5. 8.3.10.5 Pattern Inversion
        6. 8.3.10.6 Auto Scrolling
        7. 8.3.10.7 Additional Features
      11. 8.3.11 Image Enhancement Features
        1. 8.3.11.1 White Balance
          1. 8.3.11.1.1 LUT Contents
          2. 8.3.11.1.2 Enabling White Balance
        2. 8.3.11.2 Adaptive Hi-FRC Dithering
      12. 8.3.12 Serial Link Fault Detect
      13. 8.3.13 Oscillator Output
      14. 8.3.14 Interrupt Pin (INTB)
      15. 8.3.15 General-Purpose I/O
        1. 8.3.15.1 GPIO[3:0]
        2. 8.3.15.2 GPIO[8:5]
      16. 8.3.16 I2S Audio Interface
        1. 8.3.16.1 I2S Transport Modes
        2. 8.3.16.2 I2S Repeater
        3. 8.3.16.3 I2S Jitter Cleaning
        4. 8.3.16.4 MCLK
    4. 8.4 Device Functional Modes
      1. 8.4.1 Clock and Output Status
      2. 8.4.2 FPD-Link Input Frame and Color Bit Mapping Select
      3. 8.4.3 Low Frequency Optimization (LFMODE)
      4. 8.4.4 Mode Select (MODE_SEL)
      5. 8.4.5 Repeater Connections
        1. 8.4.5.1 Repeater Fan-Out Electrical Requirements
      6. 8.4.6 HDCP I2S Audio Encryption
      7. 8.4.7 Repeater Configuration
    5. 8.5 Programming
      1. 8.5.1 Serial Control Bus
    6. 8.6 Register Maps
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Transmission Media
        2. 9.2.2.2 Display Application
      3. 9.2.3 Application Curves
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
      1. 11.1.1 CML Interconnect Guidelines
    2. 11.2 Layout Example
  12. 12器件和文档支持
    1. 12.1 文档支持
      1. 12.1.1 相关文档　
    2. 12.2 商标
    3. 12.3 静电放电警告
    4. 12.4 术语表
  13. 13机械封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

1 特性

  • 支持片载密钥存储的集成型 HDCP 密码引擎
  • 支持 HDCP 中继器应用
  • 双向控制通道接口，可连接到 I2C 兼容串行控制总线
  • 低电磁干扰 (EMI) FPD-Link 视频输出
  • 支持高清 (720p) 数字视频
  • 支持 RGB888 + VS，HS，DE 和 I2S 音频
  • 支持 5MHz、85MHz 像素时钟
  • 多达 4 个针对环绕立体声应用的 I2S 数字音频输出
  • 4 条具有 2 个专用引脚的双向通用输入输出 (GPIO) 通道
  • 通过 1.8V 或 3.3V 兼容 LVCMOS I/O 接口实现 3.3V 单电源运行
  • 长达 10 米的交流耦合屏蔽双绞线 (STP) 互连
  • 具有嵌入式时钟的直流均衡和扰频数据
  • 自适应电缆均衡
  • 图像增强（白平衡和抖动）和内部图案生成
  • 汽车应用级米6体育平台手机版_好二三四：符合 AEC-Q100 2 级要求
  • >8kV 的人体模型 (HBM) 和 ISO 10605 静电放电 (ESD) 额定值
  • 向后兼容模式

2 应用范围

  • 汽车导航显示屏
  • 后座娱乐系统

3 说明

DS90UH928Q-Q1 解串器与 DS90UH925Q-Q1 或 DS90UH927Q-Q1 串行器配套使用，可针对汽车信息娱乐系统内的内容受保护数字视频的安全分发提供一套解决方案。。 该解串器借助嵌入式时钟（由单信号对 (FPD-Link III) 提供）将高速串行化接口数据转换为四个低压差分信令 (LVDS) 数据/控制流、一个 LVDS 时钟对 (FPD-Link) 以及 I2S 音频数据。 数字视频和音频数据采用业界标准的 HDCP 复制保护方案加以保护。FPD-Link III 串行总线方案支持通过单个差分链路实现高速正向通道数据传输和低速全双工反向通道通信。 通过单个差分对整合音频、视频和和控制数据可减小互连线尺寸和重量，同时还消除了偏差问题并简化了系统设计。

通过对串行输入数据流使用自适应输入均衡功能，可对传输介质损耗和确定性抖动进行补偿。 通过使用低压差分信令可最大限度减少电磁干扰 (EMI)。

串化器和解串器上都执行 HDCP 密钥引擎。 HDCP 密钥被存储在片载存储器中。

器件信息(1)

器件型号 封装 封装尺寸（标称值）
DS90UH928Q-Q1 WQFN (48) 7.00mm x 7.00mm
  1. 如需了解所有可用封装，请见数据表末尾的可订购米6体育平台手机版_好二三四附录。

4 应用图

DS90UH928Q-Q1 DS90UH928Q_TYP_APP.gif
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