在基准时钟符合条件并可供 DPLL 选择之前，独立监控每个 DPLL 基准时钟输入以进行输入验证。基准监控块包括振幅监控器、、漏脉冲监控器和矮脉冲监控器。对于 1PPS 输入，支持相位有效监控器和 LVCMOS 输入振幅监控器，但不支持差分输入振幅监控器、、漏脉冲监控器和矮脉冲监控器，因此必须禁用它们。验证计时器可设置在输入验证合格之前，清除所有已启用的基准监控器标志的最短时间。

每个输入都可以对所有基准监控器和验证计时器的启用和有效阈值进行编程。是否启用基准监控器和验证计时器是可选设置，但这些设置对于在保持或切换事件期间实现可靠的 DPLL 锁定和出色瞬态性能至关重要。基准监控器和验证计时器也用于避免选择不可靠或间歇性的时钟输入。如果未启用给定检测器，则该检测器不会设置标志并会被忽略。可以通过任何基准输入（已选择或未选择）的状态引脚来观察任何已启用的检测器的状态标志。还可以通过 DPLL 选定输入的状态位来读取已启用的检测器的状态标志。