以下公式提供了实现闭环运行所需的 APLL 和 DLL 频率关系。TICS Pro 编程软件可用于根据所需的频率计划生成有效的分频器设置。

请注意，以下公式中的任何分频器均指实际分频值（或范围），而不是可编程寄存器值。

当启用 DPLL 工作模式后，计算得出的 DPLL 频率和 APLL 频率的标称值必须相同。对配对的 APLL N 分频器 40 位固定分母进行的 DPLL 调整将跟随所选的输入基准源，以合成实际时钟输出所需的频率和相位。

当 APLL 独立于其配对的 DPLL 运行时，TI 建议使用可编程 24 位分母进行频域之间的混合同步或级联，以便在没有 DPLL 控制的情况下保持 0ppm 的频率误差。在这种情况下，APLL 跟随来自另一个 APLL 输出的级联反馈分频器基准。

当对 PLL 使用 ZDM 时，必须在 VCO 频率计算中考虑时钟输出分频器。