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ZHCSWZ2 June 2024 LMX1860-SEP

PRODUCTION DATA

封装选项

机械数据 (封装 | 引脚)

PAP|64
- MPQF071C

散热焊盘机械数据 (封装 | 引脚)

PAP|64
- PPTD060M

订购信息

7.5.1 器件寄存器

表 7-4 列出了器件寄存器的存储器映射寄存器。表 7-4 中未列出的所有寄存器偏移地址都应视为保留的位置，并且不得修改寄存器内容。

表 7-4 器件寄存器

偏移	首字母缩写词	寄存器名称	部分
0h	R0	断电、复位、倍频器模式校准	节 7.5.1.1
2h	R2	倍频器模式（状态机时钟）	节 7.5.1.2
3h	R3	倍频器模式（状态机时钟）、输出使能	节 7.5.1.3
4h	R4	输出使能、CLKOUT 电源	节 7.5.1.4
5h	R5	CLKOUT 电源、SYSREFOUT 电源	节 7.5.1.5
6h	R6	LOGICLK 使能、SYSREFOUT 电源/VCM	节 7.5.1.6
7h	R7	LOGICLK 和 LOGISYSREF	节 7.5.1.7
8h	R8	LOGICLK 和 LOGISYSREF	节 7.5.1.8
9h	R9	LOGICLK 分频器、SYNC、SYSREFREQ	节 7.5.1.9
Bh	R11	SYSREFREQ 窗口化（回读）	节 7.5.1.10
Ch	R12	SYSREFREQ 窗口化（回读）	节 7.5.1.11
Dh	R13	SYSREFREQ 窗口化	节 7.5.1.12
Eh	R14	SYSREFREQ 窗口化、SYNC、SYSREF	节 7.5.1.13
Fh	R15	SYSREFREQ 窗口化、SYNC、SYSREF	节 7.5.1.14
10h	R16	SYSREF	节 7.5.1.15
11h	R17	SYSREF、SYSREFOUT 延迟	节 7.5.1.16
12h	R18	SYSREFOUT 延迟	节 7.5.1.17
13h	R19	SYSREFOUT 延迟	节 7.5.1.18
14h	R20	SYSREFOUT 延迟	节 7.5.1.19
15h	R21	SYSREFOUT 延迟	节 7.5.1.20
16h	R22	SYSREFOUT 延迟	节 7.5.1.21
17h	R23	温度传感器、MUXOUT、SYSREFOUT 延迟	节 7.5.1.22
18h	R24	温度传感器	节 7.5.1.23
19h	R25	倍频器模式、分频器模式	节 7.5.1.24
1Ch	R28	倍频器模式（可选，部分辅助校准）	节 7.5.1.25
1Dh	R29	倍频器模式（可选，部分辅助校准）	节 7.5.1.26
21h	R33	倍频器模式（保留，必须在倍频器模式下写入）
22h	R34	倍频器模式（保留，必须在倍频器模式下写入）
41h	R65	倍频器模式（只读，可选，用于部分辅助校准）	节 7.5.1.29
43h	R67	倍频器模式（只读，可选，用于部分辅助校准）	节 7.5.1.30
48h	R72	SYSREF	节 7.5.1.31
49h	R73	保留
4Bh	R75	倍频器模式（只读，可选，锁定检测）	节 7.5.1.33
4Ch	R76	只读	节 7.5.1.34
56h	R86	MUXOUT（保留，可选，用于三态）
5Ah	R90	LOGICLK 分频器（保留，可选，用于分频器旁路）

复杂的位访问类型经过编码可适应小型表单元。表 7-5 展示了适用于此部分中访问类型的代码。

表 7-5 器件访问类型代码

访问类型	代码	说明
读取类型
R	R	读取
写入类型
W	W	写入
复位或默认值
-n		复位后的值或默认值

7.5.1.1 R0 寄存器（偏移 = 0h）[复位 = 0000h]

表 7-6 展示了 R0。

返回到表 7-4。

表 7-6 R0 寄存器字段说明

位	字段	类型	复位值	说明
15-3	未披露	R/W	0h	将该字段编程为 0x0。
2	POWERDOWN	R/W	0h	将器件设置为低功耗状态。其他寄存器的状态保持不变。
1	未披露	R/W	0h	将该字段编程为 0x0。
0	复位	R/W	0h	软复位。复位整个逻辑和寄存器（相当于上电复位）。下次写入寄存器时自行清除。

7.5.1.2 R2 寄存器（偏移 = 2h）[复位 = 0223h]

表 7-7 展示了 R2。

返回到表 7-4。

表 7-7 R2 寄存器字段说明

位	字段	类型	复位值	说明
15-11	未披露	R	0h	将该字段编程为 0x0。
10	未披露	R/W	0h	将该字段编程为 0x0。
9-6	SMCLK_DIV_PRE	R/W	8h	状态机时钟预分频器（一个热分频器）。状态机时钟从输入时钟分频。预分频器的输出应 ≤ 1600MHz。除所列值以外的值均保留。 2h = /2 4h = /4 8h = /8
5	SMCLK_EN	R/W	1h	启用状态机时钟发生器。仅在用于校准倍频器和执行倍频器锁定检测（包括在 MUXOUT 引脚上检测）时需启用。如果未使用倍频器，或者未使用倍频器锁定检测特性，则可禁用状态机时钟发生器，以更大限度减少串扰。
4-0	未披露	R/W	3h	将该字段编程为 0x3。

7.5.1.3 R3 寄存器（偏移 = 3h）[复位 = FF86h]

表 7-8 展示了 R3。

返回到表 7-4。

表 7-8 R3 寄存器字段说明

位	字段	类型	复位值	说明
15	CH3_EN	R/W	1h	启用 CH3（CLKOUT3、SYSOUT3）。将该位设置为 0 将完全禁用 CH3，从而覆盖其他断电/使能位的状态。
14	CH2_EN	R/W	1h	启用 CH2（CLKOUT2、SYSOUT2）。将该位设置为 0 将完全禁用 CH2，从而覆盖其他断电/使能位的状态。
13	CH1_EN	R/W	1h	启用 CH1（CLKOUT1、SYSOUT1）。将该位设置为 0 将完全禁用 CH1，从而覆盖其他断电/使能位的状态。
12	CH0_EN	R/W	1h	启用 CH0（CLKOUT0、SYSOUT0）。将该位设置为 0 将完全禁用 CH0，从而覆盖其他断电/使能位的状态。
11	LOGICLK_MUTE_CAL	R/W	1h	在倍频器校准期间使 LOGIC 输出 (LOGICLK/LOGISYS) 静音。
10	CH3_MUTE_CAL	R/W	1h	在倍频器校准期间使 CH3 (CLKOUT3/SYSOUT3) 静音。
9	CH2_MUTE_CAL	R/W	1h	在倍频器校准期间使 CH2 (CLKOUT2/SYSOUT2) 静音。
8	CH1_MUTE_CAL	R/W	1h	在倍频器校准期间使 CH1 (CLKOUT1/SYSOUT1) 静音。
7	CH0_MUTE_CAL	R/W	1h	在倍频器校准期间使 CH0 (CLKOUT0/SYSOUT0) 静音。
6-3	未披露	R	0h	将该字段编程为 0x0。
2-0	SMCLK_DIV	R/W	6h	设置状态机时钟分频器。进一步对状态机时钟预分频器的输出进行分频。由 SMCLK_DIV_PRE 提供的输入频率必须 ≤ 1600MHz。输出频率必须 ≤ 30MHz。分频值为 2^SMCLK_DIV。 0h = /1 1h = /2 2h = /4 3h = /8 4h = /16 5h = /32 6h = /64 7h = /128

7.5.1.4 R4 寄存器（偏移 = 4h）[复位 = 36FFh]

表 7-9 展示了 R4。

返回到表 7-4。

表 7-9 R4 寄存器字段说明

位	字段	类型	复位值	说明
15-14	未披露	R	0h	将该字段编程为 0x0。
13-11	CLKOUT1_PWR	R/W	6h	设置 CLKOUT1 的输出功率。值越大，对应的输出功率就越高。
10-8	CLKOUT0_PWR	R/W	6h	设置 CLKOUT0 的输出功率。值越大，对应的输出功率就越高。
7	SYSREFOUT3_EN	R/W	1h	启用 SYSREFOUT3 输出缓冲器。
6	SYSREFOUT2_EN	R/W	1h	启用 SYSREFOUT2 输出缓冲器。
5	SYSREFOUT1_EN	R/W	1h	启用 SYSREFOUT1 输出缓冲器。
4	SYSREFOUT0_EN	R/W	1h	启用 SYSREFOUT0 输出缓冲器。
3	CLKOUT3_EN	R/W	1h	启用 CLKOUT3 输出缓冲器。
2	CLKOUT2_EN	R/W	1h	启用 CLKOUT2 输出缓冲器。
1	CLKOUT1_EN	R/W	1h	启用 CLKOUT1 输出缓冲器。
0	CLKOUT0_EN	R/W	1h	启用 CLKOUT0 输出缓冲器。

7.5.1.5 R5 寄存器（偏移 = 5h）[复位 = 4936h]

表 7-10 展示了 R5。

返回到表 7-4。

表 7-10 R5 寄存器字段说明

位	字段	类型	复位值	说明
15	未披露	R	0h	将该字段编程为 0x0。
14-12	SYSREFOUT2_PWR	R/W	4h	设置 SYSREFOUT2 的输出功率。值越大，对应的输出功率就越高。必须正确设置 SYSREFOUT2_VCM，使输出共模电压处于允许的范围内。
11-9	SYSREFOUT1_PWR	R/W	4h	设置 SYSREFOUT1 的输出功率。值越大，对应的输出功率就越高。必须正确设置 SYSREFOUT1_VCM，使输出共模电压处于允许的范围内。
8-6	SYSREFOUT0_PWR	R/W	4h	设置 SYSREFOUT0 的输出功率。值越大，对应的输出功率就越高。必须正确设置 SYSREFOUT0_VCM，使输出共模电压处于允许的范围内。
5-3	CLKOUT3_PWR	R/W	6h	设置 CLKOUT3 的输出功率。值越大，对应的输出功率就越高。
2-0	CLKOUT2_PWR	R/W	6h	设置 CLKOUT2 的输出功率。值越大，对应的输出功率就越高。

7.5.1.6 R6 寄存器（偏移 = 6h）[复位 = B6DCh]

表 7-11 展示了 R6。

返回到表 7-4。

表 7-11 R6 寄存器字段说明

位	字段	类型	复位值	说明
15	LOGICLKOUT_EN	R/W	1h	启用逻辑时钟输出缓冲器。
14-12	SYSREFOUT3_VCM	R/W	3h	设置 SYSREFOUT3 的输出共模。必须设置正确 SYSREFOUT3_PWR，使最小和最大输出电压处于允许的范围内。
11-9	SYSREFOUT2_VCM	R/W	3h	设置 SYSREFOUT2 的输出共模。必须设置正确 SYSREFOUT2_PWR，使最小和最大输出电压处于允许的范围内。
8-6	SYSREFOUT1_VCM	R/W	3h	设置 SYSREFOUT1 的输出共模。必须设置正确 SYSREFOUT1_PWR，使最小和最大输出电压处于允许的范围内。
5-3	SYSREFOUT0_VCM	R/W	3h	设置 SYSREFOUT0 的输出共模。必须设置正确 SYSREFOUT0_PWR，使最小和最大输出电压处于允许的范围内。
2-0	SYSREFOUT3_PWR	R/W	4h	设置 SYSREFOUT3 的输出功率。值越大，对应的输出功率就越高。必须正确设置 SYSREFOUT3_VCM，使输出共模电压处于允许的范围内。

7.5.1.7 R7 寄存器（偏移 = 7h）[复位 = 0001h]

表 7-12 展示了 R7。

返回到表 7-4。

表 7-12 R7 寄存器字段说明

位	字段	类型	复位值	说明
15	未披露	R	0h	将该字段编程为 0x0。
14-13	LOGISYSREFOUT_VCM	R/W	0h	在 LVDS 模式下，设置逻辑 SYSREF 输出的输出共模。其他输出格式忽略该字段。 0h = 1.2V 1h = 1.1V 2h = 1.0V 3h = 0.9V
12-11	LOGICLKOUT_VCM	R/W	0h	在 LVDS 模式下，设置逻辑时钟输出的输出共模。其他输出格式忽略该字段。 0h = 1.2V 1h = 1.1V 2h = 1.0V 3h = 0.9V
10-9	LOGISYSREF_DIV_PWR_PRE	R/W	0h	设置逻辑 SYSREF 前置驱动器的输出功率。值越大，对应的输出功率就越高。
8-7	LOGICLK_DIV_PWR_PRE	R/W	0h	设置逻辑时钟前置驱动器的输出功率。值越大，对应的输出功率就越高。
6-4	LOGISYSREFOUT_PWR	R/W	0h	仅针对 CML 格式设置 LOGISYSREFOUT 的输出功率（其他输出格式忽略该字段）。值越大，对应的输出功率就越高。
3-1	LOGICLKOUT_PWR	R/W	0h	仅针对 CML 格式设置 LOGICLKOUT 的输出功率（其他输出格式忽略该字段）。值越大，对应的输出功率就越高。
0	LOGISYSREFOUT_EN	R/W	1h	启用逻辑 SYSREF 输出缓冲器。

7.5.1.8 R8 寄存器（偏移 = 8h）[复位 = 0120h]

表 7-13 展示了 R8。

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表 7-13 R8 寄存器字段说明

位	字段	类型	复位值	说明
15-9	未披露	R	0h	将该字段编程为 0x0。
8-6	LOGICLK_DIV_PRE	R/W	4h	设置逻辑时钟分频器的预分频器值。预分频器的输出必须小于或等于 3.2GHz。当 LOGICLK_DIV_PRE=1 时，还需要将寄存器 R79 编程为值 0x0005，将 R90 编程为值 0x0060（LOGICLK_DIV_BYP2=1，LOGICLK_DIV_BYP3=1）。除下列值以外的 LOGICLK_DIV_PRE 值均保留。 1h = /1 2h = /2 4h = /4
5	LOGIC_EN	R/W	1h	启用 LOGICLK 子系统（LOGICLKOUT、LOGISYSREFOUT）。将该位设置为 0x0 会完全禁用所有 LOGICLKOUT 和 LOGISYSREFOUT 电路，从而覆盖其他断电/使能位的状态。
4	未披露	R/W	0h	将该字段编程为 0x0。
3-2	LOGISYSREFOUT_FMT	R/W	0h	选择 LOGISYSREFOUT 输出的输出驱动器格式。 0h = LVDS 1h = 保留 2h = CML 3h = 保留
1-0	LOGICLKOUT_FMT	R/W	0h	选择 LOGICLKOUT 输出的输出驱动器格式。 0h = LVDS 1h = 保留 2h = CML 3h = 保留

7.5.1.9 R9 寄存器（偏移 = 9h）[复位 = 0020h]

表 7-14 展示了 R9。

返回到表 7-4。

表 7-14 R9 寄存器字段说明

位	字段	类型	复位值	说明
15-14	SYSREFREQ_VCM	R/W	0h	设置 SYSREFREQ 引脚的内部直流偏置。对于交流耦合输入，必须启用偏置；但对于直流耦合输入，可以启用偏置并过驱动，也可以禁用偏置。SYSREFREQ DC 引脚电压必须在 0.7V 至 VCC 范围内，包括最小和最大信号摆幅。 0h = 1.3V 1h = 1.1V 2h = 1.5V 3h = 已禁用
13	SYNC_EN	R/W	0h	启用分频器的同步路径，并允许启用时钟位置捕获电路。用于多器件同步。如果 SYSREF_EN = 0x1，则为冗余。
12	LOGICLK_DIV_PD	R/W	0h	禁用 LOGICLK 分频器。LOGICLK 预分频器保持启用状态。用于在绕过 LOGICLK 分频器时减少电流消耗。
11	LOGICLK_DIV_BYP	R/W	0h	绕过 LOGICLK_DIV 分频器，以便直接从 LOGICLK_DIV_PRE 分频器获得 LOGICLK 输出。应仅在 LOGICLK_DIV_PRE=1 时使用，作为实现 LOGICLK 总分频为 1 的步骤之一。要实现 1 分频，需要执行以下步骤。 1.设置 LOGICLK_DIV_PRE=1 2.确保将寄存器 R79 编程为值 0x0005 3.将 R90 编程为 0x0060（LOGICLK_DIV23=1，LOGICLK_DIV_DCC=1） 4.设置 LOGICLK_DIV_BYP=1 如果不希望 LOGICLK 的总分频为 1，则应将该位设置为 0。 0h = 启用 LOGICLK 分频器 1h = 绕过 LOGICLK 分频器
10	未披露	R/W	0h	将该字段编程为 0x0。
9-0	LOGICLK_DIV	R/W	20h	设置 LOGICLK 分频器值。由 LOGICLK_DIV_PRE 提供的最大输入频率必须 ≤ 3200MHz。最大 LOGICLKOUT 频率必须 ≤ 800MHz，以避免振幅衰减。 0h = 保留 1h = 保留 2h = /2 3h = /3 3FFh = /1023

7.5.1.10 R11 寄存器（偏移 = Bh）[复位 = 0000h]

表 7-15 展示了 R11。

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表 7-15 R11 寄存器字段说明

位	字段	类型	复位值	说明
15-0	rb_CLKPOS	R	0h	存储 CLKIN 信号上升沿位置相对于 SYSREFREQ 上升沿的快照，该快照从 LSB 开始并在 MSB 结束。每个位都代表 CLKIN 信号的一个样片，由 SYSREFREQ_DLY_STEP 字段确定的延迟隔开。rb_CLKPOS 的第一位和最后一位始终保持置位状态，指示捕获窗口边界条件下的不确定性。CLKIN 上升沿由从 LSB 到 MSB 的两个设置位的每个序列表示，包括边界条件下的位。快照中 CLKIN 上升沿的位置以及 CLKIN 信号周期和延迟步长可用于计算 SYSREFREQ_DLY 的值，从而更大限度地延长 SYSREFREQ 引脚上 SYNC 信号的设置时间和保持时间。

7.5.1.11 R12 寄存器（偏移 = Ch）[复位 = 0000h]

表 7-16 展示了 R12。

返回到表 7-4。

表 7-16 R12 寄存器字段说明

位	字段	类型	复位值	说明
15-0	rb_CLKPOS[31:16]	R	0h	rb_CLKPOS 字段的 MSB。

7.5.1.12 R13 寄存器（偏移 = Dh）[复位 = 0003h]

表 7-17 展示了 R13。

返回到表 7-4。

表 7-17 R13 寄存器字段说明

位	字段	类型	复位值	说明
15-2	未披露	R	0h	将该字段编程为 0x0。
1-0	SYSREFREQ_DLY_STEP	R/W	3h	设置 SYSREFREQ 路径中使用的延迟元件的步长，用于 SYSREFREQ 输入延迟和时钟位置捕获。每个步长的推荐频率范围创建了给定 CLKIN 频率的最大可用步长数。这些范围包括一些重叠，以考虑工艺和温度变化。如果 CLKIN 频率被重叠范围覆盖，则较大的延迟步长会提高在时钟位置捕获期间检测到 CLKIN 上升沿的可能性。但是，值越大，包含的延迟步长就越多，因此相对于较小的步长，较大的步长在 PVT 上的总延迟变化更大。 0h = 28ps（1.4GHz 至 2.7GHz） 1h = 15ps（2.4GHz 至 4.7GHz） 2h = 11ps（3.1GHz 至 5.7GHz） 3h = 8ps（4.5GHz 至 12.8GHz）

7.5.1.13 R14 寄存器（偏移 = Eh）[复位 = 0002h]

表 7-18 展示了 R14。

返回到表 7-4。

表 7-18 R14 寄存器字段说明

位	字段	类型	复位值	说明
15-9	未披露	R/W	0h	将该字段编程为 0x0。
8	SYNC_MUTE_PD	R/W	0h	消除 SYNC 模式 (SYSREFREQ_MODE = 0x0) 期间 SYSREFOUT 和 LOGISYSREFOUT 引脚上的静音条件。由于 SYNC 操作也会复位 SYSREF 分频器，因此静音条件通常是可取的，该位可保留为默认值。
7-3	未披露	R/W	0h	将该字段编程为 0x0。
2	CLKPOS_CAPTURE_EN	R/W	0h	启用窗口化电路，该电路可捕获 rb_CLKPOS 寄存器中相对于 SYSREF 边沿的时钟位置。捕获时钟位置之前，必须通过将 SYSREFREQ_CLR 切换为高电平然后切换为低电平来清除窗口化电路。清除窗口化电路后，SYSREFREQ 引脚上的第一个上升沿将触发捕获。捕获电路大大增加了电源电流，在 SYNC 或 SYSREF 模式下无需启用捕获电路即可延迟 SYSREFREQ 信号。确定所需的 SYSREFREQ_DLY 值后，将该位设置为 0x0 以尽可能减少电流消耗。如果 SYNC_EN = 0 且 SYSREF_EN = 0，则会忽略该位的值，并禁用窗口化电路。
1	SYSREFREQ_MODE	R/W	1h	选择 SYSREFREQ 引脚的功能 0h = SYNC 引脚 1h = SYSREFREQ 引脚
0	SYSREFREQ_LATCH	R/W	0h	在 SYSREFREQ 引脚的第一个上升沿，将内部 SYSREFREQ 状态锁存为逻辑高电平。可通过设置 SYSREFREQ_CLR=1 来清除该锁存。

7.5.1.14 R15 寄存器（偏移 = Fh）[复位 = 0B01h]

表 7-19 展示了 R15。

返回到表 7-4。

表 7-19 R15 寄存器字段说明

位	字段	类型	复位值	说明
15-12	未披露	R	0h	将该字段编程为 0x0。
11-10	SYSREF_DIV_PRE	R/W	2h	设置 SYSREF 预分频器。最大输出频率必须 ≤ 3.2GHz。 0h = /1 1h = /2 2h = /4 3h = 保留
9	未披露	R/W	1h	将该字段编程为 0x1。
8	SYSREF_EN	R/W	1h	启用 SYSREF 子系统（当 SYSREFREQ_MODE = 0x0 时还启用 SYNC 子系统）。将该位设置为 0x0 会完全禁用所有 SYNC、SYSREF 和时钟位置捕获电路，从而覆盖除 SYNC_EN 之外的其他断电/使能位的状态。如果 SYNC_EN = 0x1，则无论 SYSREF_EN 的状态如何，SYNC 路径和时钟位置捕获电路仍处于启用状态。
7	未披露	R/W	0h	将该字段编程为 0x0。
6-1	SYSREFREQ_DLY	R/W	0h	设置外部 SYSREFREQ 信号的延迟线路步长。每个延迟线路步长都会造成一定的 SYSREFREQ 信号延迟，延迟量等于 SYSREFREQ_DELAY_STEP x SYSREFREQ_DLY_STEP。在 SYNC 模式下，可以根据 rb_CLKPOS 值来确定该字段的值，从而满足 SYNC 信号相对于 CLKIN 信号的内部设置时间和保持时间要求。在 SYSREF 中继器模式下，该字段的值可用作粗略全局延迟。大于 0x3F 的值无效。由于较大的值包含更多的延迟步长，因此与较小的值相比，较大的值在整个 PVT 中的总步长变化更大。有关延迟步长计算过程的详细说明，请参阅数据表或器件 TICS Pro 配置文件。
0	SYSREFREQ_CLR	R/W	1h	清除 SYSREFREQ_LATCH 并复位 SYSREFREQ 信号的同步路径时序。在除 SYSREF 中继器模式之外的所有模式下，将该位保持为高电平可将内部 SYSREFREQ 信号保持为低电平，从而覆盖 SYSREFREQ_FORCE 的状态。在执行 SYNC 或时钟位置捕获操作之前，必须设置和清除该位一次。

7.5.1.15 R16 寄存器（偏移 = 10h）[复位 = 1005h]

表 7-20 展示了 R16。

返回到表 7-4。

表 7-20 R16 寄存器字段说明

位	字段	类型	复位值	说明
15-12	SYSREF_PULSE_CNT	R/W	1h	对在脉冲发生器模式下生成的脉冲数进行编程。脉冲发生器是对 SYSREF 分频器进行门控的计数器；因此，脉冲持续时间和频率分别等于 SYSREF 分频器输出的占空比和频率。 0h = 保留 1h = 1 个脉冲 2h = 2 个脉冲 Fh = 15 个脉冲
11-0	SYSREF_DIV	R/W	5h	设置 SYSREF 分频器。由 SYSREF_DIV_PRE 提供的最大输入频率必须 ≤ 3200MHz。最大输出频率必须 ≤ 100MHz。仅当绕过延迟发生器时，才允许奇数分频（占空比 < 50%）。 0h = 保留 1h = 保留 2h = /2 3h = /3 FFFh = /4095

7.5.1.16 R17 寄存器（偏移 = 11h）[复位 = 07F0h]

表 7-21 展示了 R17。

返回到表 7-4。

表 7-21 R17 寄存器字段说明

位	字段	类型	复位值	说明
15-11	未披露	R	0h	将该字段编程为 0x0。
10-4	SYSREF0_DLY_I	R/W	7Fh	设置 SYSREFOUT0 延迟发生器的延迟步长。必须满足 SYSREFOUT0_DLY_I + SYSREFOUT0_DLY_Q = 127
3-2	SYSREF0_DLY_PHASE	R/W	0h	设置用于 SYSREFOUT0 延迟发生器重定时器的内插器时钟的正交相位。 0h = ICLK' 1h = QCLK' 2h = ICLK 3h = QCLK
1-0	SYSREF_MODE	R/W	0h	控制 SYSREF 信号的生成方式，也受 SYSREF_DLY_BYP 字段的影响。连续模式可生成源自 SYSREF 分频器和延迟的连续 SYSREF 时钟。在脉冲发生器模式下，SYSREFREQ 引脚上的脉冲会导致为 SYSREF 输出生成特定数量（由 SYSREF_PULSE_CNT 确定）的脉冲。在中继器模式下，SYSREFREQ 引脚上的脉冲将在 SYSREF 输出端生成单个脉冲，并且只添加通过器件的传播延迟。 0h = 连续 1h = 脉冲发生器 2h = 中继器 3h = 保留

7.5.1.17 R18 寄存器（偏移 = 12h）[复位 = FE00h]

表 7-22 展示了 R18。

返回到表 7-4。

表 7-22 R18 寄存器字段说明

位	字段	类型	复位值	说明
15-9	SYSREF1_DLY_I	R/W	7Fh	设置 SYSREFOUT0 延迟发生器的延迟步长。必须满足 SYSREFOUT0_DLY_I + SYSREFOUT0_DLY_Q = 127
8-7	SYSREF1_DLY_PHASE	R/W	0h	设置用于 SYSREFOUT1 延迟发生器重定时器的内插器时钟的正交相位。 0h = ICLK' 1h = QCLK' 2h = QCLK 3h = ICLK
6-0	SYSREF0_DLY_Q	R/W	0h	确定用于生成延迟的 QCLK 强度。必须满足 SYSREF0_DLY_I + SYSREF0_DLY_Q = 127

7.5.1.18 R19 寄存器（偏移 = 13h）[复位 = FE00h]

表 7-23 展示了 R19。

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表 7-23 R19 寄存器字段说明

位	字段	类型	复位值	说明
15-9	SYSREF2_DLY_I	R/W	7Fh	确定用于生成延迟的 ICLK 强度。必须满足 SYSREF2_DLY_I + SYSREF2_DLY_Q = 127
8-7	SYSREF2_DLY_PHASE	R/W	0h	设置用于 SYSREFOUT2 延迟发生器重定时器的内插器时钟的正交相位。 0h = ICLK' 1h = QCLK' 2h = QCLK 3h = ICLK
6-0	SYSREF1_DLY_Q	R/W	0h	确定用于生成延迟的 QCLK 强度。必须满足 SYSREF1_DLY_I + SYSREF1_DLY_Q = 127

7.5.1.19 R20 寄存器（偏移 = 14h）[复位 = FE00h]

表 7-24 展示了 R20。

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表 7-24 R20 寄存器字段说明

位	字段	类型	复位值	说明
15-9	SYSREF3_DLY_I	R/W	7Fh	设置 SYSREFOUT1 延迟发生器的延迟步长。必须满足 SYSREFOUT1_DLY_I + SYSREFOUT1_DLY_Q = 127
8-7	SYSREF3_DLY_PHASE	R/W	0h	设置用于 SYSREFOUT3 延迟发生器重定时器的内插器时钟的正交相位。 0h = ICLK' 1h = QCLK' 2h = QCLK 3h = ICLK
6-0	SYSREF2_DLY_Q	R/W	0h	确定用于生成延迟的 QCLK 强度。必须满足 SYSREF3_DLY_I + SYSREF3_DLY_Q = 127

7.5.1.20 R21 寄存器（偏移 = 15h）[复位 = FE00h]

表 7-25 展示了 R21。

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表 7-25 R21 寄存器字段说明

位	字段	类型	复位值	说明
15-9	LOGISYSREF_DLY_I	R/W	7Fh	确定用于生成延迟的逻辑 ICLK 强度。必须满足 LOGISYSREF_DLY_I+LOGISYSREF_DLY_Q = 127
8-7	LOGISYSREF_DLY_PHASE	R/W	0h	设置用于 LOGISYSREFOUT 延迟发生器重定时器的内插器时钟的正交相位。 0h = ICLK' 1h = QCLK' 2h = QCLK 3h = ICLK
6-0	SYSREF3_DLY_Q	R/W	0h	确定用于生成延迟的 QCLK 强度。必须满足 SYSREFx_DLY_I + SYSREFx_DLY_Q = 127

7.5.1.21 R22 寄存器（偏移 = 16h）[复位 = 0800h]

表 7-26 展示了 R22。

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表 7-26 R22 寄存器字段说明

位	字段	类型	复位值	说明
15-14	SYSREF1_DLY_SCALE	R/W	0h	设置 SYSREFOUT1 延迟发生器的频率范围。根据相位内插器频率进行设置。 0h = 400MHz 至 800MHz 1h = 200MHz 至 400MHz 2h = 150MHz 至 200MHz 3h = 保留
13-12	SYSREF0_DLY_SCALE	R/W	0h	设置 SYSREFOUT0 延迟发生器的频率范围。根据相位内插器频率进行设置。 0h = 400MHz 至 800MHz 1h = 200MHz 至 400MHz 2h = 150MHz 至 200MHz 3h = 保留
11-9	SYSREF_DLY_DIV	R/W	4h	设置延迟发生器时钟分频，确定相位内插器频率和延迟发生器分辨率。除下列值以外的值均保留。 0h = /1（0GHz 至 1.6GHz） 1h = /2（1.6GHz 至 3.2GHz） 2h = /4（3.2GHz 至 6.4GHz） 4h = /8（6.4GHz 至 12.8GHz）
8-7	未披露	R/W	0h	将该字段编程为 0x0。
6-0	LOGISYSREF_DLY_Q	R/W	0h	设置 LOGISYSREFOUT 延迟发生器的延迟步长。必须满足 LOGISYSREFOUT_DLY_I + LOGISYSREFOUT_DLY_Q = 127。

7.5.1.22 R23 寄存器（偏移 = 17h）[复位 = 4000h]

表 7-27 展示了 R23。

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表 7-27 R23 寄存器字段说明

位	字段	类型	复位值	说明
15	TS_EN	R/W	0h	启用片上温度传感器。还必须启用温度传感器计数器 (TS_CNT_EN) 以进行回读。
14	未披露	R/W	1h	将该字段编程为 0x1。
13	MUXOUT_EN	R/W	0h	启用 MUXOUT 引脚驱动器或将其置于三态。 0h = 三态 1h = 推挽
12-7	未披露	R/W	0h	将该字段编程为 0x0。
6	MUXOUT_SEL	R/W	0h	选择 MUXOUT 引脚功能。 0h = 锁定检测 1h = 回读
5-4	LOGISYSREF_DLY_SCALE	R/W	0h	设置 LOGISYSREFOUT 延迟发生器的频率范围。根据相位内插器频率进行设置。 0h = 400MHz 至 800MHz 1h = 200MHz 至 400MHz 2h = 150MHz 至 200MHz 3h = 保留
3-2	SYSREF3_DLY_SCALE	R/W	0h	设置 SYSREFOUT3 延迟发生器的频率范围。根据相位内插器频率进行设置。 0h = 400MHz 至 800MHz 1h = 200MHz 至 400MHz 2h = 150MHz 至 200MHz 3h = 保留
1-0	SYSREF2_DLY_SCALE	R/W	0h	设置 SYSREFOUT2 延迟发生器的频率范围。根据相位内插器频率进行设置。 0h = 400MHz 至 800MHz 1h = 200MHz 至 400MHz 2h = 150MHz 至 200MHz 3h = 保留

7.5.1.23 R24 寄存器（偏移 = 18h）[复位 = 0000h]

表 7-28 展示了 R24。

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表 7-28 R24 寄存器字段说明

位	字段	类型	复位值	说明
15-14	未披露	R	0h	将该字段编程为 0x0。
13-12	未披露	R/W	0h	将该字段编程为 0x0。
11-1	rb_TS	R	0h	片上温度传感器的回读值。
0	TS_CNT_EN	R/W	0h	启用温度传感器计数器。必须启用温度传感器 (EN_TS) 才能获得准确数据。

7.5.1.24 R25 寄存器（偏移 = 19h）[复位 = 0211h]

表 7-29 展示了 R25。

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表 7-29 R25 寄存器字段说明

位	字段	类型	复位值	说明
15-7	未披露	R/W	4h	将该字段编程为 0x4。
6	CLK_DIV_RST	R/W	0h	复位主时钟分频器。如果在运行过程中更改了时钟分频器值，则在设置新分频器值后将该位设置为高电平，然后再设置为低电平。当 SYSREFREQ_MODE = 0x0 且 SYNC_EN = 0x1 时将器件与 SYSREFREQ 引脚同步也会复位主时钟分频器。该位在分频器模式之外无效。
5-3	CLK_DIV	R/W	2h	CLK_DIV 和 CLK_MULT 是同一字段的别名。当 CLK_MUX=1（缓冲器模式）时，将忽略该字段。当 CLK_MUX = 2（分频器模式）时，时钟分频器为 CLK_DIV + 1。CLK_DIV 的有效范围为 1 至 7。将其设置为 0 将禁用主时钟分频器并恢复到缓冲器模式。当 CLK_MUX = 3（倍频器模式）时，倍频器值为 CLK_MULT。有效范围为 1 至 4。超出此范围的设置将禁用倍频器模式，并恢复到缓冲器模式。有效范围为 0x1 至 0x4。
2-0	CLK_MUX	R/W	1h	选择主时钟输出的功能 0h = 保留 1h = 缓冲器 2h = 分频器 3h = 倍频器

7.5.1.25 R28 寄存器（偏移 = 1Ch）[复位 = 0A08h]

表 7-30 展示了 R28。

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表 7-30 R28 寄存器字段说明

位	字段	类型	复位值	说明
15-13	未披露	R	0h	将该字段编程为 0x0。
12	VCO_CORE_FORCE	R/W	0h	强制倍频器 PLL 的 VCO 为 VCO_CORE 选择的值。倍频器模式编程不需要该字段，但可以选择用该字段来缩短校准时间。
11-9	VCO_CORE	R/W	5h	当 VCO_CORE_FORCE=0 时，指定用于倍频器校准的起始 VCO。当 VCO_CORE_FORCE=1 时，强制使用该 VCO 内核。倍频器模式编程不需要对该字段进行编程，但该字段可用于调试目的或缩短校准时间。
8-0	未披露	R/W	8h	将该字段编程为 0x8。

7.5.1.26 R29 寄存器（偏移 = 1Dh）[复位 = 05FFh]

表 7-31 展示了 R29。

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表 7-31 R29 寄存器字段说明

位	字段	类型	复位值	说明
15-13	未披露	R	0h	将该字段编程为 0x0。
12-8	未披露	R/W	5h	将该字段编程为 0x5。
7-0	VCO_CAPCTRL	R/W	FFh	设置倍频器校准期间 VCO 调谐电容的起始值。倍频器模式编程不需要该字段，但可以用该字段来缩短校准时间。

7.5.1.27 R33 寄存器（偏移 = 21h）[复位 = 7777h]

表 7-32 展示了 R33。

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表 7-32 R33 寄存器字段说明

位	字段	类型	复位值	说明
15-0	未披露	R/W	7777h	将该字段编程为 0x6666。请注意，这与复位值不同。

7.5.1.28 R34 寄存器（偏移 = 22h）[复位 = 0007h]

表 7-33 展示了 R34。

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表 7-33 R34 寄存器字段说明

位	字段	类型	复位值	说明
15-14	未披露	R	0h	将该字段编程为 0x0。
13-0	未披露	R/W	7h	将该字段编程为 0x5。请注意，这与复位值不同。

7.5.1.29 R65 寄存器（偏移 = 41h）[复位 = 65F0h]

表 7-34 展示了 R65。

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表 7-34 R65 寄存器字段说明

位	字段	类型	复位值	说明
15-9	未披露	R/W	32h	将该字段编程为 0x32。
8-4	rb_VCO_CORE	R	1Fh	倍频器 VCO 内核的回读。仅列出有效值，VCO 由低电平位确定。 Fh = VCO1 17h = VCO2 1Bh = VCO3 1Dh = VCO4 1Eh = VCO5
3-0	未披露	R/W	0h	将该字段编程为 0x0。

7.5.1.30 R67 寄存器（偏移 = 43h）[复位 = 50C8h]

表 7-35 展示了 R67。

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表 7-35 R67 寄存器字段说明

位	字段	类型	复位值	说明
15-0	未披露	R/W	50C8h	将该字段编程为 0x51CB。请注意，这与复位值不同。

7.5.1.31 R72 寄存器（偏移 = 48h）[复位 = 0000h]

表 7-36 展示了 R72。

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表 7-36 R72 寄存器字段说明

位	字段	类型	复位值	说明
15	未披露	R	0h	将该字段编程为 0x0。
14-3	未披露	R/W	0h	将该字段编程为 0x0。
2	SYSREFREQ_FORCE	R/W	0h	设置该位可模拟 SYSREFREQ 引脚上逻辑高电平的行为，并导致 SYSREFREQ 引脚上的外部信号被忽略。
1-0	SYSREF_DLY_BYP	R/W	0h	可选择绕过延迟发生器重定时。在正常情况下 (SYSREF_DLY_BYP = 0)，延迟发生器用于连续模式或脉冲发生器模式（发生器模式），并在中继器模式下被旁路。这通常采用不同的延迟机制。在某些情况下，如果可以在 JESD 接收器上补偿 SYSREF 延迟，则通过设置 SYSREF_DLY_BYP = 1 在发生器模式下绕过延迟发生器重定时，可以大幅降低器件电流消耗。在其他情况下，通过设置 SYSREF_DLY_BYP = 2 将 SYSREFREQ 信号重定时到延迟发生器，可以提高 SYSREF 输出相位相对于 CLKIN 相位的精度；或者只要内插器分频器相位和 SYSREFREQ 相位之间存在相干相位关系，就可以独立地改变各个输出的延迟。 0h = 在发生器模式下接通，在中继器模式下旁路 1h = 在所有模式下旁路 2h = 在所有模式下接通 3h = 保留

7.5.1.32 R73 寄存器（偏移 = 49h）[复位 = 0000h]

表 7-37 展示了 R73。

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表 7-37 R73 寄存器字段说明

位	字段	类型	复位值	说明
15-13	未披露	R	0h	将该字段编程为 0x0。
12-0	未披露	R/W	0h	将该字段编程为 0x1000。请注意，这与复位值不同。

7.5.1.33 R75 寄存器（偏移 = 4Bh）[复位 = 0006h]

表 7-38 展示了 R75。

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表 7-38 R75 寄存器字段说明

位	字段	类型	复位值	说明
15	rb_CLK2_EN	R	0h	回读引脚状态
14	rb_CLK1_EN	R	0h	回读引脚状态
13	rb_CLK0_EN	R	0h	回读引脚状态
12	rb_MUXSEL1	R	0h	回读引脚状态
11	rb_MUXSEL0	R	0h	回读引脚状态
10	rb_LOGIC_EN	R	0h	回读引脚状态
9-8	rb_LD	R	0h	倍频器 PLL 锁定检测的回读。 0h = 未锁定（VTUNE 低电平） 1h = 保留 2h = 锁定 3h = 未锁定（VTUNE 高电平）
7	rb_DIVSEL2	R	0h	回读引脚状态
6	rb_DIVSEL1	R	0h	回读引脚状态
5	rb_DIVSEL0	R	0h	回读引脚状态
4	rb_CE	R	0h	回读引脚状态
3-0	未披露	R/W	6h	将该字段编程为 0x3。请注意，这与复位值不同。

7.5.1.34 R76 寄存器（偏移 = 4Ch）[复位 = 0000h]

表 7-39 展示了 R76。

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表 7-39 R76 寄存器字段说明

位	字段	类型	复位值	说明
15-4	未披露	R/W	0h	将该字段编程为 0x0。
3	rb_PWRSEL2	R	0h	回读引脚状态
2	rb_PWRSEL1	R	0h	回读引脚状态
1	rb_PWRSEL0	R	0h	回读引脚状态
0	rb_CLK3_EN	R	0h	回读引脚状态

7.5.1.35 R86 寄存器（偏移 = 56h）[复位 = 0000h]

表 7-40 展示了 R86。

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表 7-40 R86 寄存器字段说明

位	字段	类型	复位值	说明
15-3	未披露	R/W	0h	将该字段编程为 0x0。
2	MUXOUT_EN_OVRD	R/W	0h	无描述
1-0	未披露	R/W	0h	将该字段编程为 0x0。

7.5.1.36 R90 寄存器（偏移 = 5Ah）[复位 = 0000h]

表 7-41 展示了 R90。

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表 7-41 R90 寄存器字段说明

位	字段	类型	复位值	说明
15-8	未披露	R	0h	将该字段编程为 0x0。
7	未披露	R/W	0h	将该字段编程为 0x0。
6	LOGICLK_DIV_BYP3	R/W	0h	如果 LOGICLK_DIV_BYP=1，则应将该位设置为 1，否则应设置为 0。
5	LOGICLK_DIV_BYP2	R/W	0h	如果 LOGICLK_DIV_BYP=1，则应将该位设置为 1，否则应设置为 0。
4-0	未披露	R/W	0h	将该字段编程为 0x0。