ZHCSWZ2
June 2024
LMX1860-SEP
PRODUCTION DATA
1
1
特性
2
应用
3
说明
4
引脚配置和功能
5
规格
5.1
绝对最大额定值
5.2
ESD 等级
5.3
建议运行条件
5.4
热性能信息
5.5
电气特性
5.6
时序要求
5.7
时序图
5.8
典型特性
6
详细说明
6.1
概述
6.1.1
分频器和倍频器范围
6.2
功能方框图
6.3
特性说明
6.3.1
上电复位
6.3.2
温度传感器
6.3.3
时钟输出
6.3.3.1
时钟输出缓冲器
6.3.3.2
时钟多路复用器
6.3.3.3
时钟分频器
6.3.3.4
时钟倍频器
6.3.3.4.1
时钟倍频器基本信息
6.3.3.4.2
时钟倍频器的状态机时钟
6.3.3.4.2.1
状态机时钟
6.3.3.4.3
时钟倍频器校准
6.3.3.4.4
时钟倍频器锁定检测
6.3.3.4.5
看门狗计时器
6.3.4
器件功能模式配置
6.3.5
LOGICLK 输出
6.3.5.1
LOGICLK 输出格式
6.3.5.2
LOGICLK_DIV_PRE 和 LOGICLK_DIV 分频器
6.3.6
SYSREF
6.3.6.1
SYSREF 输出缓冲器
6.3.6.1.1
主时钟的 SYSREF 输出缓冲器 (SYSREFOUT)
6.3.6.1.2
用于 LOGICLK 的 SYSREF 输出缓冲器
6.3.6.2
SYSREF 频率和延迟生成
6.3.6.3
SYSREFREQ 引脚和 SYSREFREQ_FORCE 字段
6.3.6.3.1
SYSREFREQ 引脚共模电压
6.3.6.3.2
SYSREFREQ 窗口化特性
6.3.6.3.2.1
SYSREF 窗口化操作的一般过程流程图
6.3.6.3.2.2
具有延迟生成功能的 SYSREFREQ 中继器模式(重定时)
6.3.6.3.2.3
有关 SYSREF 窗口化的其他指导
6.3.6.3.2.4
用于无干扰输出
6.3.6.3.2.5
如果使用 SYNC 特性
6.3.6.3.3
SYNC 特性
6.3.7
引脚模式控制
6.3.7.1
芯片使能 (CE)
6.3.7.2
输出通道控制
6.3.7.3
逻辑输出控制
6.3.7.4
SYSREF 输出控制
6.3.7.5
器件模式选择
6.3.7.6
分频器或倍频器值选择
6.3.7.7
校准控制引脚
6.3.7.8
输出功率控制
7
应用和实施
7.1
应用信息
7.1.1
SYSREFREQ 输入配置
7.1.2
处理未使用的引脚
7.1.3
电流消耗
7.2
典型应用
7.2.1
本机振荡器分配应用
7.2.1.1
设计要求
7.2.1.2
详细设计过程
7.2.1.3
应用曲线图
7.2.2
JESD204B/C 时钟分配应用
7.3
布局
7.3.1
布局指南
7.3.2
布局示例
7.4
电源相关建议
7.4.1
上电时序
7.5
寄存器映射
7.5.1
器件寄存器
8
器件和文档支持
8.1
器件支持
8.2
文档支持
8.2.1
相关文档
8.3
接收文档更新通知
8.4
支持资源
8.5
商标
8.6
静电放电警告
8.7
术语表
9
修订历史记录
10
机械、封装和可订购信息
封装选项
机械数据 (封装 | 引脚)
PAP|64
MPQF071C
散热焊盘机械数据 (封装 | 引脚)
PAP|64
PPTD060M
订购信息
zhcswz2_oa
zhcswz2_pm
5.7
时序图
图 5-1
串行数据输入时序图
在 SPI 上写入时,还有其他几个注意事项:
R/W 位必须设置为 0。
SDI 引脚上的数据在 SCK 引脚的每个上升沿被时钟输入到移位寄存器中。
CS# 必须保持低电平,才能对数据进行时钟输入。如果 CS# 保持高电平,器件将忽略时钟脉冲。
该器件的建议 SPI 设置为 CPOL=0 和 CPHA=0。
如果在器件之间共享 SCK 和 SDI 线路,TI 建议在不进行时钟输入的器件上将 CS# 线路保持高电平。
SPI 回读还有其他几个注意事项:
R/W 位必须设置为 1。
对于事务的地址部分,MUXOUT 引脚将始终为低电平。
MUXOUT 上的数据在 SCK 的下降沿随时钟输出。也就是说,在时钟下降沿后的 t
CD
时,MUXOUT 引脚将提供回读数据。
始终忽略 SDI 线路上转换的数据部分。
回读事务完成后,MUXOUT 引脚不会自动进入三态。当与其他器件共享 SPI 总线回读引脚时,请在器件的所有回读事务完成后设置 MUXOUT_EN=0,以便手动将 MUXOUT 引脚置于三态,从而允许其他器件控制回读线路。
即使对于 R/W 位,回读值也并非总是写入的值,而是考虑了编程值以及其他因素(例如引脚状态)的内部器件状态。
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