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ZHCSSC6A february 2023 – june 2023 MSPM0G1106 , MSPM0G1107

ADVANCE INFORMATION

VDD=3.3V。所有输入都连接至 0V 或 VDD。输出不供应或吸收任何电流。所有外设均禁用。

参数		MCLK	-40°C		25°C		85°C		105°C		125°C		单位
参数		MCLK	典型值	最大值	典型值	最大值	典型值	最大值	典型值	最大值	典型值	最大值	单位
运行模式
IDD_RUN	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CoreMark，从闪存执行	80MHz	8		8		8		8		8		mA
	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CoreMark，从闪存执行	48MHz	5		5		5		5		6
	MCLK=SYSOSC、CoreMark，从闪存执行	32MHz	3		3		4		4		4
	MCLK=SYSOSC、CoreMark，从闪存执行	4MHz	0.7		0.7		0.9		1		1
	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CoreMark，从 SRAM 执行	80MHz	6		6		6		6		7
	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CoreMark，从 SRAM 执行	48MHz	4		4		4		4		5
	MCLK=SYSOSC、CoreMark，从 SRAM 执行	32MHz	3		3		3		3		3
	MCLK=SYSOSC、CoreMark，从 SRAM 执行	4MHz	0.6		0.6		0.8		0.9		1
IDD_RUN，每 MHz	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CoreMark，从闪存执行	80MHz	95		96		98		100		105		uA/MHz
IDD_RUN，每 MHz	MCLK=SYSPLL，SYSPLLREF=SYSOSC，While(1)，从闪存执行	80MHz	52		53		55		57		62		uA/MHz
SLEEP 模式
IDD_SLEEP	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CPU 暂停	80MHz	2711		2759		2919		3079		3458		uA
	MCLK=SYSPLL，SYSPLLREF=SYSOSC，CPU 暂停	48MHz	1876		1905		2063		2225		2595
	MCLK=SYSOSC，CPU 暂停	32MHz	1264		1294		1444		1603		1976 年
	MCLK=SYSOSC，CPU 暂停	4MHz	434		458		607		766		1139