ZHCSUT4B February   2024  – July 2024 SN74AC16-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 开关特性
    7. 5.7 典型特性
  7. 6 参数测量信息
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 开漏 CMOS 输出
      2. 7.3.2 CMOS 施密特触发输入
    4. 7.4 器件功能模式
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
        1. 8.2.1.1 电源注意事项
        2. 8.2.1.2 输入注意事项
        3. 8.2.1.3 输出注意事项
      2. 8.2.2 详细设计过程
      3. 8.2.3 应用曲线
    3. 8.3 电源相关建议
    4. 8.4 布局
      1. 8.4.1 布局指南
      2. 8.4.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 接收文档更新通知
    2. 9.2 支持资源
    3. 9.3 商标
    4. 9.4 静电放电警告
    5. 9.5 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息
    1. 11.1 卷带包装信息
    2. 11.2 机械数据

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • PW|14
  • BQA|14
散热焊盘机械数据 (封装 | 引脚)
订购信息

6 参数测量信息

对于下表中列出的示例，波形之间的相位关系是任意选择的。所有输入脉冲均由具有以下特性的发生器提供：PRR ≤ 1MHz，ZO = 50Ω，tt < 2.5。

输出单独测量，每次测量一个输入转换。

测试 S1 RL CL ΔV VCC
tPLZ、tPZL 闭合 1kΩ 50pF 0.15V ≤ 2.5V
tPLZ、tPZL 闭合 1kΩ 50pF 0.3V > 2.5V

SN74AC16-Q1 开漏输出的负载电路
(1) CL 包括探头和测试夹具电容。
图 6-1 开漏输出的负载电路
SN74AC16-Q1 电压波形传播延迟
(1) tPLZ 与 tdis 相同。
(2) tPZL 与 ten 相同。
图 6-2 电压波形传播延迟
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