该器件包含采用施密特触发架构的 TTL 兼容型 CMOS 输入。这些输入专门设计为通过降低的输入电压阈值与 TTL 逻辑器件连接。

TTL 兼容型施密特触发 CMOS 输入为高阻抗，通常建模为与输入电容并联的电阻器，如电气特性 中所示。最坏情况下的电阻是根据绝对最大额定值 中给出的最大输入电压和电气特性 中给出的最大输入漏电流，使用欧姆定律 (R = V ÷ I) 计算得出的。

施密特触发输入架构可提供由电气特性 表中的 ΔV_T 定义的迟滞，因而此器件能够很好地耐受慢速或高噪声输入。虽然输入的驱动速度可能比标准 CMOS 输入慢得多，但仍建议正确端接未使用的输入。用缓慢的转换信号驱动输入会增加器件的动态电流消耗。有关施密特触发输入的更多信息，请参阅了解施密特触发。

在运行期间，任何时候都不要让 TTL 兼容型 CMOS 输入悬空。未使用的输入必须在 V_CC 或 GND 端接。如果系统不会一直主动驱动输入，可以添加上拉或下拉电阻器，以在这些时间段提供有效的输入电压。电阻值将取决于多种因素；但建议使用 10kΩ 电阻器，这通常可以满足所有要求。