ZHCSSW9E
September 2003 – October 2024
SN74AHC1G32-Q1
PRODUCTION DATA
1
1
特性
2
应用
3
说明
4
引脚配置和功能
5
规格
5.1
绝对最大额定值
5.2
ESD 等级
5.3
建议运行条件
5.4
热性能信息
5.5
电气特性
5.6
开关特性,VCC = 3.3V ± 0.3V
5.7
开关特性,VCC = 5V ± 0.5V
5.8
工作特性
6
参数测量信息
7
详细说明
7.1
概述
7.2
功能方框图
7.3
特性说明
7.3.1
标准 CMOS 输入
7.3.2
平衡 CMOS 推挽式输出
7.3.3
钳位二极管结构
7.4
器件功能模式
8
应用和实施
8.1
应用信息
8.2
典型应用
8.2.1
设计要求
8.2.2
详细设计过程
8.2.3
应用曲线
8.3
电源相关建议
8.4
布局
8.4.1
布局指南
8.4.2
布局示例
9
器件和文档支持
9.1
文档支持
9.1.1
相关文档
9.2
接收文档更新通知
9.3
支持资源
9.4
商标
9.5
静电放电警告
9.6
术语表
10
修订历史记录
11
机械、封装和可订购信息
封装选项
请参考 PDF 数据表获取器件具体的封装图。
机械数据 (封装 | 引脚)
DBV|5
DCK|5
散热焊盘机械数据 (封装 | 引脚)
订购信息
zhcssw9e_oa
zhcssw9e_pm
6
参数测量信息
A.
C
L
包括探头和夹具电容。
B.
波形 1 用于具有内部条件的输出,使得输出为低电平,除非被输出控制禁用。波形 2 用于具有内部条件的输出,使得输出为高电平,除非被输出控制禁用。
C.
所有输入脉冲由具有以下特性的发生器提供:PRR ≤ 1MHz,Z
O
= 50Ω,t
r
≤ 3ns,t
f
≤ 3ns。
D.
一次测量一个输出,每次测量一个输入转换。
E.
并非所有参数和波形都适用于所有器件。
图 6-1
负载电路和电压波形
测试
S1
t
PLH
/t
PHL
开路
t
PLZ
/t
PZL
V
CC
t
PHZ
/t
PZH
GND
漏极开路
V
CC
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