ZHCSKE5 October   2019 SN74HCS72-Q1

PRODUCTION DATA.  

  1. 特性
  2. 应用
  3. 说明
    1.     Device Images
      1.      施密特触发输入的优势
  4. 修订历史记录
  5. Pin Configuration and Functions
    1.     Pin Functions
  6. Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Switching Characteristics
    7. 6.7 Timing Characteristics
    8. 6.8 Typical Characteristics
  7. Parameter Measurement Information
  8. Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 Balanced CMOS Push-Pull Outputs
      2. 8.3.2 CMOS Schmitt-Trigger Inputs
      3. 8.3.3 Positive and Negative Clamping Diodes
    4. 8.4 Device Functional Modes
  9. Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
        1. 9.2.1.1 Output Considerations
        2. 9.2.1.2 Input Considerations
        3. 9.2.1.3 Timing Considerations
      2. 9.2.2 Detailed Design Procedure
      3. 9.2.3 Application Curve
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
    2. 11.2 Layout Example
  12. 12器件和文档支持
    1. 12.1 文档支持
      1. 12.1.1 相关文档
    2. 12.2 接收文档更新通知
    3. 12.3 社区资源
    4. 12.4 商标
    5. 12.5 静电放电警告
    6. 12.6 Glossary
  13. 13机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

说明

该器件包含两个独立的 D 型负缘触发触发器。所有输入均包括施密特触发,可实现慢速或高噪声输入信号。将预设 (PRE) 输入设为低电平,会输出高电平。将清零 (CLR) 输入设为低电平,会重新输出低电平。预设和清零功能是异步的,并且不依赖于其他输入的电平。当 PRECLR 处于非活动状态(高电平)时,数据 (D) 输入处满足设置时间要求的数据将传输到时钟 (CLK) 脉冲负向缘上的输出(Q,Q)处。经过保持时间间隔后,可以更改数据 (D) 输入处的数据而不影响输出(Q,Q)处的电平。

器件信息(1)

器件型号 封装 封装尺寸(标称值)
SN74HCS72QDRQ1 SOIC (14) 8.70mm x 3.90mm
SN74HCS72QPWRQ1 TSSOP (14) 5.00mm x 4.40mm
  1. 如需了解所有可用封装,请参阅数据表末尾的可订购米6体育平台手机版_好二三四附录。