ZHCSUJ0 January   2024 SN74LV6T17-EP

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 引脚配置和功能
  6. 5 规格
    1. 5.1 绝对最大额定值
    2. 5.2 ESD 等级
    3. 5.3 建议运行条件
    4. 5.4 热性能信息
    5. 5.5 电气特性
    6. 5.6 开关特性
    7. 5.7 噪声特性
    8. 5.8 典型特性
  7. 6 参数测量信息
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 平衡 CMOS 推挽式输出
      2. 7.3.2 钳位二极管结构
      3. 7.3.3 CMOS 施密特触发输入
      4. 7.3.4 LVxT 增强输入电压
        1. 7.3.4.1 降压转换
        2. 7.3.4.2 升压转换
    4. 7.4 器件功能模式
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 设计要求
        1. 8.2.1.1 电源注意事项
        2. 8.2.1.2 输入注意事项
        3. 8.2.1.3 输出注意事项
      2. 8.2.2 详细设计过程
      3. 8.2.3 应用曲线
  10. 9 电源相关建议
  11. 10布局
    1. 10.1 布局指南
    2. 10.2 布局示例
  12. 11器件和文档支持
    1. 11.1 文档支持
      1. 11.1.1 相关文档
    2. 11.2 接收文档更新通知
    3. 11.3 支持资源
    4. 11.4 商标
    5. 11.5 静电放电警告
    6. 11.6 术语表
  13. 12修订历史记录
  14. 13机械、封装和可订购信息

封装选项

请参考 PDF 数据表获取器件具体的封装图。

机械数据 (封装 | 引脚)
  • PW|14
散热焊盘机械数据 (封装 | 引脚)
订购信息

8.2.2 详细设计过程

  1. 在 VCC 至 GND 之间添加一个去耦电容器。此电容器需要在物理上靠近器件，在电气上靠近 VCC 和 GND 引脚。布局 部分中展示了示例布局。
  2. 确保输出端的容性负载 ≤ 50pF。这不是硬性限制；但这将优化性能。这可以通过从 SN74LV6T17-EP 向一个或多个接收器件提供适当大小的短布线来实现。
  3. 确保输出端的电阻负载大于 (VCC / IO(max)) Ω，以便不会超过绝对最大额定值 中规定的最大输出电流。大多数 CMOS 输入具有以 MΩ 为单位的电阻负载；远大于之前计算的最小值。
  4. 逻辑门很少关注热问题；然而，可以使用应用报告 CMOS 功耗与 Cpd 计算 中提供的步骤计算功耗和热增量。
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