IOVDD 和 AVDD 电源轨之间的电源序列可以按任何顺序应用。不过，应将 SHDNZ 引脚保持为低电平，直到 IOVDD 电源电压稳定至支持的工作电压范围。在所有电源稳定后，将 SHDNZ 引脚设置为高电平以初始化器件。

对于电源上电要求，t₁ 和 t₂ 必须至少为 100µs。对于电源断电要求，t₃ 和 t₄ 必须至少为 10ms。该时序（如16 所示）允许器件慢慢降低录音数据的音量，关闭模拟和数字块，以及将器件置于硬件关断模式。如果使用 P0_R5_D[3:2] 位将 SHDNZ_CFG[1:0] 设置为 2'b00，则还可以立即将器件从工作模式置于硬件关断模式。在这种情况下，t₃ 和 t₄ 需要至少为 100µs。

图 8-3 电源时序要求时序图

确保电源斜坡速率低于 1V/μs，并且断电和上电事件之间的等待时间至少为 100ms。

释放 SHDNZ 后或软件复位后，将器件的任何额外 I²C 或 SPI 事务延迟至少 2ms，以便器件可以初始化内部寄存器。有关器件电源稳定至建议的工作电压电平后，该器件如何在各种模式下运行的详细信息，请参阅 节 6.4部分。

TAA3040 通过集成片上数字稳压器 DREG 和模拟稳压器 AREG，支持单 AVDD 电源运行。但是，如果系统中的 AVDD 电压低于 1.98V，请将板载 AREG 和 AVDD 引脚短接，并通过将 P0_R2 的 AREG_SELECT 位保持为 1b'0（默认值）来不启用内部 AREG。如果系统中使用的 AVDD 电源高于 2.7V，则主机器件可以在退出睡眠模式时将 AREG_SELECT 设置为 1'b1，以便器件内部稳压器可以生成 AREG 电源。