ZHCSPM5A December   2023  – November 2024 TAC5242

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
  5. 4 器件比较表
  6. 5 引脚配置和功能
  7. 6 规格
    1. 6.1 绝对最大额定值
    2. 6.2 ESD 等级
    3. 6.3 建议运行条件
    4. 6.4 热性能信息
    5. 6.5 电气特性
    6. 6.6 时序要求：TDM、I2S 或 LJ 接口
    7. 6.7 开关特性：TDM、I2S 或 LJ 接口
    8. 6.8 时序图
    9. 6.9 典型特性
  8. 7 详细说明
    1. 7.1 概述
    2. 7.2 功能方框图
    3. 7.3 特性说明
      1. 7.3.1 硬件控制
      2. 7.3.2 音频串行接口
        1. 7.3.2.1 时分多路复用 (TDM) 音频接口
        2. 7.3.2.2 IC 间音频 (I2S) 接口
        3. 7.3.2.3 左对齐 (LJ) 接口
      3. 7.3.3 锁相环 (PLL) 和时钟生成
      4. 7.3.4 模拟输入和输出配置
      5. 7.3.5 基准电压
      6. 7.3.6 集成麦克风偏置
      7. 7.3.7 ADC 信号链
        1. 7.3.7.1 数字高通滤波器
        2. 7.3.7.2 可配置数字抽取滤波器
          1. 7.3.7.2.1 线性相位滤波器
            1. 7.3.7.2.1.1 采样速率：8kHz 或 7.35kHz
            2. 7.3.7.2.1.2 采样速率：16kHz 或 14.7kHz
            3. 7.3.7.2.1.3 采样速率：24kHz 或 22.05kHz
            4. 7.3.7.2.1.4 采样速率：32kHz 或 29.4kHz
            5. 7.3.7.2.1.5 采样速率：48kHz 或 44.1kHz
            6. 7.3.7.2.1.6 采样速率：96kHz 或 88.2kHz
            7. 7.3.7.2.1.7 采样速率：192kHz 或 176.4kHz
          2. 7.3.7.2.2 低延迟滤波器
            1. 7.3.7.2.2.1 采样速率：24kHz 或 22.05kHz
            2. 7.3.7.2.2.2 采样速率：32kHz 或 29.4kHz
            3. 7.3.7.2.2.3 采样速率：48kHz 或 44.1kHz
            4. 7.3.7.2.2.4 采样速率：96kHz 或 88.2kHz
            5. 7.3.7.2.2.5 采样速率：192kHz 或 176.4kHz
      8. 7.3.8 DAC 信号链
        1. 7.3.8.1 数字内插滤波器
          1. 7.3.8.1.1 线性相位滤波器
            1. 7.3.8.1.1.1 采样速率：8kHz 或 7.35kHz
            2. 7.3.8.1.1.2 采样速率：16kHz 或 14.7kHz
            3. 7.3.8.1.1.3 采样速率：24kHz 或 22.05kHz
            4. 7.3.8.1.1.4 采样速率：32kHz 或 29.4kHz
            5. 7.3.8.1.1.5 采样速率：48kHz 或 44.1kHz
            6. 7.3.8.1.1.6 采样速率：96kHz 或 88.2kHz
            7. 7.3.8.1.1.7 采样速率：192kHz 或 176.4kHz
          2. 7.3.8.1.2 低延迟滤波器
            1. 7.3.8.1.2.1 采样速率：24kHz 或 22.05kHz
            2. 7.3.8.1.2.2 采样速率：32kHz 或 29.4kHz
            3. 7.3.8.1.2.3 采样速率：48kHz 或 44.1kHz
            4. 7.3.8.1.2.4 采样速率：96kHz 或 88.2kHz
            5. 7.3.8.1.2.5 采样速率：192kHz 或 176.4kHz
    4. 7.4 器件功能模式
      1. 7.4.1 工作模式
  9. 8 应用和实施
    1. 8.1 应用信息
    2. 8.2 典型应用
      1. 8.2.1 应用
      2. 8.2.2 设计要求
      3. 8.2.3 详细设计过程
      4. 8.2.4 应用性能曲线图
    3. 8.3 电源相关建议
    4. 8.4 布局
      1. 8.4.1 布局指南
      2. 8.4.2 布局示例
  10. 9 器件和文档支持
    1. 9.1 文档支持
      1. 9.1.1 相关文档
    2. 9.2 接收文档更新通知
    3. 9.3 支持资源
    4. 9.4 商标
    5. 9.5 静电放电警告
    6. 9.6 术语表
  11. 10修订历史记录
  12. 11机械、封装和可订购信息

封装选项

机械数据 (封装 | 引脚)
散热焊盘机械数据 (封装 | 引脚)
订购信息

7.3.4 模拟输入和输出配置

该器件支持使用高性能立体声 ADC 同时对多达两个通道进行录音。该器件包含两对模拟输入引脚（INxP 和 INxM），可通过设置 MD4 和 MD5 引脚配置为单端或差分输入模式。模拟引脚的输入源可以来自驻极体电容式模拟麦克风、微机电系统 (MEMS) 模拟麦克风，或来自系统板的线路输入（辅助输入）。

语音或音频信号输入可以容性耦合（交流耦合）或直流耦合到器件。为了获得出色的失真性能，建议使用低电压系数电容器进行交流耦合。对于 INxP 或 INxM 引脚，TAC5242 的典型输入阻抗是 5kΩ 并存在 ±20% 的偏差。在交流耦合模式下，选择的耦合电容值必须确保由耦合电容器和输入阻抗形成的高通滤波器不影响信号内容。该耦合电容器必须在上电时充电至共模电压，然后才能开始进行正确录音。为了实现快速充电，该器件具有快速充电方案，可在 I2 S/LJ 目标模式下运行时加快耦合电容器在上电时的充电速度。可以通过配置 MD3 引脚来启用该输入电容器快速充电设置。当器件在 I2 S/LJ 目标模式下运行时，MD3 引脚还可配置 ADC 信号路径的数字 HPF 截止频率，如表 7-11 所述。

为获得更佳的性能，对于交流耦合设置，器件输入端的共模变化应限制在 100mVpp 以下。对于无法避免较大共模波动的应用，该器件提供多种模式，可为单端和差分应用配置更高的共模容差。

该器件使用高性能立体声 DAC 支持两个通道的回放。该器件包含两对模拟输出引脚（OUTxP 和 OUTxM），可通过设置 MD4 和 MD5 引脚配置为单端或差分输入模式。这些通道的输入源来自 TDM/I2S/LJ 接口。

表 7-11 展示了 MD4 和 MD5 配置所提供的模拟输入输出配置模式。

表 7-10 模拟输入和输出配置
MD5 MD4 模拟输入配置 模拟输出配置
低 低 差分输入；仅交流耦合 差分输出；仅线路输出
低 高 差分输入；具有高共模容差的交流或直流耦合 差分输出；接收器/耳机负载或线路输出
高 低 INxP 上的单端输入；仅交流耦合 单端输出；仅线路输出
高 高 INxP 上的单端输入；具有高共模容差的交流或直流耦合 具有外部共模检测功能的伪差分输出；仅耳机负载

图 7-6 至图 7-9 展示了各种输入配置模式的典型配置图，图 7-10 至图 7-12 展示了各种输出模式的典型配置图。

TAC5242 直流耦合麦克风或线路差分输入连接图 7-6 直流耦合麦克风或线路差分输入连接
TAC5242 直流耦合麦克风或线路单端输入连接图 7-7 直流耦合麦克风或线路单端输入连接
TAC5242 交流耦合麦克风或线路差分输入连接图 7-8 交流耦合麦克风或线路差分输入连接
TAC5242 交流耦合麦克风或线路单端输入连接图 7-9 交流耦合麦克风或线路单端输入连接

TAC5242 差分输出连接图 7-10 差分输出连接

TAC5242 单端输出连接图 7-11 单端输出连接

TAC5242 具有外部共模检测功能的伪差分输出连接图 7-12 具有外部共模检测功能的伪差分输出连接
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