比较器子系统 (CMPSS) 由模拟比较器和支持电路组成，这些电路对于峰值电流模式控制、开关模式电源、功率因数校正、电压跳闸监控等电源应用非常有用。

该器件包含两种型号的 CMPSS 模块：CMPSS 和 CMPSS_LITE。这些模块共用一个通用架构，但是某些特性只有完整 CMPSS 型号支持，而 CMPSS_LITE 型号并不支持。

比较器子系统基于多个模块构建而成。每个子系统包含两个比较器、两个基准 12 位 DAC（CMPSS_LITE 实例是 9.5 位有效基准 DAC）和两个数字滤波器。该子系统还包括一个斜坡发生器（仅限完整的 CMPSS 模块；CMPSS_LITE 实例并不支持）。比较器在每个模块中用“H”或“L”表示，其中“H”代表高电平，“L”代表低电平。每个比较器都会生成一个数字输出，指示正输入端的电压是否大于负输入端的电压。比较器的正输入由一个外部引脚驱动（请参阅 TMS320F280013x 实时微控制器技术参考手册 中的模拟子系统 一章，了解适用于 CMPSS 的多路复用器选项）。负输入可由外部引脚或可编程基准 12 位 DAC 驱动。每个比较器输出都会通过一个可编程的数字滤波器，该滤波器可以去除伪跳变信号。如果不需要滤波，也可以使用未滤波的输出。一个斜坡发生器电路可用于控制该子系统中高电平比较器的基准 12 位 DAC 值（仅限完整 CMPSS 模块；CMPSS_LITE 实例并不支持）。

每个 CMPSS 包含：

• 两个模拟比较器
• 两个可编程的基准 12 位 DAC（CMPSS_LITE 实例上为 9.5 位有效 DAC）
• 一个斜坡发生器（仅限完整 CMPSS；CMPSS_LITE 实例上没有）
• 两个数字滤波器，65536 最大滤波器时钟预分频
• 能够将各个子模块与 EPWMSYNCPER 同步
• 能够通过 EPWMBLANK 扩展清除信号
• 能够将输出与 SYSCLK 同步
• 能够锁存输出
• 能够反转输出
• 可选择在输入端使用迟滞
• 可选择通过外部信号或基准 DAC 驱动比较器的负输入
• 可选择在外部引脚上使用低电平比较器 DAC 输出 CMPx_DACL（仅限部分实例，不能与比较功能同时使用）