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PRODUCTION DATA

请参考 PDF 数据表获取器件具体的封装图。

		最小值	标称值	最大值	单位
f_(SYSCLK)	频率，器件（系统）时钟	2		200⁽²⁾	MHz
t_c(SYSCLK)	周期，器件（系统）时钟	5⁽²⁾		500	ns
f_(PLLRAWCLK)	频率，系统 PLL 输出（在 SYSCLK 分频器之前）	120		400	MHz
f_{(AUXPLLRAWCLK)}	频率，辅助 PLL 输出（在 AUXCLK 分频器之前）	120		400	MHz
f_(AUXPLL)	频率，AUXPLLCLK	2	60	60	MHz
f_(PLL)	频率，PLLSYSCLK	2		200⁽²⁾	MHz
f_(LSP)	频率，LSPCLK	2		200⁽²⁾	MHz
t_c(LSPCLK)	周期，LSPCLK	5⁽²⁾		500	ns
f_(OSCCLK)	频率，OSCCLK（INTOSC1、INTOSC2、XTAL 或 X1）		参阅各自的时钟		MHz
f_(EPWM)	频率，EPWMCLK⁽¹⁾			100	MHz
f_(HRPWM)	频率，HRPWMCLK	60		100	MHz

(1) 对于 100MHz 以上的 SYSCLK，EPWMCLK 必须是 SYSCLK 的一半。

(2) 使用外部时钟源。如果使用 INTOSC1 或 INTOSC2 作为时钟源，那么最大频率为 194MHz，最小周期为 5.15ns。