ZHCSQE1 January 2024 TPS4810-Q1
ADVANCE INFORMATION
- 1
- 1 特性
- 2 应用
- 3 说明
- 4 Pin Configuration and Functions
- 5 Specifications
- 6 Parameter Measurement Information
-
7 Detailed Description
- 7.1 Overview
- 7.2 Functional Block Diagram
- 7.3
Feature Description
- 7.3.1 Charge Pump and Gate Driver Output (VS, G1PU, G1PD, G2, BST, SRC)
- 7.3.2 Capacitive Load Driving Using FET Gate (G1PU, G1PD) Slew Rate Control
- 7.3.3 Short-Circuit Protection
- 7.3.4 Undervoltage Protection (UVLO)
- 7.3.5 Reverse Polarity Protection
- 7.3.6 Short-Circuit Protection Diagnosis (SCP_TEST)
- 7.3.7 TPS48100-Q1 as a Simple Gate Driver
- 7.4 Device Functional Modes
- 8 Application and Implementation
- 9 Device and Documentation Support
- 10Revision History
- 11Mechanical, Packaging, and Orderable Information
3 说明
TPS48100-Q1 是一款具有保护和诊断功能的 100V 低 IQ 智能高侧驱动器。该器件具有 3.5V 至 80V 的宽工作电压范围，适用于 12V、24V 和 48V 系统设计。该器件可以承受低至 –65V 的负电源电压并保护负载免受这些电压的影响。
它包含两个具有单独控制输入（INP1、INP2）的强大 2A（拉电流和灌电流）栅极驱动器，用于驱动采用共源极配置的背靠背 MOSFET。强大的栅极驱动能力可在大电流系统设计中使用并联 MOSFET 实现电源开关。
该器件提供可调节的短路保护功能。可以配置自动重试和锁存故障行为。可通过外部检测电阻或 MOSFET VDS 检测完成电流检测。可通过使用 CS_SEL 引脚输入实现高侧或低侧电流检测电阻配置。该器件还通过对 SCP_TEST 输入的外部控制来诊断内部短路比较器。
运行期间的低静态电流(35µA，典型值）可实现常开型系统设计。在 EN/UVLO 处于低电平时，静态电流降至 1.5μA（典型值）。
TPS48100-Q1 可采用 19 引脚 VSSOP 封装。
(1) 如需了解所有可用封装，请参阅数据表末尾的可订购米6体育平台手机版_好二三四附录。
(2) 封装尺寸（长 x 宽）为标称值，并包括引脚（如适用）。
具有独立放电和充电 FET 控制的 BMS 断路器
具有低侧电流检测功能的 BMS 断路器