OFF 请求或关断故障会触发断电序列。如果配置为 EN 或 VSENSE，则可以通过 EN/PB/VSENSE 上的下降沿触发 OFF 请求；如果配置为 PB，则可以通过长按按钮触发 OFF 请求；也可以通过向 MFP_CTRL 寄存器中的 I2C_OFF_REQ 发送 I2C 命令指令来触发 OFF 请求。该位会自我清除。

I2C 触发关断需要在 EN/PB/VSENSE 引脚上重新发出 ON 请求。在 EN 或 VSENSE 配置中，需要在 EN/PB/VSENSE 引脚上产生一个下降沿，接着是一个上升沿。EN 或 VSENSE 配置的下降沿抗尖峰脉冲时间 t_{DEGL_EN/VSENSE_I2C} 短于由引脚触发的关闭请求的抗尖峰脉冲时间（t_{DEGL_EN_Fall} 和 t_{DEGL_VSENSE_Fall}）。PB 配置的抗尖峰脉冲时间保持不变。

在许多情况下，断电序列遵循与上电序列相反的顺序。在某些应用中，需要同时关断所有电源轨，电源轨之间没有延迟，或者需要等待一段时间以确保电源轨放电。

断电序列配置如下：

• 每个电源轨的时隙（即，在序列中的位置）以及 GPO1、GPO2、GPIO 和 nRSTOUT 使用相应的 *_SEQUENCE_SLOT 寄存器、上电序列的四个 MSB 和断电序列的四个 LSB 来定义。
• 每个时隙的持续时间在 POWER_DOWN_SLOT_DURATION_x 寄存器中定义，可以配置为 0ms、1.5ms、3ms 或 10ms。总共可以配置 16 个时隙，如果需要支持更多电源轨，则允许序列跨越多个 TPS65219-Q1 器件。
• 除了时隙持续时间外，除非在前一个电源轨上已禁用有源放电，否则前一个电源轨是否已经放电至 SCG 阈值以下也是断电序列的一个限制因素。如果没有发生这种情况，则暂停后续电源轨的断电。为了在电源轨偏置或短路的情况下断电，在前一个电源轨经过八倍的时隙持续时间（或者在时隙持续时间为 0ms 情况下达到 12ms）后，即使前一个电源轨未完全放电，关断序列仍将继续。
• 要绕过放电检查，请将寄存器 GENERAL_CONFIG 中的 BYPASS_RAILS_DISCHARGED_CHECK 位设置为“1”。

默认情况下会启用有源放电，而不基于 NVM。因此，如果需要，在每次 VSYS 下电上电后都需要禁用放电。在 RESET 或 OFF 请求期间，只要存在 VSYS，就不会复位放电配置。不过，在 INITIALIZE 状态下以及在上电序列之前，无论设置如何，所有电源轨都会放电。

在断电序列期间，除了未屏蔽的中断位和 *_DISCHARGE_EN 位之外，不受 EEPROM 支持的位会复位。

下图以 NVM-ID 0x01、版本 0x2 为例，展示了断电序列：

图 6-3 断电时序（示例）