UCC27524 器件的输入引脚基于与 TTL 和 CMOS 兼容的输入阈值逻辑，该逻辑与 VDD 电源电压无关。在典型高电平阈值为 2V 且典型低电平阈值为 1V 的情况下，可以使用从 3.3V 和 5V 数字电源控制器器件获取的 PWM 控制信号方便地驱动逻辑电平阈值。与传统的 TTL 逻辑实现（其中的迟滞通常小于 0.5V）相比，更宽的迟滞（通常为 1V）可提供增强的噪声抗扰度。UCC27524 器件还能够对输入引脚阈值电压电平进行严格的控制，从而简化系统设计注意事项，并确保在整个温度范围内稳定运行（请参阅典型特性）。这些引脚上的极低输入电容可减小负载并提高开关速度。

UCC27524 器件具有一个重要的保护特性，能够在相应引脚处于悬空状态时保持通道的输出。这是在所有同相输入引脚（INA、INB）上使用 GND 下拉电阻实现的，如器件方框图所示。

每个驱动器的输入级由具有较短上升或下降时间的信号进行驱动。在典型的电源应用中，输入信号由 PWM 控制器或具有较短转换时间 (<200ns) 的逻辑门提供，输入电压变化较慢，驱动器的输出可能会以高频率反复开关，因此可以满足这一条件。与大多数其他 TTL 输入阈值器件相比，UCC27524 提供的宽迟滞无疑缓解了这种担忧，但在这些实现中仍需格外小心。如果主要目标是限制功率器件的上升或下降时间，那么强烈建议在驱动器的输出和功率器件之间添加一个外部电阻。该外部电阻可提供一个额外的优势，即降低栅极驱动器器件封装中与栅极电荷相关的部分功率耗散，并将其转移到外部电阻自身中。