在系统启动期间，VDD 电压从 0V 开始升高。在 VDD 电压达到其相应的导通阈值之前，IC 在 UVLO 模式下工作。在 UVLO 模式下工作期间，不会生成 VREF 引脚电压。当 VDD 高于 1V 且低于导通阈值时，VREF 引脚被主动拉至低电平。这样一来，VREF 可以用作逻辑信号以指示 UVLO 模式。如果到 VDD 的偏置电压降至 UVLO 关断阈值以下，则 PWM 开关会停止，且 VREF 恢复为 0V。通过向 VDD 引脚施加大于 UVLO 导通阈值的电压，可以重新启动器件。