ZHCA781A January   2018  – February 2019 TLV1702 , TLV431

 

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设计目标

输入电压 输出 电源
ViMin ViMax VoMin VoMax Vcc Vee Vref
0V 5V 0V 36V 5V 0V 2.5V
VL(阈值下限) VH(阈值上限) 阈值上下限比率
1.66V 3.33V 2

设计说明

该电路采用了两个并联的比较器来确定信号是否介于两个参考电压之间。如果信号处于窗口范围内,则输出高电平。如果信号电平超出窗口范围,则输出低电平。在该设计中,参考电压由带分压器的单电源生成。

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设计注意事项

  1. 输入不应超过比较器的共模限制。
  2. 如果使用了上拉电压,则 Rp 应作相应调整,防止大量电流消耗。TLV1701 最高可支持 36 V 的上拉电压。
  3. 比较器必须为漏极开路或集电极开路才能进行 OR 运算输出。

设计步骤

  1. 确定上限 (VH) 和下限 (VL) 窗口电压。
    V H = V cc × R 1 + R 2 R 1 + R 2 + R 3 = 3 .33 V
    V L = V cc × R 1 R 1 + R 2 + R 3 = 1 .66 V
    V H V L = 1 + R 2 R 1 = 3.33 V 1.66 V = 2
  2. 选择电阻值来达到所需的窗口电压。
    V H V L = 1 + R 2 R 1 = 2 因此  R 2 = R 1
    R 1 = R 2 = 10  (Selected standard values)
R 3 = R 1 x V cc V L ( R 1 + R 2 )
R 3 = 10 × 5 V 1.66 V 20 = 10 0.12 10  (标准值)

设计仿真

瞬态仿真结果

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设计参考资料

有关 TI 综合电路库的信息,请参阅模拟工程师电路手册

请参阅电路 SPICE 仿真文件 SBOC516

请参阅 TIPD178

设计采用的运算放大器

TLV1702
Vcc 2.2V 至 36V
VinCM 轨到轨
Vout 集电极开路(最大 36V)
Vos 2.5 mV
Iq 75µA/通道
Ib 15nA
上升时间 365ns
下降时间 240ns
通道数 1、2 和 4
TLV1702