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ZHCAB92A October 2020 – July 2021 AM2431 , AM2432 , AM2434 , AM6411 , AM6412 , AM6421 , AM6441 , AM6442

3.14 数据组布线规格

字节信号网类别中的偏差会直接降低 DQ 和 DM 网的建立和保持裕度。因此，与 ADDR_CTRL 信号网类别和相关的 CK 时钟网类别一样，必须控制该偏差。PCB 布线具有与其长度成正比的延迟。因此，必须通过匹配一组定义的信号内布线的长度来管理长度偏差。在 PCB 上实际匹配长度的唯一方法是将较短的迹线延长至网类别中最长的网及其相关时钟的长度。

注：

不需要也不建议在所有字节通道之间匹配长度。仅需要在每个字节内进行长度匹配。

表 3-7 包含字节 0 和字节 1 布线组的布线规格。每个信号网类别及其相关的时钟网类别都是独立布线并进行匹配的。

表 3-7 数据组布线规格

数量	参数	最小值	最大值	单位
LP4_DRS1	网类别 DQSx 的传播延迟 (RSD1)		500	ps
LP4_DRS2	网类别 BYTEx 的传播延迟 (RSD2)		500	ps
LP4_DRS3	网类别 DQSx 内的偏差（DDR0_DQSx 至 DDR0_DQSx_n 偏差）		0.4	ps
LP4_DRS4	网类别 DQSx 和 BYTEx 上的偏差（RSD1 至 RSD2 偏差）⁽¹⁾⁽²⁾		2	ps
LP4_DRS5	网类别 BYTEx 内的偏差（DQ/DM 至 DQ/DM 偏差）⁽¹⁾		2	ps
LP4_DRS6	每条迹线上的过孔数		2⁽⁴⁾	个过孔
LP4_DRS7	过孔数差异		0⁽³⁾	个过孔
LP4_DRS8	RSD1 中心到中心间距（时钟网类别之间）⁽⁵⁾	4w
LP4_DRS9	RSD1 中心到中心间距（时钟网类别内）⁽⁶⁾⁽⁷⁾	请参阅以下注意事项
LP4_DRS10	RSD2 中心到中心间距（信号网类别之间）⁽⁵⁾	4w
LP4_DRS11	RSD2 中心到中心间距（信号网类别内）⁽⁵⁾	3w

(1) 仅在一个字节内进行长度匹配。不需要也不建议在字节之间进行长度匹配。

(2) 每个 DQS 对和与其关联的字节进行长度匹配。

(3) 只有在应用了信号飞行时间的精确 3-D 建模以确保不超过 DQn 偏差和 DQSn 至 DQn 偏差最大值时，过孔数差异才可能增加 1。

(4) 最大值基于保守的信号完整性方法。仅当上升时间和下降时间的详细信号完整性分析确认运行和预期一致时，才能扩展该值。

(5) 对于最长达 500 mil 的布线长度，允许中心到中心间距降至最小 2w（仅在端点附近）。

(6) 设置 DQS 对间距以确保具有适当的差分阻抗。

(7) 用户必须控制阻抗，以免造成无意的阻抗不匹配。一般来说，中心到中心间距应为 2w 或略大于 2w，从而使该层上的差分阻抗等于单端阻抗 Zo 的两倍。