ZHCACH4A September   2024  – September 2024 AM62A3 , AM62A3-Q1 , AM62A7 , AM62A7-Q1

 

  1.   1
  2.   摘要
  3.   商标
  4. 引言
    1. 1.1 开始定制电路板设计之前的准备工作
    2. 1.2 处理器选择
    3. 1.3 技术文档
      1. 1.3.1 更新了 SK 原理图(添加了设计、审核和 CAD 注解)
      2. 1.3.2 支持定制电路板设计的常见问题解答
    4. 1.4 设计文档
  5. 方框图
    1. 2.1 创建方框图
    2. 2.2 配置引导模式
    3. 2.3 确认 PinMux(PinMux 配置)
  6. 电源
    1. 3.1 电源架构
      1. 3.1.1 集成电源
      2. 3.1.2 分立式电源
    2. 3.2 电源轨
      1. 3.2.1 内核电源
      2. 3.2.2 外设电源
      3. 3.2.3 动态切换双电压 IO 电源 LDO
      4. 3.2.4 IO 组(处理器)的内部 LDO
      5. 3.2.5 双电压 IO(用于处理器 IO 组)
      6. 3.2.6 VPP(电子保险丝 ROM 编程)电源
    3. 3.3 确定电路板电源要求
    4. 3.4 电源滤波器
    5. 3.5 电源去耦和大容量电容
      1. 3.5.1 PDN 目标阻抗说明
    6. 3.6 电源时序控制
    7. 3.7 电源诊断
    8. 3.8 电源监控
  7. 处理器时钟
    1. 4.1 处理器外部时钟源
      1. 4.1.1 未使用的 WKUP_LFOSC0
      2. 4.1.2 LVCMOS 数字时钟源
      3. 4.1.3 晶体选型
    2. 4.2 处理器时钟输出
  8. JTAG(联合测试行动组)
    1. 5.1 JTAG/仿真
      1. 5.1.1 JTAG/仿真的配置
      2. 5.1.2 JTAG/仿真的实现
      3. 5.1.3 JTAG 接口信号的连接
  9. 配置(处理器)和初始化(处理器和器件)
    1. 6.1 处理器复位
    2. 6.2 引导模式配置的锁存
    3. 6.3 复位附加器件
    4. 6.4 看门狗计时器
  10. 处理器外设
    1. 7.1  跨域选择外设
    2. 7.2  存储器 (DDRSS)
      1. 7.2.1 处理器 DDR 子系统和器件寄存器配置
      2. 7.2.2 DDRSS 的校准电阻器连接
      3. 7.2.3 附加存储器器件 ZQ 和 Reset_N 连接
    3. 7.3  媒体和数据存储接口
    4. 7.4  通用平台以太网交换机 3 端口千兆位(CPSW3G - 用于以太网接口)
    5. 7.5  可编程实时单元子系统 (PRUSS)
    6. 7.6  通用串行总线 (USB) 子系统
    7. 7.7  通用连接外设
    8. 7.8  显示子系统 (DSS)
    9. 7.9  摄像头子系统 (CSI)
    10. 7.10 处理器电源引脚、未使用外设和 IO 的连接
      1. 7.10.1 外部中断 (EXTINTn)
      2. 7.10.2 预留 (RSVD) 引脚
  11. 处理器 IO(LVCMOS 或开漏或失效防护型 IO 缓冲器)的接口和仿真
  12. 处理器电流额定值和散热分析
    1. 9.1 功耗估算
    2. 9.2 不同电源轨的最大电流额定值
    3. 9.3 电源模式
    4. 9.4 热设计指南
      1. 9.4.1 VTM(电压热管理模块)
  13. 10原理图:设计、捕获、录入和审阅
    1. 10.1 选择元件和值
    2. 10.2 原理图设计和捕获
    3. 10.3 原理图审阅
  14. 11布局规划、布局、布线指南、电路板层和仿真
    1. 11.1 PCB 设计迂回布线
    2. 11.2 LPDDR4 设计和布局布线指南
    3. 11.3 高速差分信号布线指南
    4. 11.4 电路板层数和堆叠
      1. 11.4.1 仿真建议
    5. 11.5 运行仿真时应遵循的步骤参考
  15. 12定制电路板组装和测试
    1. 12.1 指南和电路板启动提示
  16. 13器件处理和组装
    1. 13.1 焊接建议
      1. 13.1.1 其他参考内容
  17. 14参考资料
    1. 14.1 处理器特定
    2. 14.2 通用
  18. 15术语
  19. 16修订历史记录

通用串行总线 (USB) 子系统

该处理器系列支持最多两个 USB 2.0 端口。这些端口可以配置为主机、设备或双角色设备 (DRD)。使用任何处理器 GPIO 都支持 USBn_ID(识别)功能。

在连接到 USBn_VBUS [n = 0..1] 引脚之前,请按照器件特定数据表的 USB VBUS 设计指南 一节根据情况调节 USB VBUS 电压(USB 接口连接器附近的电源)。

当 USB 接口配置为器件模式时,建议连接 VBUS(VBUS 电源输入,包括电压调节电阻器分压器/钳位器)输入。VBUS 的连接(VBUS 电源输入,包括电压调节电阻器分压器/钳位器)在处理器 USB 主机模式下是可选的。

当 USB 接口配置为 VBUS 控制主机时,建议使用带 OC(过流)输出指示的电源开关。USB DRVVBUS 驱动电源开关。当 USB 接口配置为主机时,建议将 OC 输出连接到处理器 GPIO(输入)。

有关与 USB 连接和 On-The-Go 特性支持相关的详情,请参阅器件特定 TRM。

有关更多详细信息,请参阅器件特定 TRM 中外设 一章的高速串行接口 部分。

当不使用 USB0 和 USB1 时,请参阅器件特定数据表的引脚连接要求 部分来连接 USB 电源引脚。

当不使用 USB0 或 USB1 时,请参阅器件特定数据表的引脚连接要求 部分来连接接口信号和 USB 电源引脚。

有关 USB2.0 接口的更多信息,请参阅 [常见问题解答] AM625/AM623/AM625SIP/AM625-Q1/AM620-Q1 定制电路板硬件设计 – USB2.0 接口。这是通用常见问题解答,也适用于 AM62A7/AM62A3 系列处理器。