ZHCADE2 November 2023 LMK3H0102
表 5-1 是针对 LMK3H0102 100MHz LP-HCSL 无 SSC 相位噪声测量的 PCIe 合规性结果汇总。图 5-1 显示用于分析的相位噪声捕获。表 5-2 是 LMK3H0102 100MHz LP-HCSL –0.5% 向下展频 SSC 相位噪声测量的 PCIe 合规性结果汇总。图 5-2 显示用于分析的相位噪声捕获。其中展示了器件在第 1 代到第 6 代 PCIe、噪声折叠 0 和 3 以及带展频 (CCS) 和独立基准独立展频 (SRIS) 的时钟架构通用时钟的抖动兼容性。
PCIe 抖动规格或时域计算可能具有以下状态之一:
抖动滤波器 | 时钟架构 | 噪声折叠 | 最小 (ps) | 最大 (ps) | 限制 | 状态 |
---|---|---|---|---|---|---|
PCIe1(1) | CC | 0 | 0.0 | 2.202 | 86ps pp | 通过 |
3 | 0.0 | 2.27 | 86ps pp | 通过 | ||
PCIe2 | CC | 0 | 0.053 | 0.273 | 3.1ps RMS | 通过 |
3 | 0.101 | 0.279 | 3.1ps RMS | 通过 | ||
SRNS | 0 | 0.095 | 0.216 | 不适用 | 不适用 | |
3 | 0.146 | 0.225 | 不适用 | 不适用 | ||
PCIe3 | CC | 0 | 0.024 | 0.082 | 1ps RMS | 通过 |
3 | 0.041 | 0.084 | 1ps RMS | 通过 | ||
SRNS | 0 | 0.249 | 0.067 | 不适用 | 不适用 | |
3 | 0.273 | 0.07 | 不适用 | 不适用 | ||
PCIe4 | CC | 0 | 0.024 | 0.082 | 0.5ps RMS | 通过 |
3 | 0.041 | 0.084 | 0.5ps RMS | 通过 | ||
SRNS | 0 | 0.17 | 0.067 | 不适用 | 不适用 | |
3 | 0.18 | 0.07 | 不适用 | 不适用 | ||
PCIe5 | CC | 0 | 0.004 | 0.036 | 0.15ps RMS | 通过 |
3 | 0.004 | 0.037 | 0.15ps RMS | 通过 | ||
SRNS | 0 | 0.052 | 0.029 | 不适用 | 不适用 | |
3 | 0.053 | 0.030 | 不适用 | 不适用 | ||
PCIe6 | CC | 0 | 0.004 | 0.020 | 0.10ps RMS | 通过 |
3 | 0.008 | 0.020 | 0.10ps RMS | 通过 | ||
SRNS | 0 | 0.036 | 0.017 | 不适用 | 不适用 | |
3 | 0.039 | 0.018 | 不适用 | 不适用 |
抖动滤波器 | 时钟架构 | 噪声折叠 | 最小 (ps) | 最大 (ps) | 限制 | 状态 |
---|---|---|---|---|---|---|
PCIe1(1) | CCS | 0 | 0.0 | 3.886 | 86ps pp | 通过 |
3 | 0.0 | 4.654 | 86ps pp | 通过 | ||
PCIe2 | CCS | 0 | 0.053 | 0.161 | 3.1ps RMS | 通过 |
3 | 0.101 | 0.312 | 3.1ps RMS | 通过 | ||
SRIS | 0 | 0.095 | 0.169 | 不适用 | 不适用 | |
3 | 0.146 | 0.334 | 不适用 | 不适用 | ||
PCIe3 | CCS | 0 | 0.024 | 0.078 | 1ps RMS | 通过 |
3 | 0.041 | 0.101 | 1ps RMS | 通过 | ||
SRIS | 0 | 0.249 | 0.289 | 不适用 | 不适用 | |
3 | 0.273 | 0.376 | 不适用 | 不适用 | ||
PCIe4 | CCS | 0 | 0.024 | 0.078 | 0.5ps RMS | 通过 |
3 | 0.041 | 0.101 | 0.5ps RMS | 通过 | ||
SRIS | 0 | 0.17 | 0.185 | 不适用 | 不适用 | |
3 | 0.18 | 0.217 | 不适用 | 不适用 | ||
PCIe5 | CCS | 0 | 0.004 | 0.031 | 0.15ps RMS | 通过 |
3 | 0.004 | 0.04 | 0.15ps RMS | 通过 | ||
SRIS | 0 | 0.052 | 0.066 | 不适用 | 不适用 | |
3 | 0.053 | 0.072 | 不适用 | 不适用 | ||
PCIe6 | CCS | 0 | 0.004 | 0.016 | 0.10ps RMS | 通过 |
3 | 0.008 | 0.024 | 0.10ps RMS | 通过 | ||
SRIS | 0 | 0.036 | 0.047 | 不适用 | 不适用 | |
3 | 0.039 | 0.05 | 不适用 | 不适用 |
表 5-3 是用于 LMK3H0102 时域分析的 PCIe 合规性摘要,展示了器件的时域合规性。
计算 | 最小值 | 平均值 | 最大值 | 限制 | 状态 |
---|---|---|---|---|---|
Vcross | 396.62mV | 407.61mV | 416.73mV | 250mV 至 550mV | 通过 |
Vhigh | 720mV | 720mV | 150mV | 通过 | |
Vlow | -12.0mV | -12.0mV | -150mV | 通过 | |
周期 | 9.9ns | 9.996ns | 10.1ns | 9.847ns 到 10.203ns | 通过 |
占空比 | 50.02% | 50.58% | 51.021% | 40%至60% | 通过 |
过冲电压 | 28.26mV | 40.0mV | 300mV | 通过 | |
下冲电压 | -32.28mV | -48.0mV | -300mV | 通过 | |
上升沿速率 | 2.24V/ns | 2.584V/ns | 2.92V/ns | 0.6V/ns 至 0.4V/ns | 通过 |
下降沿速率 | 2.12V/ns | 2.612V/ns | 3.08V/ns | 0.6V/ns 至 0.4V/ns | 通过 |