ZHCADO3 January   2024 DP83TC812R-Q1 , DP83TC812S-Q1

 

  1.   1
  2.   商标
  3. 1前言
  4.   命名惯例
  5. 2相关文档
  6. 3支持资源
  7. 4排查 PHY 应用问题
    1. 4.1  原理图和布局检查清单
    2. 4.2  验证 PHY 是否成功上电
    3. 4.3  外设引脚检查
      1. 4.3.1 探测 RESET_N 引脚
      2. 4.3.2 探测 INH 引脚
      3. 4.3.3 探测 CLKOUT 引脚
      4. 4.3.4 探测串行管理接口(MDC、MDIO)引脚
    4. 4.4  寄存器转储比较
    5. 4.5  验证 Strap 配置
    6. 4.6  检查 MDI 信号
    7. 4.7  链路接通失败常见问题
    8. 4.8  信号质量检查
    9. 4.9  上电时序
    10. 4.10 环回测试
    11. 4.11 调试 MAC 接口
    12. 4.12 验证 Open Alliance PMA 合规性
    13. 4.13 工具和参考
      1. 4.13.1 DP83TC812 寄存器访问
      2. 4.13.2 DP83TC812 USB2MDIO 脚本
      3. 4.13.3 扩展寄存器访问
      4. 4.13.4 Linux 上的软件和驱动程序调试
        1. 4.13.4.1 常见的 Linux 终端输出
  8. 5结语

探测 CLKOUT 引脚

参考时钟频率和稳定性对于维持 PHY 的正常运行至关重要。不符合数据表中的规格可能会导致位错误、读取/写入问题或 PHY 完全无法运行。

请勿直接探测晶体,因为这会改变电路的容性负载并改变行为。相反,探测 CLKOUT 引脚(引脚 16),它是输入参考时钟的缓冲版本。

将频率保持在预期值的 ±100ppm 范围内:针对 RMII 从模式为 (40.995Mhz - 50.005Mhz),而针对所有其他模式为 (24.9975Mhz - 25.0025Mhz)。

表 4-2 25MHz 晶体要求

25MHz 晶体要求

频率

25

MHz

最大频率容差及稳定性与温度及老化之间的关系

±100

ppm

最大等效串联电阻

100

Ω

GUID-20230801-SS0I-3QTB-HHJP-ZVWQ88CHLCHK-low.png图 4-1 DP83TC812 CLK_OUT 测量
注: 确认振幅等于 VDDMAC 且频率处于 ±100ppm (24.9975Mhz - 25.0025Mhz) 范围内