ZHCSEG5E October   2015  – September 2017 TMDS171

PRODUCTION DATA.  

  1. 1 特性
  2. 2 应用
  3. 3 说明
  4. 4 修订历史记录
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Switching Characteristics
    7. 6.7 Typical Characteristics
  7. 7 Parameter Measurement Information
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1  Reset Implementation
      2. 8.3.2  Operation Timing
      3. 8.3.3  Swap and Polarity Working (Retimer Mode Only)
      4. 8.3.4  TMDS Inputs
      5. 8.3.5  TMDS Inputs Debug Tools
      6. 8.3.6  Receiver Equalizer
      7. 8.3.7  Input Signal Detect Block
      8. 8.3.8  Audio Return Channel
      9. 8.3.9  Transmitter Impedance Control
      10. 8.3.10 TMDS Outputs
      11. 8.3.11 Pre-Emphasis/De-Emphasis
    4. 8.4 Device Functional Modes
      1. 8.4.1 Retimer Mode
      2. 8.4.2 Redriver Mode
      3. 8.4.3 DDC Functional Description
      4. 8.4.4 Mode Selection Functional Description
    5. 8.5 Register Maps
      1. 8.5.1  Local I2C Overview
        1. 8.5.1.1 BIT Access Tag Conventions
      2. 8.5.2  CSR Bit Field Definitions, DEVICE_ID (offset: 00000000 ≈ 00000111) (reset:00h ≈ 07h)
      3. 8.5.3  CSR Bit Field Definitions, REV _ID (offset: 00001000) (reset: 01h)
      4. 8.5.4  CSR BIT Field Definitions - Misc Control (offset: 00001001) (reset: 02h)
      5. 8.5.5  CSR BIT Field Definitions - Misc Control (offset: 00001010) (reset: B1h)
      6. 8.5.6  CSR BIT Field Definitions - Misc Control (offset: 00001011) (reset: 00h)
      7. 8.5.7  CSR BIT Field Definitions - Misc Control (offset: 00001100) (reset: 00h)
      8. 8.5.8  CSR BIT Field Definitions - Equalization Control Register (offset: 00001101) (reset: 01h)
      9. 8.5.9  CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00001110) (reset: 00h)
      10. 8.5.10 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00001111) (reset: 00h)
      11. 8.5.11 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010000) (reset: 00h)
      12. 8.5.12 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010001) (reset: 00h)
      13. 8.5.13 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010010) (reset: 00h)
      14. 8.5.14 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010011) (reset: 00h)
      15. 8.5.15 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010100) (reset: 00h)
      16. 8.5.16 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010101) (reset: 00h)
      17. 8.5.17 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010110) (reset: 00h)
      18. 8.5.18 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00010111) (reset: 00h)
      19. 8.5.19 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011000) (reset: 00h)
      20. 8.5.20 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011001) (reset: 00h)
      21. 8.5.21 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011010) (reset: 00h)
      22. 8.5.22 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011011) (reset: 00h)
      23. 8.5.23 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011100) (reset: 00h)
      24. 8.5.24 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011101) (reset: 00h)
      25. 8.5.25 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011110) (reset: 00h)
      26. 8.5.26 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00011111) (reset: 00h)
      27. 8.5.27 CSR BIT Field Definitions - RX Pattern Verifier Control/Status (offset: 00100000) (reset: 00h)
  9. 9 Application and Implementation
    1. 9.1 Application Information
      1. 9.1.1 Application Chain Showing DDC Connections
      2. 9.1.2 DDC Pull Up Resistors
    2. 9.2 Source Side Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
      3. 9.2.3 Application Curves
      4. 9.2.4 Sink Side Application
        1. 9.2.4.1 Design Requirements
        2. 9.2.4.2 Detailed Design Procedure
    3. 9.3 System Examples
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
    2. 11.2 Layout Example
  12. 12器件和文档支持
    1. 12.1 相关文档　
    2. 12.2 接收文档更新通知
    3. 12.3 社区资源
    4. 12.4 商标
    5. 12.5 静电放电警告
    6. 12.6 Glossary
  13. 13机械、封装和可订购信息

1 特性

  • 高清多媒体接口 (HDMI) 输入端口与输出端口间具有时钟和数据恢复 (CDR) 电路，支持高达 3.4Gbps 的数据传输速率
  • 兼容 HDMI1.4b 电气参数。
  • 支持 4k2k30p 和高达 WUXGA 12 位色深或 1080p，具有更高的刷新率™
  • 对输入流重新定时以补偿随机抖动
  • 自适应接收器均衡器或可编程固定均衡器
  • I2C 和引脚设置可编程
  • 5+ 位对内偏移补偿
  • 包括眼图的链路调试工具，位于 RX 均衡器之后
  • 支持单端模式 ARC
  • 48 引脚 7mm x 7mm 0.5mm 间距超薄型四方扁平无引线 (VQFN) 封装
  • 扩展商业温度范围为 0°C 至 85°C (TMDS171)
  • 工业温度范围为 -40℃ 至 85°C (TMDS171I)

2 应用

  • 数字电视
  • 数字投影仪
  • 音频/视频设备
  • 蓝光 (Blu-Ray) DVD
  • 监视器
  • 台式机/一体化计算机
  • 有源线缆

3 说明

TMDS171 是一款数字视频接口 (DVI) 或高清多媒体接口 (HDMI) 重定时器。TMDS171 支持四条 TMDS 通道，音频返回通道 (SPDIF_IN/ARC_OUT)、热插拔检测 (HPD) 和数字显示控制 (DDC) 接口。TMDS171 支持高达 3.4Gbps 的信号传输速率，可实现最高分辨率达 4k2k30p 24 位/像素和高达 WUXGA 12 位色深或 1080p，并且具有较高的刷新率。TMDS171 在低于 1Gbps 的数据速率下会自动配置为重驱动器，而在高于该速率时会自动配置为重定时器。

TMDS171 支持双电源轨（VDD 为 1.2V，VCC 为 3.3V），有助于降低功耗。该器件采用多种电源管理方法来降低整体功耗。TMDS171x 通过 I2C 或引脚设置支持固定的 EQ 增益或自适应 EQ 控制，以补偿不同长度的输入电缆或电路板走线。

器件信息(1)

器件型号 封装 封装尺寸（标称值）
TMDS171 (VQFN) 48 引脚 7.00mm x 7.00mm
TMDS171I
  1. 如需了解所有可用封装，请参阅数据表末尾的可订购米6体育平台手机版_好二三四附录。

简化电路原理图

TMDS171 TMDS171I fp_circuit_sllsen7.gif
TMDS171 TMDS171I fp_tv_image_sllsen7.gif
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