ZHCSQL8B June   2022  – June 2023 AM620-Q1 , AM623 , AM625 , AM625-Q1

PRODUCTION DATA  

  1.   1
  2. 1 特性
  3. 2 应用
  4. 3 说明
    1. 3.1 功能方框图
  5. 4 修订历史记录
  6. 5 器件比较
    1. 5.1 相关米6体育平台手机版_好二三四
  7. 6 终端配置和功能
    1. 6.1 引脚图
    2. 6.2 引脚属性
      1.      12
      2.      13
    3. 6.3 信号说明
      1.      15
      2. 6.3.1  CPSW3G
        1. 6.3.1.1 MAIN 域
          1.        18
          2.        19
          3.        20
          4.        21
      3. 6.3.2  CPTS
        1. 6.3.2.1 MAIN 域
          1.        24
      4. 6.3.3  CSI-2
        1. 6.3.3.1 MAIN 域
          1.        27
      5. 6.3.4  DDRSS
        1. 6.3.4.1 MAIN 域
          1.        30
      6. 6.3.5  DSS
        1. 6.3.5.1 MAIN 域
          1.        33
      7. 6.3.6  ECAP
        1. 6.3.6.1 MAIN 域
          1.        36
          2.        37
          3.        38
      8. 6.3.7  仿真和调试
        1. 6.3.7.1 MAIN 域
          1.        41
        2. 6.3.7.2 MCU 域
          1.        43
      9. 6.3.8  EPWM
        1. 6.3.8.1 MAIN 域
          1.        46
          2.        47
          3.        48
          4.        49
      10. 6.3.9  EQEP
        1. 6.3.9.1 MAIN 域
          1.        52
          2.        53
          3.        54
      11. 6.3.10 GPIO
        1. 6.3.10.1 MAIN 域
          1.        57
          2.        58
        2. 6.3.10.2 MCU 域
          1.        60
      12. 6.3.11 GPMC
        1. 6.3.11.1 MAIN 域
          1.        63
      13. 6.3.12 I2C
        1. 6.3.12.1 MAIN 域
          1.        66
          2.        67
          3.        68
          4.        69
        2. 6.3.12.2 MCU 域
          1.        71
        3. 6.3.12.3 WKUP 域
          1.        73
      14. 6.3.13 MCAN
        1. 6.3.13.1 MAIN 域
          1.        76
        2. 6.3.13.2 MCU 域
          1.        78
          2.        79
      15. 6.3.14 MCASP
        1. 6.3.14.1 MAIN 域
          1.        82
          2.        83
          3.        84
      16. 6.3.15 MCSPI
        1. 6.3.15.1 MAIN 域
          1.        87
          2.        88
          3.        89
        2. 6.3.15.2 MCU 域
          1.        91
          2.        92
      17. 6.3.16 MDIO
        1. 6.3.16.1 MAIN 域
          1.        95
      18. 6.3.17 MMC
        1. 6.3.17.1 MAIN 域
          1.        98
          2.        99
          3.        100
      19. 6.3.18 OLDI
        1. 6.3.18.1 MAIN 域
          1.        103
      20. 6.3.19 OSPI
        1. 6.3.19.1 MAIN 域
          1.        106
      21. 6.3.20 电源
        1.       108
      22. 6.3.21 PRUSS
        1. 6.3.21.1 MAIN 域
          1.        111
          2.        112
      23. 6.3.22 保留
        1.       114
      24. 6.3.23 系统和其他
        1. 6.3.23.1 启动模式配置
          1. 6.3.23.1.1 MAIN 域
            1.         118
        2. 6.3.23.2 时钟
          1. 6.3.23.2.1 MCU 域
            1.         121
          2. 6.3.23.2.2 WKUP 域
            1.         123
        3. 6.3.23.3 系统
          1. 6.3.23.3.1 MAIN 域
            1.         126
          2. 6.3.23.3.2 MCU 域
            1.         128
          3. 6.3.23.3.3 WKUP 域
            1.         130
        4. 6.3.23.4 VMON
          1.        132
      25. 6.3.24 计时器
        1. 6.3.24.1 MAIN 域
          1.        135
        2. 6.3.24.2 MCU 域
          1.        137
        3. 6.3.24.3 WKUP 域
          1.        139
      26. 6.3.25 UART
        1. 6.3.25.1 MAIN 域
          1.        142
          2.        143
          3.        144
          4.        145
          5.        146
          6.        147
          7.        148
        2. 6.3.25.2 MCU 域
          1.        150
        3. 6.3.25.3 WKUP 域
          1.        152
      27. 6.3.26 USB
        1. 6.3.26.1 MAIN 域
          1.        155
          2.        156
    4. 6.4 引脚连接要求
  8. 7 规格
    1. 7.1  绝对最大额定值
    2. 7.2  未通过 AEC - Q100 认证的器件的 ESD 等级
    3. 7.3  采用 AMC 封装且通过 AEC - Q100 认证的器件的 ESD 等级
    4. 7.4  上电小时数 (POH)
    5. 7.5  建议运行条件
    6. 7.6  运行性能点
    7. 7.7  功耗摘要
    8. 7.8  电气特性
      1. 7.8.1  I2C 开漏和失效防护 (I2C OD FS) 电气特性
      2. 7.8.2  失效防护复位（FS 复位）电气特性
      3. 7.8.3  高频振荡器 (HFOSC) 电气特性
      4. 7.8.4  低频振荡器 (LFXOSC) 电气特性
      5. 7.8.5  SDIO 电气特性
      6. 7.8.6  LVCMOS 电气特性
      7. 7.8.7  OLDI LVDS (OLDI) 电气特性
      8. 7.8.8  CSI-2 (D-PHY) 电气特性
      9. 7.8.9  USB2PHY 电气特性
      10. 7.8.10 DDR 电气特性
    9. 7.9  一次性可编程 (OTP) 电子保险丝的 VPP 规格
      1. 7.9.1 建议的 OTP 电子保险丝编程操作条件
      2. 7.9.2 硬件要求
      3. 7.9.3 编程序列
      4. 7.9.4 对硬件保修的影响
    10. 7.10 热阻特性
      1. 7.10.1 ALW 和 AMC 封装的热阻特性
    11. 7.11 时序和开关特性
      1. 7.11.1 时序参数和信息
      2. 7.11.2 电源要求
        1. 7.11.2.1 电源压摆率要求
        2. 7.11.2.2 电源时序
          1. 7.11.2.2.1 上电时序
          2. 7.11.2.2.2 下电时序
          3. 7.11.2.2.3 部分 IO 电源时序
      3. 7.11.3 系统时序
        1. 7.11.3.1 复位时序
        2. 7.11.3.2 错误信号时序
        3. 7.11.3.3 时钟时序
      4. 7.11.4 时钟规格
        1. 7.11.4.1 输入时钟/振荡器
          1. 7.11.4.1.1 MCU_OSC0 内部振荡器时钟源
            1. 7.11.4.1.1.1 负载电容
            2. 7.11.4.1.1.2 并联电容
          2. 7.11.4.1.2 MCU_OSC0 LVCMOS 数字时钟源
          3. 7.11.4.1.3 WKUP_LFOSC0 内部振荡器时钟源
          4. 7.11.4.1.4 WKUP_LFOSC0 LVCMOS 数字时钟源
          5. 7.11.4.1.5 未使用 WKUP_LFOSC0
        2. 7.11.4.2 输出时钟
        3. 7.11.4.3 PLL
        4. 7.11.4.4 时钟和控制信号转换的建议系统预防措施
      5. 7.11.5 外设
        1. 7.11.5.1  CPSW3G
          1. 7.11.5.1.1 CPSW3G MDIO 时序
          2. 7.11.5.1.2 CPSW3G RMII 时序
          3. 7.11.5.1.3 CPSW3G RGMII 时序
        2. 7.11.5.2  CPTS
        3. 7.11.5.3  CSI-2
        4. 7.11.5.4  DDRSS
        5. 7.11.5.5  DSS
        6. 7.11.5.6  ECAP
        7. 7.11.5.7  仿真和调试
          1. 7.11.5.7.1 迹线
          2. 7.11.5.7.2 JTAG
        8. 7.11.5.8  EPWM
        9. 7.11.5.9  EQEP
        10. 7.11.5.10 GPIO
        11. 7.11.5.11 GPMC
          1. 7.11.5.11.1 GPMC 和 NOR 闪存 - 同步模式
          2. 7.11.5.11.2 GPMC 和 NOR 闪存 - 异步模式
          3. 7.11.5.11.3 GPMC 和 NAND 闪存 - 异步模式
        12. 7.11.5.12 I2C
        13. 7.11.5.13 MCAN
        14. 7.11.5.14 MCASP
        15. 7.11.5.15 MCSPI
          1. 7.11.5.15.1 MCSPI - 控制器模式
          2. 7.11.5.15.2 MCSPI - 外设模式
        16. 7.11.5.16 MMCSD
          1. 7.11.5.16.1 MMC0 - eMMC/SD/SDIO 接口
            1. 7.11.5.16.1.1  旧 SDR 模式
            2. 7.11.5.16.1.2  高速 SDR 模式
            3. 7.11.5.16.1.3  HS200 模式
            4. 7.11.5.16.1.4  默认速度模式
            5. 7.11.5.16.1.5  高速模式
            6. 7.11.5.16.1.6  UHS–I SDR12 模式
            7. 7.11.5.16.1.7  UHS–I SDR25 模式
            8. 7.11.5.16.1.8  UHS–I SDR50 模式
            9. 7.11.5.16.1.9  UHS–I DDR50 模式
            10. 7.11.5.16.1.10 UHS–I SDR104 模式
          2. 7.11.5.16.2 MMC1/MMC2 - SD/SDIO 接口
            1. 7.11.5.16.2.1 默认速度模式
            2. 7.11.5.16.2.2 高速模式
            3. 7.11.5.16.2.3 UHS–I SDR12 模式
            4. 7.11.5.16.2.4 UHS–I SDR25 模式
            5. 7.11.5.16.2.5 UHS–I SDR50 模式
            6. 7.11.5.16.2.6 UHS–I DDR50 模式
            7. 7.11.5.16.2.7 UHS–I SDR104 模式
        17. 7.11.5.17 OLDI
          1. 7.11.5.17.1 OLDI0 开关特性
        18. 7.11.5.18 OSPI
          1. 7.11.5.18.1 OSPI0 PHY 模式
            1. 7.11.5.18.1.1 具有 PHY 数据训练的 OSPI0
            2. 7.11.5.18.1.2 无数据训练的 OSPI0
              1. 7.11.5.18.1.2.1 OSPI0 PHY SDR 时序
              2. 7.11.5.18.1.2.2 OSPI0 PHY DDR 时序
          2. 7.11.5.18.2 OSPI0 Tap 模式
            1. 7.11.5.18.2.1 OSPI0 Tap SDR 时序
            2. 7.11.5.18.2.2 OSPI0 Tap DDR 时序
        19. 7.11.5.19 PRUSS
          1. 7.11.5.19.1 PRUSS 可编程实时单元 (PRU)
            1. 7.11.5.19.1.1 PRUSS PRU 直接输出模式时序
            2. 7.11.5.19.1.2 PRUSS PRU 并行捕获模式时序
            3. 7.11.5.19.1.3 PRUSS PRU 移位模式时序
          2. 7.11.5.19.2 PRUSS 工业以太网外设 (IEP)
            1. 7.11.5.19.2.1 PRUSS IEP 时序
          3. 7.11.5.19.3 PRUSS 通用异步接收器/发送器 (UART)
            1. 7.11.5.19.3.1 PRUSS UART 时序
          4. 7.11.5.19.4 PRUSS 增强型捕获外设 (ECAP)
            1. 7.11.5.19.4.1 PRUSS ECAP 时序
        20. 7.11.5.20 计时器
        21. 7.11.5.21 UART
        22. 7.11.5.22 USB
  9. 8 详细说明
    1. 8.1 概述
    2. 8.2 处理器子系统
      1. 8.2.1 Arm Cortex-A53 子系统
      2. 8.2.2 器件/电源管理器
      3. 8.2.3 Arm Cortex-M4F
    3. 8.3 加速器和协处理器
      1. 8.3.1 图形处理单元 (GPU)
      2. 8.3.2 可编程实时单元子系统 (PRUSS)
    4. 8.4 其他子系统
      1. 8.4.1 双时钟比较器 (DCC)
      2. 8.4.2 数据移动子系统 (DMSS)
      3. 8.4.3 存储器循环冗余校验 (MCRC)
      4. 8.4.4 外设 DMA 控制器 (PDMA)
      5. 8.4.5 实时时钟 (RTC)
    5. 8.5 外设
      1. 8.5.1  千兆位以太网交换机 (CPSW3G)
      2. 8.5.2  摄像头流媒体接口接收器 (CSI_RX_IF)
      3. 8.5.3  DDR 子系统 (DDRSS)
      4. 8.5.4  显示子系统 (DSS)
      5. 8.5.5  增强型捕获 (ECAP)
      6. 8.5.6  错误定位模块 (ELM)
      7. 8.5.7  增强型脉宽调制 (EPWM)
      8. 8.5.8  错误信令模块 (ESM)
      9. 8.5.9  增强型正交编码器脉冲 (EQEP)
      10. 8.5.10 通用接口 (GPIO)
      11. 8.5.11 通用存储器控制器 (GPMC)
      12. 8.5.12 全局时基计数器 (GTC)
      13. 8.5.13 内部集成电路 (I2C)
      14. 8.5.14 模块化控制器局域网 (MCAN)
      15. 8.5.15 多通道音频串行端口 (MCASP)
      16. 8.5.16 多通道串行外设接口 (MCSPI)
      17. 8.5.17 多媒体卡安全数字 (MMCSD)
      18. 8.5.18 八进制串行外设接口 (OSPI)
      19. 8.5.19 计时器
      20. 8.5.20 通用异步收发器 (UART)
      21. 8.5.21 通用串行总线子系统 (USBSS)
  10. 9 应用、实现和布局
    1. 9.1 器件连接和布局基本准则
      1. 9.1.1 电源
        1. 9.1.1.1 电源设计
        2. 9.1.1.2 配电网络实施指南
      2. 9.1.2 外部振荡器
      3. 9.1.3 JTAG、仿真和跟踪
      4. 9.1.4 复位
      5. 9.1.5 未使用的引脚
    2. 9.2 外设和接口的相关设计信息
      1. 9.2.1 DDR 电路板设计和布局布线指南
      2. 9.2.2 OSPI/QSPI/SPI 电路板设计和布局指南
        1. 9.2.2.1 无环回、内部 PHY 环回和内部焊盘环回
        2. 9.2.2.2 外部电路板环回
        3. 9.2.2.3 DQS（仅适用于八路 SPI 器件）
      3. 9.2.3 USB VBUS 设计指南
      4. 9.2.4 系统电源监测设计指南
      5. 9.2.5 高速差分信号布线指南
      6. 9.2.6 散热解决方案指导
  11. 10器件和文档支持
    1. 10.1 器件命名规则
      1. 10.1.1 标准封装编号法
      2. 10.1.2 器件命名约定
    2. 10.2 工具与软件
    3. 10.3 文档支持
    4. 10.4 支持资源
    5. 10.5 商标
    6. 10.6 静电放电警告
    7. 10.7 术语表
  12. 11机械、封装和可订购信息
    1. 11.1 封装信息
7.11.2.2.1 上电时序

表 7-4 和图 7-5 介绍了器件上电时序。

注： 本节中定义的电源时序要求不包括进入或退出低功耗模式。有关进入或退出低功耗模式时电源序列要求的更多信息，请参阅节 7.11.2.2.3部分 IO 电源时序。
表 7-4 上电时序 – 电源/信号分配 请参阅：图 7-5
波形 电源/信号名称
A VSYS(1)、VMON_VSYS(2)
B VDDSHV_CANUART(3)、VDDSHV_MCU(3)、VDDSHV0(3)、VDDSHV1(3)、VDDSHV2(3)、VDDSHV3(3)、VDDA_3P3_USB、VMON_3P3_SOC(4)
C VDDSHV_CANUART(5)、VDDSHV_MCU(5)、VDDSHV0(5)、VDDSHV1(5)、VDDSHV2(5)、VDDSHV3(5)、VDDA_MCU、VDDS_OSC0、VDDA_PLL0、VDDA_PLL1、VDDA_PLL2、VDDA_1P8_CSIRX0、VDDA_1P8_USB、VDDA_TEMP0、VDDA_TEMP1、VMON_1P8_SOC(6)
D VDDSHV4(7)、VDDSHV5(7)、VDDSHV6(7)
E VDDS_DDR(8)、VDDS_DDR_C(8)
F VDD_CANUART(9)
G VDD_CANUART(10)、VDD_CORE(10)(12)、VDDA_CORE_CSIRX0(10)、VDDA_CORE_USB0(10)、VDDA_DDR_PLL0(10)
H VDD_CANUART(11)、VDD_CORE(11)(12)、VDDA_CORE_CSIRX0(11)、VDDA_CORE_USB0(11)、VDDA_DDR_PLL0(11)、VDDR_CORE(12)
I VPP(13)
J MCU_PORz
K MCU_OSC0_XI、MCU_OSC0_XI
(1) VSYS 表示为整个系统供电的电源的名称。该电源应是一个预调节电源，为电源管理器件提供电源，而电源管理器件为所有其他电源提供电源。
(2) VMON_VSYS 输入用于通过外部电阻分压器电路监测 VSYS。有关更多信息，请参阅系统电源监测设计指南。
(3) VDDSHV_CANUART、VDDSHV_MCU 和 VDDSHVx [x=0-3] 是双电压 IO 电源，可根据应用要求以 1.8V 或 3.3V 的电压运行。当使用部分 IO 低功耗模式时，VDDSHV_CANUART 应连接到常开型电源，或者当不使用部分 IO 低功耗模式时，应连接到任何有效的 IO 电源。当 VDDSHV_CANUART 未连接至常开型电源且工作电压为 3.3V 时，应在该波形定义的 3.3V 斜坡周期内使用其他 3.3V 电源进行斜升。当任何 VDDSHV_MCU 和 VDDSHVx [x=0-3] IO 电源以 3.3V 运行时，它们应在该波形定义的 3.3V 斜坡周期内与其他 3.3V 电源一起斜升。
(4) VMON_3P3_SOC 输入用于监测电源电压，并应连接到相应的 3.3V 电源。
(5) VDDSHV_CANUART、VDDSHV_MCU 和 VDDSHVx [x=0-3] 是双电压 IO 电源，可根据应用要求以 1.8V 或 3.3V 的电压运行。当使用部分 IO 低功耗模式时，VDDSHV_CANUART 应连接到常开型电源，或者当不使用部分 IO 低功耗模式时，应连接到任何有效的 IO 电源。当 VDDSHV_CANUART 未连接至常开型电源且工作电压为 1.8V 时，应在该波形定义的 1.8V 斜坡周期内使用其他 1.8V 电源进行斜升。当任何 VDDSHV_MCU 和 VDDSHVx [x=0-3] IO 电源以 1.8V 运行时，它们应在该波形定义的 1.8V 斜坡周期内与其他 1.8V 电源一起斜升。
(6) VMON_1P8_SOC 输入用于监测电源电压，并应连接到相应的 1.8V 电源。
(7) VDDSHV4、VDDSHV5 和 VDDSHV6 旨在支持上电、下电或不依赖于其他电源轨的动态电压变化。这是支持 UHS-I SD 卡所必需的功能。
(8) VDDS_DDR 和 VDDS_DDR_C 应由同一电源供电，以便它们一起斜升。
(9) 当使用部分 IO 低功耗模式时，VDD_CANUART 应连接到常开型电源。当 VDD_CANUART 连接到常开型电源时，上电或断电期间施加到 VDD_CORE 的电势绝不能大于施加到 VDD_CANUART 的电势 + 0.18V。这要求 VDD_CANUART 在 VDD_CORE 之前斜升并在 VDD_CORE 之后斜降。除了为 VDD_CORE 定义的斜坡要求之外，VDD_CANUART 没有任何斜坡要求。
(10) 在不使用部分 IO 低功耗模式时，VDD_CANUART 应连接到与 VDD_CORE、VDDA_CORE_CSIRX0、VDDA_CORE_USB 和 VDDA_DDR_PLL0 相同的电源。VDD_CANUART、VDD_CORE、VDDA_CORE_CSIRX0、VDDA_CORE_USB 和 VDDA_DDR_PLL0 可在 0.75V 或 0.85V 下运行。当这些电源在 0.75V 下运行时，它们应在 VDDR_CORE 之前按照该波形的定义进行斜升。
(11) 在不使用部分 IO 低功耗模式时，VDD_CANUART 应连接到与 VDD_CORE、VDD_CORE、VDDA_CORE_CSIRX0、VDDA_CORE_USB 和 VDDA_DDR_PLL0 相同的电源。VDD_CANUART、VDD_CORE、VDDA_CORE_CSIRX0、VDDA_CORE_USB 和 VDDA_DDR_PLL0 可在 0.75V 或 0.85V 下运行。当这些电源在 0.85V 下运行时，它们应由与 VDDR_CORE 相同的电源供电，并在该波形定义的 0.85V 斜坡周期内斜升。
(12) 在上电或断电期间，施加到 VDDR_CORE 的电势绝不能大于施加到 VDD_CORE 的电势 + 0.18V。当 VDD_CORE 工作电压为 0.75V 时，这要求 VDD_CORE 在 VDDR_CORE 之前斜升并在 VDDR_CORE 之后斜降。除了为 VDD_CORE 定义的斜坡要求之外，VDD_CORE 没有任何斜坡要求。VDD_CORE 和 VDDR_CORE 应由同一电源供电，因此当 VDD_CORE 以 0.85V 电压运行时，这些电压会一起升降。
(13) VPP 是 1.8V 电子保险丝编程电源，在上电/断电序列期间以及正常器件运行期间，应保持悬空（高阻态）或接地。该电源应仅在对电子保险丝进行编程时提供。
AM625 AM625-Q1 AM623 AM620-Q1 上电时序图 7-5 上电时序
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