ZHCUBX0A April   2024  – September 2024 TMS320F28P550SJ , TMS320F28P559SJ-Q1

 

  1.   1
  2.   摘要
  3.   商标
  4. 1F28003x 和 F28P55x 之间的特性差异
    1. 1.1 F28003x 和 F28P55x 特性比较
  5. 2PCB 硬件更改
    1. 2.1 100 引脚 PZ、80 引脚 PNA 和 64 引脚 PM 封装的 PCB 硬件更改
    2. 2.2 F28003x 和 F28P55x 之间针对新 PCB 和现有 PCB 的 100 引脚 PZ、80 引脚 PNA 和 64 引脚 PM 迁移
    3. 2.3 GPIO 输入缓冲器控制寄存器
  6. 3系统特性差异注意事项
    1. 3.1 F28P55x 中的新特性
      1. 3.1.1 可编程增益放大器 (PGA)
      2. 3.1.2 通用串行总线 (USB)
      3. 3.1.3 5V 失效防护 IO
      4. 3.1.4 闪存写保护
      5. 3.1.5 神经网络处理单元 (NPU)
    2. 3.2 通信模块更改
    3. 3.3 控制模块更改
    4. 3.4 模拟模块差异
    5. 3.5 其他器件更改
      1. 3.5.1 PLL
      2. 3.5.2 PIE 通道映射
      3. 3.5.3 Bootrom
      4. 3.5.4 ROM 中包含的软件库
      5. 3.5.5 AGPIO
    6. 3.6 电源管理
      1. 3.6.1 LDO/VREG
      2. 3.6.2 POR/BOR
      3. 3.6.3 功耗
    7. 3.7 内存模块更改
    8. 3.8 GPIO 多路复用更改
    9. 3.9 模拟多路复用更改
  7. 4从 F28003x 到 F28P55x 的应用程序代码迁移
    1. 4.1 C2000Ware 头文件
    2. 4.2 链接器命令文件
    3. 4.3 C2000Ware 示例
  8. 5与 F28P55x 中的新特性相关的特定用例
    1. 5.1 PGA
    2. 5.2 USB
  9. 6EABI 支持
    1. 6.1 闪存 API
  10. 7参考资料
  11. 8修订历史记录

3.5.1 PLL

F28003x 和 F28P55x 器件的 PLL 块相同，不过 F28P55x 的最大 PLL 原始时钟更高，以满足 F28P55x 的 SYSCLK 频率要求。表 3-4 列出了两种器件的 PLL 特性以供比较。有关更多信息，请参阅 TMS320F28P55x 微控制器技术参考手册。

表 3-4 PLL 特性
特性 F28003x F28P55x
最大 CPU 时钟 120MHz 150MHz
VCO 范围 220MHz - 600MHz 220MHz - 600MHz
PLL 原始时钟范围 6MHz - 240MHz 6MHz - 300MHz
X1 输入范围（PLL 启用） 2MHz - 25MHz 2MHz - 25MHz
REFCLK 分频器 是 [1..32] 是 [1..32]
PLL 滑动检测 否（使用 DCC） 否（使用 DCC）
分数 PLL 倍频器 否 否
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