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CD4027B

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CMOS 双通道 J-K 主/从触发器

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CD4027B

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米6体育平台手机版_好二三四详情

Number of channels 2 Technology family CD4000 Supply voltage (min) (V) 3 Supply voltage (max) (V) 18 Input type TTL Output type Push-Pull Clock frequency (MHz) 12 Supply current (max) (µA) 600 IOL (max) (mA) 1.5 IOH (max) (mA) -1.5 Features Balanced outputs, Clear, Positive edge triggered, Positive input clamp diode, Preset, Standard speed (tpd > 50ns) Operating temperature range (°C) -55 to 125 Rating Catalog
Number of channels 2 Technology family CD4000 Supply voltage (min) (V) 3 Supply voltage (max) (V) 18 Input type TTL Output type Push-Pull Clock frequency (MHz) 12 Supply current (max) (µA) 600 IOL (max) (mA) 1.5 IOH (max) (mA) -1.5 Features Balanced outputs, Clear, Positive edge triggered, Positive input clamp diode, Preset, Standard speed (tpd > 50ns) Operating temperature range (°C) -55 to 125 Rating Catalog
PDIP (N) 16 181.42 mm² 19.3 x 9.4 SOIC (D) 16 59.4 mm² 9.9 x 6 SOP (NS) 16 79.56 mm² 10.2 x 7.8 TSSOP (PW) 16 32 mm² 5 x 6.4
  • 置位/复位功能
  • 静态触发器运行 – 以高 或低 时钟电平无限期地保持状态
  • 中速运行 – 在 10V 下具有 16MHz（典型值）的时钟切换速度
  • 标准化对称输出特性
  • 针对 20V 下的静态电流进行了 100% 测试
  • 在全封装温度范围内，18V 时的最大输入电流为 1µA；18V 和 25°C 时为 100nA
  • 噪声容限（在全封装温度范围内）：
    • VDD = 5V 时为 1V
    • VDD = 10V 时为 2V
    • VDD = 15V 时为 2.5V
  • 5V、10V 和 15V 参数额定值
  • 符合 JEDEC 第 138 号暂行标准，这是用于描述“B”系列 CMOS 器件的标准规范
  • 置位/复位功能
  • 静态触发器运行 – 以高 或低 时钟电平无限期地保持状态
  • 中速运行 – 在 10V 下具有 16MHz（典型值）的时钟切换速度
  • 标准化对称输出特性
  • 针对 20V 下的静态电流进行了 100% 测试
  • 在全封装温度范围内，18V 时的最大输入电流为 1µA；18V 和 25°C 时为 100nA
  • 噪声容限（在全封装温度范围内）：
    • VDD = 5V 时为 1V
    • VDD = 10V 时为 2V
    • VDD = 15V 时为 2.5V
  • 5V、10V 和 15V 参数额定值
  • 符合 JEDEC 第 138 号暂行标准，这是用于描述“B”系列 CMOS 器件的标准规范

CD4027B 是一款包含两个相同互补对称 J-K 触发器的单片芯片集成电路。每个触发器都提供了单独的 J、K、置位、复位和时钟输入信号，以及缓冲 Q 和 Q 输出信号。借助此输入/输出，可实现与 RCA-CD4013B 双路 D 型触发器的兼容操作。

CD4027B 适用于执行控制、寄存器和切换功能。J 和 K 输入端的逻辑电平以及内部自操纵控制每个触发器的状态；触发器状态的变化与时钟脉冲的正向转换同步。置位和复位功能独立于时钟，并在置位或复位输入端出现高电平信号时启动。

CD4027B 型采用 16 引脚气密性双列直插式陶瓷封装（后缀为 F3A）、16 引脚双列直插式塑料封装（后缀为 E）、16 引脚小外形封装（后缀为 M、M96、MT 和 NSR）和 16 引脚薄型紧缩小外形封装（后缀为 PW 和 PWR）。

CD4027B 是一款包含两个相同互补对称 J-K 触发器的单片芯片集成电路。每个触发器都提供了单独的 J、K、置位、复位和时钟输入信号，以及缓冲 Q 和 Q 输出信号。借助此输入/输出，可实现与 RCA-CD4013B 双路 D 型触发器的兼容操作。

CD4027B 适用于执行控制、寄存器和切换功能。J 和 K 输入端的逻辑电平以及内部自操纵控制每个触发器的状态；触发器状态的变化与时钟脉冲的正向转换同步。置位和复位功能独立于时钟，并在置位或复位输入端出现高电平信号时启动。

CD4027B 型采用 16 引脚气密性双列直插式陶瓷封装（后缀为 F3A）、16 引脚双列直插式塑料封装（后缀为 E）、16 引脚小外形封装（后缀为 M、M96、MT 和 NSR）和 16 引脚薄型紧缩小外形封装（后缀为 PW 和 PWR）。
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应用手册 Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
选择指南 逻辑器件指南 2014 (Rev. AA) 最新英语版本 (Rev.AB) 2014年 11月 17日
用户指南 LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
应用手册 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
用户指南 Signal Switch Data Book (Rev. A) 2003年 11月 14日
应用手册 Understanding Buffered and Unbuffered CD4xxxB Series Device Characteristics 2001年 12月 3日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑米6体育平台手机版_好二三四通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 旨在支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
英语版 (Rev.B): PDF | HTML
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封装 引脚 CAD 符号、封装和 3D 模型
PDIP (N) 16 Ultra Librarian
SOIC (D) 16 Ultra Librarian
SOP (NS) 16 Ultra Librarian
TSSOP (PW) 16 Ultra Librarian
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订购和质量

包含信息：
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

支持和培训

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