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CD74HC164

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高速 CMOS 逻辑 8 位串行输入/并行输出移位寄存器

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Configuration Serial-in, Parallel-out Bits (#) 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type Push-Pull Clock frequency (MHz) 24 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
Configuration Serial-in, Parallel-out Bits (#) 8 Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Input type Standard CMOS Output type Push-Pull Clock frequency (MHz) 24 IOL (max) (mA) 5.2 IOH (max) (mA) -5.2 Supply current (max) (µA) 160 Features Balanced outputs, High speed (tpd 10-50ns), Positive input clamp diode Operating temperature range (°C) -55 to 125 Rating Catalog
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6
  • 缓冲输入
  • 异步复位
  • 当 VCC = 5V，CL = 15pF，TA = 25°C 时，fMAX 典型值 = 60MHz
  • 扇出（过热范围）
    • 标准输出：10 个 LSTTL 负载
    • 总线驱动器输出：15 个 LSTTL 负载
  • 宽工作温度范围：–55°C 至 125°C
  • 平衡的传播延迟及转换时间
  • 与 LSTTL 逻辑 IC 相比，可显著降低功耗
  • HC 类型
    • 工作电压为 2V 至 6V
    • 高抗噪性：当 VCC = 5V 时，NIL = 30%，NIH = VCC 的 30%
  • HCT 类型
    • 工作电压为 4.5V 至 5.5V
    • 直接 LSTTL 输入逻辑兼容性，VIL = 0.8V（最大值），VIH = 2V（最小值）
    • CMOS 输入兼容性，当电压为 VOL、VOH 时，II ≤ 1µA
  • 缓冲输入
  • 异步复位
  • 当 VCC = 5V，CL = 15pF，TA = 25°C 时，fMAX 典型值 = 60MHz
  • 扇出（过热范围）
    • 标准输出：10 个 LSTTL 负载
    • 总线驱动器输出：15 个 LSTTL 负载
  • 宽工作温度范围：–55°C 至 125°C
  • 平衡的传播延迟及转换时间
  • 与 LSTTL 逻辑 IC 相比，可显著降低功耗
  • HC 类型
    • 工作电压为 2V 至 6V
    • 高抗噪性：当 VCC = 5V 时，NIL = 30%，NIH = VCC 的 30%
  • HCT 类型
    • 工作电压为 4.5V 至 5.5V
    • 直接 LSTTL 输入逻辑兼容性，VIL = 0.8V（最大值），VIH = 2V（最小值）
    • CMOS 输入兼容性，当电压为 VOL、VOH 时，II ≤ 1µA

’HC164 和 ’HCT164 是具有异步复位功能的 8 位串行输入/并行输出移位寄存器。数据在时钟 (CLK) 正边沿发生移位。复位 (CLR) 引脚上的低电平将移位寄存器复位，无论输入情况如何，所有输出均进入低电平状态。提供的两个串行数据输入（A 和 B）中的任一个都可用作数据使能控制。

’HC164 和 ’HCT164 是具有异步复位功能的 8 位串行输入/并行输出移位寄存器。数据在时钟 (CLK) 正边沿发生移位。复位 (CLR) 引脚上的低电平将移位寄存器复位，无论输入情况如何，所有输出均进入低电平状态。提供的两个串行数据输入（A 和 B）中的任一个都可用作数据使能控制。
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用户指南 Signal Switch Data Book (Rev. A) 2003年 11月 14日
应用手册 TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
应用手册 CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
应用手册 使用逻辑器件进行设计 (Rev. C) 1997年 6月 1日
应用手册 Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
应用手册 Live Insertion 1996年 10月 1日
应用手册 SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
应用手册 Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑米6体育平台手机版_好二三四通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 旨在支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
英语版 (Rev.B): PDF | HTML
TI.com 上无现货
封装 引脚 CAD 符号、封装和 3D 模型
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
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订购和质量

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