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Technology family GTL Applications GTL Rating Catalog Operating temperature range (°C) -40 to 85
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SOT-SC70 (DCK) 6 4.2 mm² 2 x 2.1
  • VDD Range: 3.0 V to 3.6 V
  • VTT Range: 1 V to 1.3 V
  • Provides Selectable GTL VREF
    • 0.615 × VTT
    • 0.63 × VTT
    • 0.65 × VTT
    • 0.67 × VTT
  • ±1% Resistor Ratio Tolerance
  • Ambient Temperature Range: -40°C to 85°C
  • ESD Protection Exceeds the Following Levels Tests (Tested Per JESD-22):
    • 2500-V Human-Body Model
      (A114-B, Class II)
    • 250-V Machine Model (A115-A)
    • 1500-V Charged-Device Model (C101)

  • VDD Range: 3.0 V to 3.6 V
  • VTT Range: 1 V to 1.3 V
  • Provides Selectable GTL VREF
    • 0.615 × VTT
    • 0.63 × VTT
    • 0.65 × VTT
    • 0.67 × VTT
  • ±1% Resistor Ratio Tolerance
  • Ambient Temperature Range: -40°C to 85°C
  • ESD Protection Exceeds the Following Levels Tests (Tested Per JESD-22):
    • 2500-V Human-Body Model
      (A114-B, Class II)
    • 250-V Machine Model (A115-A)
    • 1500-V Charged-Device Model (C101)

The SN74GTL3004 provides for a selectable GTL Voltage Reference (GTL VREF). The value of the GTL VREF can be adjusted using S0 and S1 select pins.

The S0 and S1 pins contain glitch-suppression circuitry for excellent noise immunity. When left floating, the S0 and S1 control input pins have 100-kµ pullups that set the GTL VREF default value to the 0.67 × VTT ratio
(S0 = 1 and S1 =1).

The SN74GTL3004 provides for a selectable GTL Voltage Reference (GTL VREF). The value of the GTL VREF can be adjusted using S0 and S1 select pins.

The S0 and S1 pins contain glitch-suppression circuitry for excellent noise immunity. When left floating, the S0 and S1 control input pins have 100-kµ pullups that set the GTL VREF default value to the 0.67 × VTT ratio
(S0 = 1 and S1 =1).

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类型 标题 下载最新的英语版本 日期
* 数据表 Selectable GTL Voltage Reference 数据表 (Rev. A) 2008年 4月 1日
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选择指南 Logic Guide (Rev. AB) 2017年 6月 12日
应用手册 Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
选择指南 逻辑器件指南 2014 (Rev. AA) 最新英语版本 (Rev.AB) 2014年 11月 17日
选择指南 《高级总线接口逻辑器件选择指南》 英语版 2010年 7月 7日
用户指南 LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
应用手册 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
应用手册 TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
应用手册 Power-Up 3-State (PU3S) Circuits in TI Standard Logic Devices 2002年 5月 10日
用户指南 GTLP/GTL Logic High-Performance Backplane Drivers Data Book (Rev. A) 2001年 9月 15日
应用手册 GTL/BTL: A Low-Swing Solution for High-Speed Digital Logic (Rev. A) 1997年 3月 1日
应用手册 Understanding Advanced Bus-Interface Products Design Guide 1996年 5月 1日

设计和开发

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评估板

5-8-LOGIC-EVM — 支持 5 至 8 引脚 DCK、DCT、DCU、DRL 和 DBV 封装的通用逻辑评估模块

灵活的 EVM 设计用于支持具有 5 至 8 引脚数且采用 DCK、DCT、DCU、DRL 或 DBV 封装的任何器件。
用户指南: PDF
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仿真模型

HSPICE Model for SN74GTL3004

SCBJ169.ZIP (92 KB) - HSpice Model
封装 引脚 CAD 符号、封装和 3D 模型
SOT-SC70 (DCK) 6 Ultra Librarian

订购和质量

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  • REACH
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  • 引脚镀层/焊球材料
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  • 鉴定摘要
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