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Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 8 IOL (max) (mA) 6 Supply current (max) (µA) 80 IOH (max) (mA) -6 Input type Standard CMOS Output type 3-State Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
Technology family HC Supply voltage (min) (V) 2 Supply voltage (max) (V) 6 Number of channels 8 IOL (max) (mA) 6 Supply current (max) (µA) 80 IOH (max) (mA) -6 Input type Standard CMOS Output type 3-State Features Balanced outputs, Input clamp diode, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 85
PDIP (N) 20 228.702 mm² 24.33 x 9.4 SOIC (DW) 20 131.84 mm² 12.8 x 10.3 SOP (NS) 20 98.28 mm² 12.6 x 7.8 SSOP (DB) 20 56.16 mm² 7.2 x 7.8 TSSOP (PW) 20 41.6 mm² 6.5 x 6.4
  • 2V 至 6V 的宽工作电压范围
  • 高电流三态输出直接驱动总线或多达 15 个 LSTTL 负载
  • 低功耗,ICC 最大值为 80µA
  • tpd典型值 = 10 ns
  • ±6mA 输出驱动(电压为 5V 时)
  • 低输入电流,最大值为 1µA
  • 数据直通式引脚排列(所有输入均在输出对侧)
  • 2V 至 6V 的宽工作电压范围
  • 高电流三态输出直接驱动总线或多达 15 个 LSTTL 负载
  • 低功耗,ICC 最大值为 80µA
  • tpd典型值 = 10 ns
  • ±6mA 输出驱动(电压为 5V 时)
  • 低输入电流,最大值为 1µA
  • 数据直通式引脚排列(所有输入均在输出对侧)

这些八路缓冲器和线路驱动器具有 SNx4HC541 器件的性能,以及封装两侧输入和输出的引脚排列。这种布置非常有助于印刷电路板布局布线。

三态输出由双输入或非门控制。如果任一输出使能端(OE1OE2)输入为高电平,则所有八路输出均处于高阻抗状态。SNx4HC541 器件在输出端提供真实数据。

这些八路缓冲器和线路驱动器具有 SNx4HC541 器件的性能,以及封装两侧输入和输出的引脚排列。这种布置非常有助于印刷电路板布局布线。

三态输出由双输入或非门控制。如果任一输出使能端(OE1OE2)输入为高电平,则所有八路输出均处于高阻抗状态。SNx4HC541 器件在输出端提供真实数据。

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* 数据表 SNx4HC541 具有三态输出的八路缓冲器和线路驱动器 数据表 (Rev. E) PDF | HTML 英语版 (Rev.E) PDF | HTML 2022年 5月 31日
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选择指南 Logic Guide (Rev. AB) 2017年 6月 12日
应用手册 Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
选择指南 逻辑器件指南 2014 (Rev. AA) 最新英语版本 (Rev.AB) 2014年 11月 17日
用户指南 LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
应用手册 Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
用户指南 Signal Switch Data Book (Rev. A) 2003年 11月 14日
应用手册 TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
应用手册 CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
应用手册 使用逻辑器件进行设计 (Rev. C) 1997年 6月 1日
应用手册 Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
应用手册 Live Insertion 1996年 10月 1日
应用手册 SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
应用手册 Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

设计和开发

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评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑米6体育平台手机版_好二三四通用评估模块

14-24-LOGIC-EVM 评估模块 (EVM) 旨在支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。

用户指南: PDF | HTML
英语版 (Rev.B): PDF | HTML
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仿真模型

SN74HC541 Behavioral SPICE Model

SCLM210.ZIP (7 KB) - PSpice Model
封装 引脚 CAD 符号、封装和 3D 模型
PDIP (N) 20 Ultra Librarian
SOIC (DW) 20 Ultra Librarian
SOP (NS) 20 Ultra Librarian
SSOP (DB) 20 Ultra Librarian
TSSOP (PW) 20 Ultra Librarian

订购和质量

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  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
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