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SN74LVCZ244A

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具有三态输出的 8 通道、2.7V 至 3.6V 缓冲器

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SN74LVCZ244A

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米6体育平台手机版_好二三四详情

Technology family LVC Supply voltage (min) (V) 2.7 Supply voltage (max) (V) 3.6 Number of channels 8 IOL (max) (mA) 24 Supply current (max) (µA) 100 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Damping resistors, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
Technology family LVC Supply voltage (min) (V) 2.7 Supply voltage (max) (V) 3.6 Number of channels 8 IOL (max) (mA) 24 Supply current (max) (µA) 100 IOH (max) (mA) -24 Input type Standard CMOS Output type 3-State Features Balanced outputs, Damping resistors, Very high speed (tpd 5-10ns) Rating Catalog Operating temperature range (°C) -40 to 125
SOIC (DW) 20 131.84 mm² 12.8 x 10.3 SOP (NS) 20 98.28 mm² 12.6 x 7.8 SSOP (DB) 20 56.16 mm² 7.2 x 7.8 TSSOP (PW) 20 41.6 mm² 6.5 x 6.4
  • Operates From 2.7 V to 3.6 V
  • Inputs Accept Voltages to 5.5 V
  • Max tpd of 5.9 ns at 3.3 V
  • Typical VOLP (Output Ground Bounce)
    < 0.8 V at VCC = 3.3 V, TA = 25°C
  • Typical VOHV (Output VOH Undershoot)
    > 2 V at VCC = 3.3 V, TA = 25°C
  • Ioff Supports Live Insertion, Partial-Power-
    Down Mode, and Back-Drive Protection
  • Supports Mixed-Mode Signal Operation
    on All Ports (5-V Input/Output Voltage
    With 3.3-V VCC)
  • Latch-Up Performance Exceeds 100 mA
    Per JESD 78, Class II
  • Operates From 2.7 V to 3.6 V
  • Inputs Accept Voltages to 5.5 V
  • Max tpd of 5.9 ns at 3.3 V
  • Typical VOLP (Output Ground Bounce)
    < 0.8 V at VCC = 3.3 V, TA = 25°C
  • Typical VOHV (Output VOH Undershoot)
    > 2 V at VCC = 3.3 V, TA = 25°C
  • Ioff Supports Live Insertion, Partial-Power-
    Down Mode, and Back-Drive Protection
  • Supports Mixed-Mode Signal Operation
    on All Ports (5-V Input/Output Voltage
    With 3.3-V VCC)
  • Latch-Up Performance Exceeds 100 mA
    Per JESD 78, Class II

This octal buffer/line driver is designed for 2.7-V to 3.6-V VCC operation.

The SN74LVCZ244A device is organized as two 4-bit line drivers with separate output-enable (OE) inputs. When OE is low, the device passes data from the A inputs to the Y outputs. When OE is high, the outputs are in the high-impedance state.

This octal buffer/line driver is designed for 2.7-V to 3.6-V VCC operation.

The SN74LVCZ244A device is organized as two 4-bit line drivers with separate output-enable (OE) inputs. When OE is low, the device passes data from the A inputs to the Y outputs. When OE is high, the outputs are in the high-impedance state.
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应用手册 Input and Output Characteristics of Digital Integrated Circuits 1996年 10月 1日
应用手册 Live Insertion 1996年 10月 1日
设计指南 Low-Voltage Logic (LVC) Designer's Guide 1996年 9月 1日
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设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑米6体育平台手机版_好二三四通用评估模块

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用户指南: PDF | HTML
英语版 (Rev.B): PDF | HTML
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