JAJSI11B
October 2019 – February 2021
ADS131M08
PRODUCTION DATA
1
特長
2
アプリケーション
3
概要
4
Revision History
5
Pin Configuration and Functions
6
Specifications
6.1
Absolute Maximum Ratings
6.2
ESD Ratings
6.3
Recommended Operating Conditions
6.4
Thermal Information
6.5
Electrical Characteristics
6.6
Timing Requirements
6.7
Switching Characteristics
6.8
Timing Diagrams
6.9
Typical Characteristics
7
Parameter Measurement Information
7.1
Noise Measurements
8
Detailed Description
8.1
Overview
8.2
Functional Block Diagram
8.3
Feature Description
8.3.1
Input ESD Protection Circuitry
8.3.2
Input Multiplexer
8.3.3
Programmable Gain Amplifier (PGA)
8.3.4
Voltage Reference
8.3.5
Clocking and Power Modes
8.3.6
ΔΣ Modulator
8.3.7
Digital Filter
8.3.7.1
Digital Filter Implementation
8.3.7.1.1
Fast-Settling Filter
8.3.7.1.2
SINC3 and SINC3 + SINC1 Filter
8.3.7.2
Digital Filter Characteristic
8.3.8
DC Block Filter
8.3.9
Internal Test Signals
8.3.10
Channel Phase Calibration
8.3.11
Calibration Registers
8.3.12
Communication Cyclic Redundancy Check (CRC)
8.3.13
Register Map CRC
8.4
Device Functional Modes
8.4.1
Power-Up and Reset
8.4.1.1
Power-On Reset
8.4.1.2
SYNC/RESET Pin
8.4.1.3
RESET Command
8.4.2
Fast Startup Behavior
8.4.3
Conversion Modes
8.4.3.1
Continuous-Conversion Mode
8.4.3.2
Global-Chop Mode
8.4.4
Power Modes
8.4.5
Standby Mode
8.4.6
Current-Detect Mode
8.5
Programming
8.5.1
Interface
8.5.1.1
Chip Select (CS)
8.5.1.2
Serial Data Clock (SCLK)
8.5.1.3
Serial Data Input (DIN)
8.5.1.4
Serial Data Output (DOUT)
8.5.1.5
Data Ready (DRDY)
8.5.1.6
Conversion Synchronization or System Reset (SYNC/RESET)
8.5.1.7
SPI Communication Frames
8.5.1.8
SPI Communication Words
8.5.1.9
ADC Conversion Data
8.5.1.9.1
Collecting Data for the First Time or After a Pause in Data Collection
8.5.1.10
Commands
8.5.1.10.1
NULL (0000 0000 0000 0000)
8.5.1.10.2
RESET (0000 0000 0001 0001)
8.5.1.10.3
STANDBY (0000 0000 0010 0010)
8.5.1.10.4
WAKEUP (0000 0000 0011 0011)
8.5.1.10.5
LOCK (0000 0101 0101 0101)
8.5.1.10.6
UNLOCK (0000 0110 0110 0110)
8.5.1.10.7
RREG (101a aaaa annn nnnn)
8.5.1.10.7.1
Reading a Single Register
8.5.1.10.7.2
Reading Multiple Registers
8.5.1.10.8
WREG (011a aaaa annn nnnn)
8.5.1.11
Short SPI Frames
8.5.2
Synchronization
8.6
Registers
9
Application and Implementation
9.1
Application Information
9.1.1
Unused Inputs and Outputs
9.1.2
Antialiasing
9.1.3
Minimum Interface Connections
9.1.4
Power Metrology Applications
9.1.5
Multiple Device Configuration
9.1.6
Code Example
9.1.7
Troubleshooting
9.2
Typical Application
9.2.1
Design Requirements
9.2.2
Detailed Design Procedure
9.2.2.1
Voltage Measurement Front-End
9.2.2.2
Current Measurement Front-End
9.2.2.3
ADC Setup
9.2.2.4
Calibration
9.2.2.5
Formulae
9.2.3
Application Curves
10
Power Supply Recommendations
10.1
CAP Pin Behavior
10.2
Power-Supply Sequencing
10.3
Power-Supply Decoupling
11
Layout
11.1
Layout Guidelines
11.2
Layout Example
12
Device and Documentation Support
12.1
Documentation Support
12.1.1
Related Documentation
12.2
ドキュメントの更新通知を受け取る方法
12.3
サポート・リソース
12.4
Trademarks
12.5
静電気放電に関する注意事項
12.6
用語集
13
Mechanical, Packaging, and Orderable Information
パッケージ・オプション
メカニカル・データ(パッケージ|ピン)
PBS|32
MPQF027A
RSN|32
MPQF194B
サーマルパッド・メカニカル・データ
PBS|32
QFND381
RSN|32
QFND189E
発注情報
jajsi11b_oa
jajsi11b_pm
1
特長
8
同時サンプリング差動入力
プログラマブル・データ・レート:最大 32kSPS
プログラマブル・ゲイン:最大 128
ノイズ特性
ゲイン = 1、4kSPS で 102dB のダイナミック・レンジ
ゲイン = 64、4kSPS で 80dB のダイナミック・レンジ
全高調波歪み:-100dB
センサと直接接続できる高インピーダンス入力
330kΩ の入力インピーダンス
(ゲイン = 1、2、4 の場合)
1MΩ 以上の入力インピーダンス
(ゲイン = 8、16、32、64、128 の場合)
プログラム可能なチャネル間位相遅延較正
244ns の分解能、8.192MHz の f
CLKIN
電流検出モードにより、非常に低い消費電力で改ざん検出が可能
高速なスタートアップ:最初のデータは電源ランプから 0.5ms 以内
内蔵された負チャージ・ポンプにより、グランドより低い入力信号に対応が可能
チャネル間のクロストーク:-120dB
低ドリフトの内部基準電圧
通信およびレジスタ・マップでの巡回冗長性検査 (CRC)
2.7V~3.6V のアナログおよびデジタル電源
低消費電力3V AVDD および DVDD で 6.0mW
パッケージ:32 ピン TQFP または 32 ピン WQFN
動作温度範囲:–40℃~+125℃
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