JAJSL67A
June 2021 – February 2023
LM25148-Q1
PRODUCTION DATA
1
特長
2
アプリケーション
3
概要
4
Revision History
5
概要 (続き)
6
Pin Configuration and Functions
6.1
Wettable Flanks
7
Specifications
7.1
Absolute Maximum Ratings
7.2
ESD Ratings
7.3
Recommended Operating Conditions
7.4
Thermal Information
7.5
Electrical Characteristics
7.6
Typical Characteristics
8
Detailed Description
8.1
Overview
8.2
Functional Block Diagram
8.3
Feature Description
8.3.1
Input Voltage Range (VIN)
8.3.2
High-Voltage Bias Supply Regulator (VCC, VCCX, VDDA)
8.3.3
Precision Enable (EN)
8.3.4
Power-Good Monitor (PG)
8.3.5
Switching Frequency (RT)
8.3.6
Dual Random Spread Spectrum (DRSS)
8.3.7
Soft Start
8.3.8
Output Voltage Setpoint (FB)
8.3.9
Minimum Controllable On Time
8.3.10
Error Amplifier and PWM Comparator (FB, EXTCOMP)
8.3.11
Slope Compensation
8.3.12
Inductor Current Sense (ISNS+, VOUT)
8.3.12.1
Shunt Current Sensing
8.3.12.2
Inductor DCR Current Sensing
8.3.13
Hiccup Mode Current Limiting
8.3.14
High-Side and Low-Side Gate Drivers (HO, LO)
8.3.15
Output Configurations (CNFG)
8.3.16
Single-Output Dual-Phase Operation
8.4
Device Functional Modes
8.4.1
Sleep Mode
8.4.2
Pulse Frequency Modulation and Synchronization (PFM/SYNC)
8.4.3
Thermal Shutdown
9
Application and Implementation
9.1
Application Information
9.1.1
Power Train Components
9.1.1.1
Buck Inductor
9.1.1.2
Output Capacitors
9.1.1.3
Input Capacitors
9.1.1.4
Power MOSFETs
9.1.1.5
EMI Filter
9.1.2
Error Amplifier and Compensation
9.2
Typical Applications
9.2.1
Design 1 – High Efficiency 2.1-MHz Synchronous Buck Regulator
9.2.1.1
Design Requirements
9.2.1.2
Detailed Design Procedure
9.2.1.2.1
Custom Design with WEBENCH® Tools
9.2.1.2.2
Buck Inductor
9.2.1.2.3
Current-Sense Resistance
9.2.1.2.4
Output Capacitors
9.2.1.2.5
Input Capacitors
9.2.1.2.6
Frequency Set Resistor
9.2.1.2.7
Feedback Resistors
9.2.1.2.8
Compensation Components
9.2.1.3
Application Curves
9.2.2
Design 2 – High Efficiency 440-kHz Synchronous Buck Regulator
9.2.2.1
Design Requirements
9.2.2.2
Detailed Design Procedure
9.2.2.3
Application Curves
9.2.3
Design 3 – Dual-Phase 400-kHz 20-A Synchronous Buck Regulator
9.2.3.1
Design Requirements
9.2.3.2
Detailed Design Procedure
9.2.3.3
Application Curves
9.3
Power Supply Recommendations
9.4
Layout
9.4.1
Layout Guidelines
9.4.1.1
Power Stage Layout
9.4.1.2
Gate-Drive Layout
9.4.1.3
PWM Controller Layout
9.4.1.4
Thermal Design and Layout
9.4.1.5
Ground Plane Design
9.4.2
Layout Example
10
Device and Documentation Support
10.1
Device Support
10.1.1
Development Support
10.1.1.1
Custom Design with WEBENCH® Tools
10.2
Documentation Support
10.2.1
Related Documentation
10.2.1.1
PCB Layout Resources
10.2.1.2
Thermal Design Resources
10.3
ドキュメントの更新通知を受け取る方法
10.4
サポート・リソース
10.5
Trademarks
10.6
静電気放電に関する注意事項
10.7
用語集
11
Mechanical, Packaging, and Orderable Information
パッケージ・オプション
メカニカル・データ(パッケージ|ピン)
RGY|24
MPQF143E
サーマルパッド・メカニカル・データ
RGY|24
QFND668
発注情報
jajsl67a_oa
1
特長
車載アプリケーション用に AEC-Q100 認定済み:
デバイス温度グレード 1:-40℃~+125℃ の動作時周囲温度範囲
機能安全対応
機能安全システムの設計に役立つ資料
EMI 低減機能を内蔵
低周波数帯域と高周波数帯域にわたり
EMI 性能を向上させる
選択可能なデュアル・ランダム・スペクトラム拡散 (DRSS)
CISPR 25 Class 5 要件
に合わせて最適化
多用途な同期整流式降圧 DC/DC コントローラ
3.5V~
42V
の広い入力電圧範囲
精度 1% の固定 3.3V、5V、12V 出力または可変出力 (0.8V~
36V
)
最大接合部温度:150℃
ロスレス DCR またはシャント電流センシング
シャットダウン・モード電流:2.3μA
無負荷スリープ電流:9.5μA
3ms の内部ソフト・スタート・ランプ
最大 2 フェーズまでスタック可能
内部ブートストラップ・ダイオード
スイッチング周波数:100kHz~2.2MHz
SYNC In および SYNC Out 機能
PFM または FPWM モードを選択可能
堅牢な設計のための本質的な保護機能
内部ヒカップ・モード過電流保護
ENABLE および PGOOD 機能
VCC、VDDA、ゲート・ドライブの UVLO 保護
内部または外部ループ補償
ヒステリシス付きのサーマル・シャットダウン保護
WEBENCH®
Power Designer
により LM25148-Q1 を使用するカスタム設計を作成
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