JAJSOK0
November 2022
LMG3522R030
PRODUCTION DATA
1
特長
2
アプリケーション
3
概要
4
Revision History
5
Pin Configuration and Functions
6
Specifications
6.1
Absolute Maximum Ratings
6.2
ESD Ratings
6.3
Recommended Operating Conditions
6.4
Thermal Information
6.5
Electrical Characteristics
6.6
Switching Characteristics
6.7
Typical Characteristics
7
Parameter Measurement Information
7.1
Switching Parameters
7.1.1
Turn-On Times
7.1.2
Turn-Off Times
7.1.3
Drain-Source Turn-On Slew Rate
8
Detailed Description
8.1
Overview
8.2
Functional Block Diagram
8.3
Feature Description
8.3.1
GaN FET Operation Definitions
8.3.2
Direct-Drive GaN Architecture
8.3.3
Drain-Source Voltage Capability
8.3.4
Internal Buck-Boost DC-DC Converter
8.3.5
VDD Bias Supply
8.3.6
Auxiliary LDO
8.3.7
Fault Detection
8.3.7.1
Overcurrent Protection and Short-Circuit Protection
8.3.7.2
Overtemperature Shutdown
8.3.7.3
UVLO Protection
8.3.7.4
Fault Reporting
8.3.8
Drive Strength Adjustment
8.3.9
Temperature-Sensing Output
8.3.10
Ideal-Diode Mode Operation
8.3.10.1
Overtemperature-Shutdown Ideal-Diode Mode
8.4
Start Up Sequence
8.5
Safe Operation Area (SOA)
8.5.1
Safe Operation Area (SOA) - Repetitive SOA
8.6
Device Functional Modes
9
Application and Implementation
9.1
Application Information
9.2
Typical Application
9.2.1
Design Requirements
9.2.2
Detailed Design Procedure
9.2.2.1
Slew Rate Selection
9.2.2.1.1
Start-Up and Slew Rate With Bootstrap High-Side Supply
9.2.2.2
Signal Level-Shifting
9.2.2.3
Buck-Boost Converter Design
9.2.3
Application Curves
9.3
Do's and Don'ts
9.4
Power Supply Recommendations
9.4.1
Using an Isolated Power Supply
9.4.2
Using a Bootstrap Diode
9.4.2.1
Diode Selection
9.4.2.2
Managing the Bootstrap Voltage
9.5
Layout
9.5.1
Layout Guidelines
9.5.1.1
Solder-Joint Reliability
9.5.1.2
Power-Loop Inductance
9.5.1.3
Signal-Ground Connection
9.5.1.4
Bypass Capacitors
9.5.1.5
Switch-Node Capacitance
9.5.1.6
Signal Integrity
9.5.1.7
High-Voltage Spacing
9.5.1.8
Thermal Recommendations
9.5.2
Layout Examples
10
Device and Documentation Support
10.1
Documentation Support
10.1.1
Related Documentation
10.2
Receiving Notification of Documentation Updates
10.3
サポート・リソース
10.4
Trademarks
10.5
Electrostatic Discharge Caution
10.6
Export Control Notice
10.7
Glossary
11
Mechanical, Packaging, and Orderable Information
パッケージ・オプション
メカニカル・データ(パッケージ|ピン)
RQS|52
MPQF571F
サーマルパッド・メカニカル・データ
RQS|52
QFND671A
発注情報
jajsok0_oa
1
特長
ゲート・ドライバ内蔵の
650
-V GaN オン Si FET
高精度のゲート・バイアス電圧を内蔵
FET ホールド・オフ:200V/ns
2
MHz のスイッチング周波数
20V/ns~150V/ns のスルーレートによりスイッチング性能の最適化と EMI の軽減
7.5V~18V 電源で動作
堅牢な保護
サイクル単位の過電流保護と応答時間 100ns 未満のラッチ付き短絡保護
ハード・スイッチング中のサージ耐性:720V
内部過熱および UVLO 監視機能による自己保護
高度な電源管理
デジタル温度 PWM 出力
上面から放熱する 12mm × 12mm の VQFN パッケージにより、電気的経路と熱的経路を分離することで電力ループのインダクタンスを最小化
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