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AFE79XX-HSC-DESIGN — AFE79xx family high-speed transceiver design & support files
Find detailed product information on the AFE79xx product family (datasheets, EVM resources, software and firmware, reference designs, etc)
AFE7900
- 申请完整数据表
- 四通道射频采样 12 GSPS 发送 DAC
- 四通道射频采样 3 GSPS 接收 ADC
- 双通道射频采样 3 GSPS 反馈（辅助 RX）ADC
- 最大射频信号带宽：
- 4TX 或 2FB：1200 MHz 或 2TX：2400 MHz
- RX）：1200 MHz（无 FB）、600 MHz（带 FB）
- 射频频率范围：
- TX： 5MHz - 7.4GHz
- RX/FB： 5MHz - 7.4GHz
- 数字步进衰减器 (DSA)：
- TX：40 dB 范围，0.125 dB 步进
- RX 或 FB：25 dB 范围，0.5 dB 步进
- 用于 TX 和 RX 的单频带或双频带 DUC/DDC
- 每个 TX/RX 和 FB 为 16 个 NCO
- 可选内部 PLL/VCO，提供 DAC 或 ADC 采样率下的 DAC/ADC 时钟或外部时钟
- Sysref 对齐检测器
- 串行器/解串器数据接口：
- 可兼容 JESD204B 和 JESD204C
- 8 个高达 29.5 Gbps 的串行器/解串器收发器
- 子类 1 多器件同步
- 封装：17mm × 17mm FCBGA，间距 0.8 mm
AFE7900 是一款高性能、高带宽、多通道收发器，集成了四个射频采样发送链、四个射频采样接收链和两个射频采样反馈链（总计六个射频采样 ADC）。此器件具有高达 7.4GHz 的工作频率，支持直接在 L、S 和 C 频带频率范围内进行射频采样，无需额外的频率转换级。密度和灵活性提高后可支持高通道数、多任务系统。
TX 信号路径支持插值和数字上变频选项，从而为四个 TX 提供高达 1200MHz 的信号带宽，或者为两个 TX 提供高达 2400MHz 的信号带宽。DUC 的输出驱动一个 12GSPS DAC（数模转换器），通过混合模式输出选项增强在第二奈奎斯特区的运行。DAC 输出包括一个具有 40dB 范围以及 1dB 模拟和 0.125dB 数字步进的可变增益放大器 (TX DSA)。
每个接收器链均包含一个 25dB 范围的数字步进衰减器 (DSA)，后跟一个 3GSPS 模数转换器 (ADC)。每个接收器通道都有多个模拟峰值功耗检测器和各种数字功耗检测器，可辅助进行外部或内部自主自动增益控制器，另外还具有一个射频过载检测器，用于提供器件可靠性保护。灵活的抽取选项可为数据带宽提供高达 1200MHz 的优化（对于四条不带 FB 路径的 RX），或为带两条 FB 路径（每条 1200MHz 带宽）提供 600MHz 的优化。
该器件包含一个 SYSREF 时序检测器，用于优化相对于器件时钟的 SYSREF 输入时序。
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技术文档
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| 证书 | AFE7900EVM EU RoHS Declaration of Conformity (DoC) | 2021年 6月 3日 | ||||
| 应用手册 | How to Achieve Frequency Hopping with the AFE79xx | 2020年 7月 2日 |
设计和开发
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评估板
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AFE7900 评估模块 (EVM) 是一个射频采样收发器平台，通过配置可同时支持最多四个发送、四个接收和两个反馈 (4T4R+2FB) 通道。
此模块可评估 AFE7900 四通道、射频采样模拟前端 (AFE)，后者具有 14 位 12GSPS 数模转换器 (DAC)、14 位 3GSPS 模数转换器 (ADC) 以及为 DAC 和 ADC 生成高频时钟的片上集成锁相环/压控振荡器 (PLL/VCO)。
AFE7900EVM 可在每个通道使用双频带数字升压转换器和降压转换器，从而同时将具有高动态范围的多个宽带信号合成并实现数字化。接收通道支持片上集成数字步进衰减器 (DSA)，发送通道支持 (...)
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超声波 AFE
射频采样收发器
硬件开发
评估板
软件
支持软件
参考设计
TIDA-010230 — 适用于雷达和 EW 应用的多通道射频收发器、低噪声时钟参考设计
在现代雷达和电子战 (EW) 系统中，有源电子扫描阵列 (AESA) 天线系统通常与高速多通道射频收发器一起使用。这些系统需要噪声极低的时钟，以便进行精确的通道间偏移调整，实现出色的系统性能，如信噪比 (SNR)、无杂散动态范围 (SFDR)、IMD3 和有效位数 (ENOB)。该参考设计展示了基于 LMX2820 和 LMK04832 且符合 JESD204B 标准的低噪声时钟，可让多个 AFE7950 在高达 X 带的频率范围内运行，并以小于 10ps 的时间实现器件同步，同时在 9GSPS、3GSPS DAC 或 ADC 时钟下提高系统性能。
设计指南: PDF
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| FCBGA (ABJ) | 400 | Ultra Librarian |
| FCBGA (ALK) | 400 | Ultra Librarian |
订购和质量
包含信息：
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- 引脚镀层/焊球材料
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