SN54AHC138
- 工作范围为 2V 至 5.5V VCC
- 专门为高速存储器解码器和数据传输系统设计
- 包含三个使能输入以简化级联和/或数据接收
- 闩锁性能超过 250mA,符合 JESD 17 规范
- ESD 保护性能超过 JESD 22 规范要求:
- 2000V 人体放电模型 (A114-A)
- 1000V 充电器件模型 (C101)
SNx4AHC138 解码器/多路信号分离器设计用于需要极短传播延迟时间的高性能存储器解码和数据路由应用。在高性能存储器系统中,可使用此类解码器来尽可能地消除系统解码的影响。与使用高速使能电路的高速存储器一同使用时,这些解码器的延迟时间和存储器的使能时间通常小于存储器的典型存取时间。这意味着解码器引起的有效系统延迟可以忽略不计。
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封装 | 引脚 | CAD 符号、封装和 3D 模型 |
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CDIP (J) | 16 | Ultra Librarian |
CFP (W) | 16 | Ultra Librarian |
LCCC (FK) | 20 | Ultra Librarian |
订购和质量
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