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TPS51116

アクティブ

DDR、DDR2、DDR3、DDR3L、LPDDR3、DDR4 向けの包括的な電源ソリューション用途の同期整流降圧コントローラ、3A LDO

製品詳細

Vin (min) (V) 3 Vin (max) (V) 28 Vout (min) (V) 0.75 Vout (max) (V) 3 Features Complete Solution, Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) -40 to 85 Iq (typ) (mA) 0.8 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L, DDR4, LPDDR2, LPDDR3
Vin (min) (V) 3 Vin (max) (V) 28 Vout (min) (V) 0.75 Vout (max) (V) 3 Features Complete Solution, Shutdown Pin for S3 Rating Catalog Operating temperature range (°C) -40 to 85 Iq (typ) (mA) 0.8 Product type DDR DDR memory type DDR, DDR2, DDR3, DDR3L, DDR4, LPDDR2, LPDDR3
HTSSOP (PWP) 20 41.6 mm² 6.5 x 6.4 VQFN (RGE) 24 16 mm² 4 x 4
  • 同期整流バック・コントローラ(VDDQ)
    • 広い入力電圧範囲: 3.0V~28V
    • 100ns負荷ステップ応答を実現するD−CAP™モード
    • 電流モードを選択することによりセラミック出力コンデンサに対応
    • S4/S5状態のソフトオフに対応
    • RDS(on)または抵抗による電流検知
    • 2.5V (DDR)、1.8V (DDR2)、
      1.5Vまでの可変(DDR3)、1.35V (DDR3L)、1.2V (LPDDR3およびDDR4)または
      出力範囲0.75V~3.0V
    • パワー・グッド、過電圧保護、低電圧保護機能
  • 3A LDO (VTT)、バッファ付き基準電圧(VREF)
    • 3Aのシンク/ソース可能
    • 電力損失の最適化に利用可能なLDO入力
    • 最小出力容量20µF (セラミック)
    • 低ノイズ、バッファ付きの10mA出力電流
    • 精度±20mV (VREF/VTT)
    • ハイ・インピーダンス(S3)およびソフトオフ(S4/S5)に対応
    • サーマル・シャットダウン
  • 同期整流バック・コントローラ(VDDQ)
    • 広い入力電圧範囲: 3.0V~28V
    • 100ns負荷ステップ応答を実現するD−CAP™モード
    • 電流モードを選択することによりセラミック出力コンデンサに対応
    • S4/S5状態のソフトオフに対応
    • RDS(on)または抵抗による電流検知
    • 2.5V (DDR)、1.8V (DDR2)、
      1.5Vまでの可変(DDR3)、1.35V (DDR3L)、1.2V (LPDDR3およびDDR4)または
      出力範囲0.75V~3.0V
    • パワー・グッド、過電圧保護、低電圧保護機能
  • 3A LDO (VTT)、バッファ付き基準電圧(VREF)
    • 3Aのシンク/ソース可能
    • 電力損失の最適化に利用可能なLDO入力
    • 最小出力容量20µF (セラミック)
    • 低ノイズ、バッファ付きの10mA出力電流
    • 精度±20mV (VREF/VTT)
    • ハイ・インピーダンス(S3)およびソフトオフ(S4/S5)に対応
    • サーマル・シャットダウン

TPS51116は、DDR/SSTL-2、DDR2/SSTL-18、DDR3/SSTL-15、DDR3L、LPDDR3、およびDDR4メモリ・システムに完全準拠した電源を提供します。本製品は、同期整流バック・コントローラ、3Aのシンク/ソース・トラッキング・リニア・レギュレータ、低ノイズのバッファ付き基準電圧を内蔵しています。TPS51116は小型、低コストが要求されるシステムに最適です。TPS51116の同期式コントローラは、アダプティブ・オンタイム・コントロール方式を用いた固定の400kHz擬似定周波数PWMで動作し、使い易さと高速過渡応答を優先した D-CAP™モード、またはセラミック出力コンデンサに対応する電流モードで構成することができます。3Aシンク/ソースのLDOは出力容量としてわずか20µF (2×10µF)のセラミック・コンデンサを用いるだけで高速な過渡応答を実現します。さらに、LDO電源入力を外部から取り入れて総電力損失を大きく低減することが可能です。TPS51116は、すべてのスリープ状態制御に対応しており、S3状態(RAMへのサスペンド)ではVTT出力をハイ・インピーダンスにし、S4/S5状態(ディスクへのサスペンド)ではVDDQ、VTT、VTTREFを放電してオフにします(ソフトオフ)。TPS51116はサーマル・シャットダウンを含むすべての保護機能を内蔵しており、20ピンHTSSOP PowerPAD™パッケージと24ピン4×4 QFNで供給されます。

TPS51116は、DDR/SSTL-2、DDR2/SSTL-18、DDR3/SSTL-15、DDR3L、LPDDR3、およびDDR4メモリ・システムに完全準拠した電源を提供します。本製品は、同期整流バック・コントローラ、3Aのシンク/ソース・トラッキング・リニア・レギュレータ、低ノイズのバッファ付き基準電圧を内蔵しています。TPS51116は小型、低コストが要求されるシステムに最適です。TPS51116の同期式コントローラは、アダプティブ・オンタイム・コントロール方式を用いた固定の400kHz擬似定周波数PWMで動作し、使い易さと高速過渡応答を優先した D-CAP™モード、またはセラミック出力コンデンサに対応する電流モードで構成することができます。3Aシンク/ソースのLDOは出力容量としてわずか20µF (2×10µF)のセラミック・コンデンサを用いるだけで高速な過渡応答を実現します。さらに、LDO電源入力を外部から取り入れて総電力損失を大きく低減することが可能です。TPS51116は、すべてのスリープ状態制御に対応しており、S3状態(RAMへのサスペンド)ではVTT出力をハイ・インピーダンスにし、S4/S5状態(ディスクへのサスペンド)ではVDDQ、VTT、VTTREFを放電してオフにします(ソフトオフ)。TPS51116はサーマル・シャットダウンを含むすべての保護機能を内蔵しており、20ピンHTSSOP PowerPAD™パッケージと24ピン4×4 QFNで供給されます。

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技術資料

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* データシート TPS51116 DDR/DDR2/DDR3/DDR3L/LPDDR3/DDR4完全準拠パワー・ソリューション同期整流バック・コントローラ、3A LDO、バッファ付き基準電圧 データシート (Rev. J 翻訳版) PDF | HTML 英語版 (Rev.J) PDF | HTML 2018年 1月 25日
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ユーザー・ガイド Using the TPS51116 (Rev. A) 2008年 11月 12日
アプリケーション・ノート Cyclone™ III FPGA Starter Kit Power Reference Design 2008年 3月 27日
アプリケーション・ノート DDR2 Power Solutions for Notebooks 2004年 5月 24日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

TPS51116EVM-001 — TPS51116EVM-001 評価モジュール

The TPS51116EVM evaluation module (EVM) is a dual-output converter for DDR and DDRII memory modules. It uses a 10 A synchronous buck converter to provide the core voltage (VDDQ) for DDR memory modules. The EVM is designed to use a 4.5 V to 28 V supply voltage and a 4.75 V to (...)

ユーザー ガイド: PDF
シミュレーション・モデル

TPS51116 PSpice Transient Model (Rev. B)

SLIM076B.ZIP (101 KB) - PSpice Model
シミュレーション・モデル

TPS51116 TINA-TI Transient Reference Design

SLUM166.TSC (224 KB) - TINA-TI Reference Design
シミュレーション・モデル

TPS51116 TINA-TI Transient Spice Model

SLUM167.ZIP (58 KB) - TINA-TI Spice Model
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
HTSSOP (PWP) 20 Ultra Librarian
VQFN (RGE) 24 Ultra Librarian

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブの拠点
  • 組み立てを実施した拠点

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