DS90LV032A
- >400 Mbps (200 MHz) Switching Rates
- 0.1-ns Channel-to-Channel Skew (Typical)
- 0.1-ns Differential Skew (Typical)
- 3.3-ns Maximum Propagation Delay
- 3.3-V Power Supply Design
- Power Down High Impedance on LVDS Inputs
- Low Power Design (40 mW at 3.3 V Static)
- Interoperable With Existing 5-V LVDS Networks
- Accepts Small Swing (350 mV Typical) VID
- Supports Open, Short, and Terminated Input Fail-Safe
- Compatible With ANSI/TIA/EIA-644
- Industrial Temperature Operating Range (–40°C to 85°C)
- Available in SOIC and TSSOP Packaging
The DS90LV032A is a quad CMOS differential line receiver designed for applications requiring ultra-low power dissipation and high data rates. The device is designed to support data rates in excess of 400 Mbps (200 MHz) using Low Voltage Differential Signaling (LVDS) technology.
The DS90LV032A accepts low voltage (350 mV typical) differential input signals and translates them to 3-V CMOS output levels. The receiver supports a TRI-STATE function that may be used to multiplex outputs. The receiver also supports open, shorted, and terminated (100 Ω) input Fail-safe. The receiver output is HIGH for all fail-safe conditions.
The DS90LV032A and companion LVDS line driver (for example, DS90LV031A) provide a new alternative to high power PECL or ECL devices for high speed point-to-point interface applications.
技术文档
类型 | 标题 | 下载最新的英语版本 | 日期 | |||
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* | 数据表 | DS90LV032A 3-V LVDS Quad CMOS Differential Line Receiver 数据表 (Rev. D) | PDF | HTML | 2016年 8月 24日 | ||
应用简报 | How Far, How Fast Can You Operate LVDS Drivers and Receivers? | 2018年 8月 3日 | ||||
应用简报 | How to Terminate LVDS Connections with DC and AC Coupling | 2018年 5月 16日 | ||||
更多文献资料 | Die D/S DS90LV032A MDS (PRELIMINARY) 3V LVDS Quad CMOS Diff Line Receive | 2012年 12月 20日 | ||||
应用手册 | AN-1110 LVDS Quad Dynamic I CC vs Frequency | 2004年 5月 15日 | ||||
应用手册 | An Overview of LVDS Technology | 1998年 10月 5日 |
设计和开发
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封装 | 引脚 | CAD 符号、封装和 3D 模型 |
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SOIC (D) | 16 | Ultra Librarian |
TSSOP (PW) | 16 | Ultra Librarian |
订购和质量
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