DS250DF810
- 具有集成信号调节功能的八通道多速率重定时器
- 所有通道均可独立锁定在 20.2752 至 25.8Gbps 的范围内（包括 10.3125Gbps、12.5Gbps 等子速率）
- 超低延迟：25.78125Gbps 数据速率下的典型延迟 < 500ps
- 单电源，无需低抖动参考时钟，集成交流耦合电容器以降低电路板布线复杂程度并节省物料清单 (BOM) 成本
- 集成 2×2 交叉点
- 自适应性连续时间线性均衡器 (CTLE)
- 自适应判决反馈均衡器 (DFE)
- 带有 3 抽头有限脉冲响应 (FIR) 滤波器的低抖动发射器
- 组合式均衡，在 12.9GHz 频率下支持 35dB 以上的通道损耗
- 可调节发送幅值：205mVppd 至 1225mVppd（典型值）
- 片上眼图张开度监视器 (EOM)，PRBS 模式校验器/发生器小型 8mm × 13mm BGA 封装，可轻松实现直通布线
- 独特引脚可实现在封装下方布置高速信号布线
- 支持兼容引脚的中继器
DS250DF810 是一款具有集成信号调节功能的八通道多速率重定时器。该器件用于扩展有损且存在串扰的远距离高速串行链路的延伸长度并提升稳定性，同时实现不高于 10-15 的比特误码率 (BER)。
DS250DF810 各通道的串行数据速率均可独立锁定在 20.6Gbps 至 25.8Gbps 的连续范围内或者支持的任意子速率（速率的一半和四分之一），包括 10.3125Gbps 和 12.5Gbps 等关键数据速率，从而允许 DS280BR810 进行独立通道前向纠错 (FEC)。
印刷电路板 (PCB) 上集成了物理交流耦合电容（TX 与 RX），无需使用外部电容。DS250DF810 具备一个单电源，能够最大限度地减少外部组件的数量。这些 特性 可降低 PCB 布线的复杂程度并节省 BOM 成本。
DS250DF230 的高级均衡 特性 包括：一个低抖动 3 抽头发送有限冲激响应 (FIR) 滤波器、一个自适应连续时间线性均衡器 (CTLE) 以及一个自适应判决反馈均衡器 (DFE)。支持针对具有多个连接器且存在串扰的有损互连和背板进行扩展。集成的时钟和数据恢复 (CDR) 功能可重置抖动预算并对高速串行数据进行重定时， 非常适用于前端口光学模块 应用。DS250DF810 对每个通道对采用 2x2 交叉点，可为主机同时提供通道交叉和扇出选项。
DS250DF810 可通过 SMBus 或外部 EEPROM 进行配置。单个 EEPROM 最多可由 16 个器件共享。非破坏性片上眼图监视器和 PRBS 发生器/校验器为系统内诊断提供支持。
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技术文档
| 类型 | 标题 | 下载最新的英语版本 | 日期 | |||
|---|---|---|---|---|---|---|
| * | 数据表 | DS250DF810 25Gbps 多速率 8 通道重定时器 数据表 (Rev. C) | PDF | HTML | 英语版 (Rev.C) | PDF | HTML | 2020年 6月 8日 |
| 应用手册 | 实施引脚兼容的以太网转接驱动器和重定时器 | PDF | HTML | 英语版 | PDF | HTML | 2024年 10月 30日 | |
| 应用手册 | 25G/28G 重定时器与转接驱动器在常见应用中的最优化实现 (Rev. B) | PDF | HTML | 英语版 (Rev.B) | PDF | HTML | 2023年 5月 15日 | |
| 应用手册 | DS2X0DF810 Junction Temperature Readback and Temperature Lock Range (TLR) Extens | PDF | HTML | 2021年 5月 24日 | |||
| EVM 用户指南 | DS250DF810EVM User's Guide (Rev. C) | 2019年 9月 3日 | ||||
| 应用手册 | DS280DF810/DS250DF810在通信系统中的快速编程指南 | 2019年 3月 11日 | ||||
| 应用手册 | Transmitter Optimization for ≥ 25Gbps Retimer Links | 2017年 9月 8日 | ||||
| 更多文献资料 | Advanced Signal Conditioning Made Easy and Efficient | 2017年 1月 12日 | ||||
| 模拟设计期刊 | Green box testing: A method for optimizing high-speed serial links | 2016年 7月 21日 | ||||
| 技术文章 | Designing a 25G system: 5 tips to balance power, performance and price | PDF | HTML | 2016年 2月 1日 | |||
| 应用手册 | Understanding EEPROM Programming for 25G and 28G Repeaters and Retimers | 2016年 1月 13日 |
设计和开发
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| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| FCCSP (ABV) | 135 | Ultra Librarian |
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