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隔离式栅极驱动器

UCC21225A

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具有双输入、5V UVLO 且采用 LGA 封装的 2.5kVrms、4A/6A 双通道隔离式栅极驱动器

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UCC21225A

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米6体育平台手机版_好二三四详情

Number of channels 2 Isolation rating Functional Withstand isolation voltage (VISO) (Vrms) 2500 Working isolation voltage (VIOWM) (Vrms) 792 Transient isolation voltage (VIOTM) (VPK) 3535 Power switch GaNFET, IGBT, MOSFET, SiCFET Peak output current (A) 6 Features Disable, Programmable dead time Output VCC/VDD (max) (V) 25 Output VCC/VDD (min) (V) 6.5 Input supply voltage (min) (V) 3 Input supply voltage (max) (V) 18 Propagation delay time (µs) 0.019 Input threshold CMOS, TTL Operating temperature range (°C) -40 to 125 Rating Catalog Bootstrap supply voltage (max) (V) 792 Rise time (ns) 6 Fall time (ns) 7 Undervoltage lockout (typ) (V) 5
Number of channels 2 Isolation rating Functional Withstand isolation voltage (VISO) (Vrms) 2500 Working isolation voltage (VIOWM) (Vrms) 792 Transient isolation voltage (VIOTM) (VPK) 3535 Power switch GaNFET, IGBT, MOSFET, SiCFET Peak output current (A) 6 Features Disable, Programmable dead time Output VCC/VDD (max) (V) 25 Output VCC/VDD (min) (V) 6.5 Input supply voltage (min) (V) 3 Input supply voltage (max) (V) 18 Propagation delay time (µs) 0.019 Input threshold CMOS, TTL Operating temperature range (°C) -40 to 125 Rating Catalog Bootstrap supply voltage (max) (V) 792 Rise time (ns) 6 Fall time (ns) 7 Undervoltage lockout (typ) (V) 5
VLGA (NPL) 13 25 mm² 5 x 5
  • Universal: Dual Low-Side, Dual High-Side or Half-Bridge Driver
  • 5 x 5 mm, Space-Saving LGA-13 Package
  • Switching Parameters:
    • 19-ns Typical Propagation Delay
    • 5-ns Maximum Delay Matching
    • 6-ns Maximum Pulse-Width Distortion
  • CMTI Greater than 100-V/ns
  • 4-A Peak Source, 6-A Peak Sink Output
  • TTL and CMOS Compatible Inputs
  • 3-V to 18-V Input VCCI Range
  • Up to 25-V VDD with 5-V UVLO
  • Programmable Overlap and Dead Time
  • Rejects Input Transients Shorter than 5-ns
  • Fast Disable for Power Sequencing
  • Safety-Related Certifications:
    • 3535-VPK Isolation per DIN V VDE V 0884-11:2017-01
    • 2500-VRMS Isolation for 1 Minute per UL 1577
    • CQC per GB4943.1-2011 (Planned)
  • Universal: Dual Low-Side, Dual High-Side or Half-Bridge Driver
  • 5 x 5 mm, Space-Saving LGA-13 Package
  • Switching Parameters:
    • 19-ns Typical Propagation Delay
    • 5-ns Maximum Delay Matching
    • 6-ns Maximum Pulse-Width Distortion
  • CMTI Greater than 100-V/ns
  • 4-A Peak Source, 6-A Peak Sink Output
  • TTL and CMOS Compatible Inputs
  • 3-V to 18-V Input VCCI Range
  • Up to 25-V VDD with 5-V UVLO
  • Programmable Overlap and Dead Time
  • Rejects Input Transients Shorter than 5-ns
  • Fast Disable for Power Sequencing
  • Safety-Related Certifications:
    • 3535-VPK Isolation per DIN V VDE V 0884-11:2017-01
    • 2500-VRMS Isolation for 1 Minute per UL 1577
    • CQC per GB4943.1-2011 (Planned)

The UCC21225A is an isolated dual-channel gate driver with 4-A source and 6-A sink peak current in a 5-mm x 5-mm LGA-13 package. It is designed to drive power transistors up to 5-MHz with best-in-class propagation delay and pulse-width distortion.

The input side is isolated from the two output drivers by a 2.5-kVRMS isolation barrier, with 100-V/ns minimum common-mode transient immunity (CMTI). Internal functional isolation between the two secondary side drivers allows working voltage up to 700-VDC.

This driver can be configured as two low-side, two high-side, or a half-bridge driver with programmable dead time (DT). A disable pin shuts down both outputs simultaneously when it is set high, and allows normal operation when left open or grounded.

The device accepts VDD supply voltages up to 25-V. A wide input VCCI range from 3-V to 18-V makes the driver suitable for interfacing with both analog and digital controllers. All the supply voltage pins have under voltage lock-out (UVLO) protection.

With all these advanced features, the UCC21225A enables high power density, high efficiency, and robustness in a wide variety of power applications.

The UCC21225A is an isolated dual-channel gate driver with 4-A source and 6-A sink peak current in a 5-mm x 5-mm LGA-13 package. It is designed to drive power transistors up to 5-MHz with best-in-class propagation delay and pulse-width distortion.

The input side is isolated from the two output drivers by a 2.5-kVRMS isolation barrier, with 100-V/ns minimum common-mode transient immunity (CMTI). Internal functional isolation between the two secondary side drivers allows working voltage up to 700-VDC.

This driver can be configured as two low-side, two high-side, or a half-bridge driver with programmable dead time (DT). A disable pin shuts down both outputs simultaneously when it is set high, and allows normal operation when left open or grounded.

The device accepts VDD supply voltages up to 25-V. A wide input VCCI range from 3-V to 18-V makes the driver suitable for interfacing with both analog and digital controllers. All the supply voltage pins have under voltage lock-out (UVLO) protection.

With all these advanced features, the UCC21225A enables high power density, high efficiency, and robustness in a wide variety of power applications.

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类型 标题 下载最新的英语版本 日期
* 数据表 UCC21225A 4-A, 6-A, 2.5-kVRMS Isolated Dual-Channel Gate Driver in LGA 数据表 (Rev. A) PDF | HTML 2018年 2月 7日
证书 VDE Certificate for Basic Isolation for DIN EN IEC 60747-17 (Rev. W) 2024年 1月 31日
应用手册 驱动芯片在应用中的常见问题分析与解决 2023年 1月 13日
应用简报 了解峰值源电流和灌电流 (Rev. A) 英语版 (Rev.A) 2020年 4月 29日
应用简报 适用于栅极驱动器的外部栅极电阻器设计指南 (Rev. A) 英语版 (Rev.A) 2020年 4月 29日
应用简报 How to Drive High Voltage GaN FETs with UCC21220A 2019年 3月 6日
证书 UL Certification E181974 Vol 4. Sec 8 (Rev. A) 2018年 7月 23日
证书 CQC Product Certificate 2 2018年 2月 7日
EVM 用户指南 Using the UCC21225AEVM-365 2017年 3月 14日

设计和开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

UCC21225AEVM-365 — UCC21225A 4A 和 6A、5.7kVRMS 隔离式双通道栅极驱动器评估模块

UCC21225AEVM-365 适用于评估 UCC21225ANPL，后者采用 5x5 LGA 封装，是一种具备 4A 源电流容量和 6A 峰值灌电流容量的隔离式双通道栅极驱动器。此 EVM 可用作驱动功率 MOSFET、IGBT 和 SiC MOSFET 的参考设计，具备 UCC21225A 引脚功能识别、组件选择指南以及 PCB 布局示例。
用户指南: PDF
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仿真模型

UCC21225A PSpice Transient Model

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仿真模型

UCC21225A Unencrypted PSpice Transient Model

SLUM575.ZIP (4 KB) - PSpice Model
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模拟工具

PSPICE-FOR-TI — 适用于 TI 设计和模拟工具的 PSpice®

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参考设计

PMP40988 — 变频、ZVS、5kW、基于 GaN 的两相图腾柱 PFC 参考设计

该参考设计为高密度高效 5kW 图腾柱功率因数校正 (PFC) 设计。设计采用两相图腾柱 PFC，能在可变频率和零电压开关 (ZVS) 条件下运行。控制器采用新拓扑和改进型三角电流模式 (iTCM)，能够减小尺寸并提高效率。设计方案为在 TMS320F280049C 微控制器内使用高性能处理内核，可在广泛的工作范围内保证效率。PFC 的运行频率范围为 100kHz 至 800kHz。峰值系统效率为 99%，该数值在 120W/in3 开放式框架功率密度下实现。
测试报告: PDF
参考设计

PMP23332 — 交错和多相反相降压/升压转换器参考设计

此参考设计使用 UCD3138064A 作为数字控制器来控制反相降压/升压，并支持两相峰值电流模式控制。此设计采用软开关技术来提高电源效率。输入电压范围为 -62V 至 -36V。输出电压范围可在 28V 至 52V 之间调节。默认输出电压为 48V，最大电流为 14A。
测试报告: PDF
参考设计

PMP20587 — 反相降压/升压参考设计

此参考设计使用 UCD3138064A 作为数字控制器，用来控制两相双轨反相降压/升压。此非隔离式转换器适用于无线射频电源。输入电压范围为 -35V 至 -60V。输出电压有两种。电源轨 1 的默认输出电压为 32V，最大电流为 8.5A；电源轨 2 的默认输出电压为 48V，最大电流为 5.5A。可调输出电压范围为 30V 至 56V。通过某些元件更改和固件更改，硬件可用于电流模式控制或转换模式控制，从而增加功率并提高负载瞬态性能。三种控制模式的测试结果会分别提供。
测试报告: PDF
原理图: PDF
参考设计

PMP21943 — 适用于功率放大器的 48V/25A 负转正同步降压/升压转换器参考设计

此参考设计是一个适用于功率放大器应用的负到正同步降压/升压转换器。该电路由额定 -48V 系统电源供电，可在电流为 25A 时提供 +48V 的输出电压。该设计使用两个双同步升压控制器，以 150kHz 的开关频率进行四相操作。可通过可选跳线将输出电压调节至 +30V。还可通过可选跳线进行单相至四相操作。
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原理图: PDF
封装 引脚 CAD 符号、封装和 3D 模型
VLGA (NPL) 13 Ultra Librarian
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  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

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