Buffered Inputs
Typical Propagation Delay
- 10ns at V_CC = 5V, T_A = 25°C, C_L = 50pF
Exceeds 2kV ESD Protection per MIL-STD-883, Method 3015
SCR-Latchup-Resistant CMOS Process and Circuit Design
Speed of Bipolar FAST™/AS/S with Significantly Reduced Power Consumption
Balanced Propagation Delays
AC Types Feature 1.5V to 5.5V Operation and Balanced Noise Immunity at 30% of the Supply
±24mA Output Drive Current
- Fanout to 15 FAST™ ICs
- Drives 50 Transmission Lines
Characterized for operation from –40° to 85°C

FAST™ is a Trademark of Fairchild Semiconductor.

Buffered Inputs
Typical Propagation Delay
- 10ns at V_CC = 5V, T_A = 25°C, C_L = 50pF
Exceeds 2kV ESD Protection per MIL-STD-883, Method 3015
SCR-Latchup-Resistant CMOS Process and Circuit Design
Speed of Bipolar FAST™/AS/S with Significantly Reduced Power Consumption
Balanced Propagation Delays
AC Types Feature 1.5V to 5.5V Operation and Balanced Noise Immunity at 30% of the Supply
±24mA Output Drive Current
- Fanout to 15 FAST™ ICs
- Drives 50 Transmission Lines
Characterized for operation from –40° to 85°C

FAST™ is a Trademark of Fairchild Semiconductor.

The ’AC280 and ’ACT280 are 9-bit odd/even parity generator/checkers that utilize Advanced CMOS Logic technology. Both even and odd parity outputs are available for checking or generating parity for words up to nine bits long. Even parity is indicated (E output to any input of an additional ’AC280, ’ACT280 parity checker.

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技術資料

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	種類	タイトル	最新の英語版をダウンロード	日付
*	データシート	9-Bit Odd/Even Parity Generator/Checker データシート (Rev. A)		2000年 5月 17日
	アプリケーション・ノート	Implications of Slow or Floating CMOS Inputs (Rev. E)		2021年 7月 26日
	セレクション・ガイド	Logic Guide (Rev. AB)		2017年 6月 12日
	アプリケーション・ノート	Understanding and Interpreting Standard-Logic Data Sheets (Rev. C)		2015年 12月 2日
	セレクション・ガイド	ロジック・ガイド (Rev. AA 翻訳版)	最新英語版 (Rev.AB)	2014年 11月 6日
	その他の技術資料	HiRel Unitrode Power Management Brochure		2009年 7月 7日
	ユーザー・ガイド	LOGIC Pocket Data Book (Rev. B)		2007年 1月 16日
	アプリケーション・ノート	Semiconductor Packing Material Electrostatic Discharge (ESD) Protection		2004年 7月 8日
	アプリケーション・ノート	TI IBIS File Creation, Validation, and Distribution Processes		2002年 8月 29日
	アプリケーション・ノート	CMOS Power Consumption and CPD Calculation (Rev. B)		1997年 6月 1日
	アプリケーション・ノート	Designing With Logic (Rev. C)		1997年 6月 1日
	アプリケーション・ノート	Input and Output Characteristics of Digital Integrated Circuits		1996年 10月 1日
	アプリケーション・ノート	Live Insertion		1996年 10月 1日
	アプリケーション・ノート	Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc		1996年 4月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジックデバイスをサポートする設計を採用しています。

ユーザーガイド: PDF | HTML

TI.com で取り扱いなし

パッケージ	ピン数	CAD シンボル、フットプリント、および 3D モデル
PDIP (N)	14	Ultra Librarian
SOIC (D)	14	Ultra Librarian

TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：

RoHS
REACH
デバイスのマーキング
リード端子の仕上げ / ボールの原材料
MSL 定格 / ピークリフロー
MTBF/FIT 推定値
使用原材料
認定試験結果
継続的な信頼性モニタ試験結果

記載されている情報：

ファブの拠点
組み立てを実施した拠点

サポートとトレーニング

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9 ビット、奇数 / 偶数パリティ・ジェネレータ / チェッカ