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CD74HCT125

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TTL 互換 CMOS 入力、3 ステート出力、4 チャネル、4.5V ～ 5.5V バッファ

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CD74HCT125

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製品詳細

Technology family HCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 4 IOL (max) (mA) 6 Supply current (max) (µA) 160 IOH (max) (mA) -6 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, High speed (tpd 10-50ns), Input clamp diode Rating Catalog Operating temperature range (°C) -55 to 125
Technology family HCT Supply voltage (min) (V) 4.5 Supply voltage (max) (V) 5.5 Number of channels 4 IOL (max) (mA) 6 Supply current (max) (µA) 160 IOH (max) (mA) -6 Input type TTL-Compatible CMOS Output type 3-State Features Balanced outputs, High speed (tpd 10-50ns), Input clamp diode Rating Catalog Operating temperature range (°C) -55 to 125
PDIP (N) 14 181.42 mm² 19.3 x 9.4 SOIC (D) 14 51.9 mm² 8.65 x 6
  • LSTTL 入力ロジック互換
    • VIL(max) = 0.8V、VIH(min) = 2V
  • CMOS 入力ロジック互換
    • II ≦ 1µA (VOL、VOH)
  • バッファ付き入力
  • 4.5V～5.5V で動作
  • 広い動作温度範囲：-55°C～+125℃
  • 最大 10 個の LSTTL 負荷ファンアウトに対応
  • LSTTL ロジック IC に比べて消費電力を大幅削減
  • LSTTL 入力ロジック互換
    • VIL(max) = 0.8V、VIH(min) = 2V
  • CMOS 入力ロジック互換
    • II ≦ 1µA (VOL、VOH)
  • バッファ付き入力
  • 4.5V～5.5V で動作
  • 広い動作温度範囲：-55°C～+125℃
  • 最大 10 個の LSTTL 負荷ファンアウトに対応
  • LSTTL ロジック IC に比べて消費電力を大幅削減

このデバイスには、3 ステート出力を備えた 4 つの独立したバッファが内蔵されています。各ゲートはブール関数 Y = A を正論理で実行します。

このデバイスには、3 ステート出力を備えた 4 つの独立したバッファが内蔵されています。各ゲートはブール関数 Y = A を正論理で実行します。
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技術資料

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種類 タイトル 最新の英語版をダウンロード 日付
* データシート CDx4HCT125 クワッド バッファ、3 ステート出力 データシート (Rev. A 翻訳版) PDF | HTML 英語版 (Rev.A) PDF | HTML 2024年 8月 30日
アプリケーション・ノート Implications of Slow or Floating CMOS Inputs (Rev. E) 2021年 7月 26日
セレクション・ガイド Logic Guide (Rev. AB) 2017年 6月 12日
アプリケーション・ノート Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) 2015年 12月 2日
セレクション・ガイド ロジック・ガイド (Rev. AA 翻訳版) 最新英語版 (Rev.AB) 2014年 11月 6日
ユーザー・ガイド LOGIC Pocket Data Book (Rev. B) 2007年 1月 16日
アプリケーション・ノート Semiconductor Packing Material Electrostatic Discharge (ESD) Protection 2004年 7月 8日
ユーザー・ガイド Signal Switch Data Book (Rev. A) 2003年 11月 14日
アプリケーション・ノート TI IBIS File Creation, Validation, and Distribution Processes 2002年 8月 29日
アプリケーション・ノート CMOS Power Consumption and CPD Calculation (Rev. B) 1997年 6月 1日
アプリケーション・ノート Designing With Logic (Rev. C) 1997年 6月 1日
アプリケーション・ノート SN54/74HCT CMOS Logic Family Applications and Restrictions 1996年 5月 1日
アプリケーション・ノート Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc 1996年 4月 1日

設計および開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

14-24-LOGIC-EVM — 14 ピンから 24 ピンの D、DB、DGV、DW、DYY、NS、PW の各パッケージに封止した各種ロジック製品向けの汎用評価基板

14-24-logic-EVM 評価基板は、14 ピンから 24 ピンの D、DW、DB、NS、PW、DYY、DGV の各パッケージに封止した各種ロジック デバイスをサポートする設計を採用しています。

ユーザー ガイド: PDF | HTML
TI.com で取り扱いなし
シミュレーション・モデル

CD74HCT125 Behavioral SPICE Model

SCHM099.ZIP (7 KB) - PSpice Model
ダウンロード
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (N) 14 Ultra Librarian
SOIC (D) 14 Ultra Librarian
TI の評価品に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用原材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブの拠点
  • 組み立てを実施した拠点

サポートとトレーニング

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